XMOS推出的基于其第三代xcore架构的xcore.ai系列可编程SoC芯片，在一颗器件里面集成了边缘AI、DSP、控制单元和I/O等功能，因而可以针对应用利用软件将其定义为不同的器件系统，在保持灵活性和可编程性的同时提供优异的性能，从而可以有更快的速度和更低的成本完成全新器件系统的开发。本文将介绍如何利用xcore.ai芯片开发DSP系统，并以XMOS与DSP Concepts近期宣布的合作协议为例，展示音频开发人员如何将 XMOS 的高度确定性、低延迟的 xcore.ai 平台与 DSP Conce
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DSP 软件定义 SoC 音频汽车
IT之家 7 月 17 日消息，联发科天玑 7350 芯片现已发布，基于台积电第二代 4nm 工艺打造，采用第二代 Arm v9 架构，CPU 主频最高可达 3.0 GHz。天玑 7350 芯片 CPU 采用了两个 Arm Cortex-A715 大核和六个 Arm Cortex-A510 小核，集成 Arm Mali-G610 GPU 以及 NPU 657，支持 MediaTek HyperEngine 5.0 游戏引擎以及 MiraVision 765 移动显示技术，支持多种全球
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联发科 天玑 SoC
IT之家 7 月 15 日消息，台媒工商时报消息，台积电 2nm 制程本周试产，苹果将拿下首波产能。台积电 2nm 制程芯片测试、生产与零组件等设备已在二季度初期入厂装机，本周将在新竹宝山新建晶圆厂进行 2nm 制程试产，并计划 2025 年量产，消息称预计由 iPhone 17 系列搭载。IT之家注：iPhone 15 Pro 搭载采用台积电 3nm 工艺（N3B）制造的 A17 Pro 芯片；M4 iP
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台积电 晶圆代工 2nm
自三星电子官网获悉，7月9日，三星电子宣布将向日本人工智能公司Preferred Networks提供采用2nm GAA工艺和先进2.5D封装技术的Interposer-Cube S（I-Cube S）一站式半导体解决方案。据介绍，2.5D先进封装I-Cube S技术是一种异构集成封装技术，通过将多个芯片集成在一个封装中，从而提高互连速度并缩小封装尺寸。声明中称，Preferred Networks的目标是借助三星领先的代工和先进的封装产品，开发强大的AI加速器，以满足由生成式AI驱动的日益增长的计算需求
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三星 2nm AI芯片
据外媒报道，台积电的2nm制程工艺将开始在新竹科学园区的宝山晶圆厂风险试产，生产设备已进驻厂区并安装完毕，相较市场普遍预期的四季度提前了一个季度。芯片制程工艺的风险试产是为了确保稳定的良品率，进而实现大规模量产，风险试产之后也还需要一段时间才会量产。在近几个季度的财报分析师电话会议上，台积电CEO魏哲家是多次提到在按计划推进2nm制程工艺在2025年大规模量产。值得一提的是，台积电在早在去年12月就首次向苹果展示了其2nm芯片工艺技术，预计苹果将包下首批的2nm全部产能。台积电2nm步入GAA时代作为3n
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台积 三星 2nm 3nm 制程
7月5日消息，纵观目前手机市场几大巨头，无一例外都拥有自家的Soc芯片，头部谷歌自然而然会走向制造SoC的道路。从Pixel 6系列开始，Pixel机型搭载谷歌定制的Tensor芯片，这颗芯片是基于三星Exynos魔改而来，只有TPU、ISP以及搭配的TitanM2安全芯片是谷歌自家的技术。但从Tensor G5开始，谷歌将实现芯片的完全自研，据报道，Tensor G5将由台积电代工，采用3nm工艺制程，目前已经进入到了流片阶段。所谓流片，就是像流水线一样通过一系列工艺步骤制造芯片，该环节处于芯片设计和芯
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谷歌 Soc 台积电 Pixel
财联社7月3日电，泰凌微公告，TLSR925x系列SoC是公司高性能、低功耗、多协议、高集成度无线连接芯片家族的最新一代产品，是国内首颗实现工作电流低至1mA量级的多协议物联网无线SoC(实测结果)。公司预计TLSR925x芯片将于2024年内实现批量生产，并在近期开始为先导客户进行开发和提供样品。
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泰凌微 TLSR925x SoC
三星既没有获得客户的大批量订单，又在先进制程上遭遇英特尔和台积电的双重打击。
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NanoFlex 2nm
根据韩国媒体Etnews的报导，晶圆代工大厂三星正在考虑将其设在美国德州泰勒市的晶圆厂制程技术，从原计划的4纳米改为2纳米，以加强与台积电美国厂和英特尔的竞争。消息人士称，三星电子最快将于第三季做出最终决定。报导指出，三星的美国德州泰勒市晶圆厂投资于2021年，2022年开始兴建，计划于2024年底开始分阶段运营。以三星电子DS部门前负责人Lee Bong-hyun之前的说法表示，到2024年底，我们将开始从这里出货4纳米节点制程的产品。不过，相较于三星泰勒市晶圆厂，英特尔计划2024年在亚利桑那州和俄亥
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4nm 2nm 三星 晶圆厂 制程节点
6月16日消息，ASML去年底向Intel交付了全球第一台High NA EUV极紫外光刻机，同时正在研究更强大的Hyper NA EUV光刻机，预计可将半导体工艺推进到0.2nm左右，也就是2埃米。ASML第一代Low NA EUV光刻机孔径数值只有0.33，对应产品命名NXE系列，包括已有的3400B/C、3600D、3800E，以及未来的4000F、4200G、4X00。该系列预计到2025年可以量产2nm，再往后就得加入多重曝光，预计到2027年能实现1.4nm的量产。High NA光刻机升级到了
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ASML 光刻机 高NA EUV 0.2nm
近日，日本晶圆代工企业Rapidus与IBM宣布建立合作伙伴关系，建立2nm半导体学校芯片封装的大规模生产技术。通过此次合作，Rapidus将获得IBM关于高性能半导体封装技术的许可，并将共同开发该技术。图片来源：Rapidus官网据了解，2021年，IBM对外公布全球首款2nm芯片原型。2022年12月，Rapidus与IBM达成战略性伙伴关系，双方共同推动基于IBM突破性的2nm制程技术的研发。Rapidus董事长小池淳义表示，“继2nm半导体的共同开发之后，关于芯片封装的技术确立也与IBM签订了伙伴
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Rapidus IBM 2nm
智能家居设备已经深深融入亿万家庭中，成为提升我们居家生活便利性的重要工具，但是早期的智能家居设备往往只能被动地接受用户设定的指令来运行，显然这样的“呆板”无法满足用户的智能化需求。现在随着人工智能（AI）技术的发展，智能家居设备正变得越来越“聪明”，能够主动适应并调整相关设定，以更好地配合用户的生活习惯与作息规律。本文将为您介绍人工智能将如何强化智能家居设备的功能，以及由芯科科技（Silicon Labs）所推出的解决方案，将如何增强智能家居设备的功能性与安全性。人工智能赋予智能家居设备自主判断能力在许多
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智能家居 芯科科技 SoC 物联网安全
全球客制化存储芯片解决方案设计公司爱普科技与硅知识产权（SIP）、平台与IP设计服务供货商Mobiveil今日宣布，已成功开发出专属爱普的Ultra
High Speed (UHS) PSRAM的IP控制器，为SoC业者提供一个更高性能、更低功耗的全新选择。Mobiveil结合爱普UHS PSRAM存储芯片超高带宽和少引脚数的产品优势，为控制器和UHS
PSRAM设计全新接口，优化SOC整体性能；对于有尺寸限制的IoT产品应用，提供更简易的设计，加速上市时间。Mobiveil
的首席营运长&n
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爱普科技 Mobiveil UHS PSRAM 控制器 SoC
距离 2nm 制程量产还有一年左右的时间，当下，对于台积电、三星和英特尔这三大玩家来说，都进入了试产准备期，新一轮先进制程市场争夺战一触即发。经过多年的技术积累、发展和追赶，在工艺成熟度和良率方面，三星、英特尔与台积电的差距越来越小了，在 2nm 时代，台积电依然占据优势地位的局面可以预见，但与 5nm 和 3nm 时期相比，市场竞争恐怕会激烈得多。三大玩家的 2nm 技术路线在发展 2nm 制程技术方面，台积电、三星和英特尔既有相同点，也有不同之处，总体来看，台积电相对稳健，英特尔相对激进，三星则处于居
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一些设计团队在创建片上系统（SoC）设备时，有幸能够使用最新和最先进的技术节点，并且拥有相对不受限制的预算来从可信的第三方供应商那里获取知识产权（IP）模块。然而，许多工程师并没有这么幸运。对于每一个「不惜一切代价」的项目，都有一千个「在有限预算下尽你所能」的对应项目。一种从成本较低、早期代、中档处理器和加速器核心中挤出最大性能的方法是，明智地应用缓存。削减成本图 1 展示了一个典型的成本意识 SoC 场景的简化示例。尽管 SoC 可能由许多 IP 组成，但这里为了清晰起见，只展示了三个。图 1SoC 内
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2nm soc介绍
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