Microchip Technology Inc.（微芯科技公司）始终致力于通过整体系统解决方案让创新设计变得更简单。今日其与全球车载摄像头模组供应商舜宇智领（舜宇光学科技集团旗下子公司）宣布达成战略合作，旨在共同拓展汽车 SerDes 联盟移动链路（ASA-ML）生态系统。作为此次合作的一部分，舜宇智领推出了基于 Microchip VS700 系列 ASA-ML 器件的高级驾驶辅助系统（ADAS）摄像头模组，旨在为汽车行业提供更快速、更简便且更具成本效益的摄像头
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Microchip
车载摄像头
舜宇智领
ASA-ML
SerDes
随着AI模型以惊人速度扩展，SerDes（串行/解串器）已成为提升芯片间数据带宽的关键。据TrendForce观察，自2025年以来，高速SerDes的竞争日益激烈。除了博通和Marvell，联发科据报道通过224G SerDes进入了谷歌的TPU生态系统，而NVIDIA则开始向集成电路和IP设计合作伙伴开放其NVLink Fusion SerDes的IP。在此背景下，SerDes能力正成为ASIC厂商的关键差异化因素，企业竞相加强互联技术以支持AI基础设施。这引发了关于SerDes是什么、为何变得如此关
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SerDes
博通
Marvell
联发科
人工智能
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中国数字EDA/IP龙头企业上海合见工业软件集团有限公司（简称“合见工软”）近日发布国产自主研发支持多协议的32G SerDes PHY 解决方案UniVista 32G Multi-Protocol SerDes IP (简称UniVista 32G MPS IP)。该多协议PHY产品可支持PCIe5、USB4、以太网、SRIO、JESD204C等多种主流和专用协议，并支持多家先进工艺，成功应用在高性能计算、人工智能AI、数据中心等复杂网络领域IC企业芯片中部署。随着全球数据量呈指数级增长，这场由数据驱
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合见工软
SerDes IP
HDR 相机的世界不仅限于为您的手机或超高清电视屏幕提供令人惊艳的视觉效果。如今，高性能相机越来越多地应用于现代先进驾驶辅助系统 (ADAS) 和自动驾驶汽车 (AV) 领域。例如，Waymo 的第五代自动驾驶汽车配备了至少29个摄像头，此外还有五个激光雷达和六个雷达。未来的自动驾驶汽车需要支持总带宽在 3 到 40 GBit/s（约 1.4 到 19 TB/h）之间，而摄像头将生成最多的数据。图1 在ADAS和AV传感器中，摄像头每秒产生的数据量最多 数据来源：Lucid Motors车载网络-区域架构
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汽车
SerDes
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摄像头传感器
串行化/去串行化电路，统称为SerDes，为数字通信系统提供了重要的好处，尤其是当需要高数据速率时。在我工程生涯的早期，我认为并行通信通常比串行通信更可取。我很欣赏同时移动所有8个（或16个，或32个…）数据位的简单性和效率，使用一两个控制信号进行握手，而不需要复杂的同步方案。然而，不久之后，主流的数字通信协议——UART、SPI、I2C等——使用串行接口就变得很明显了，我还注意到，用于专业应用的高级协议有利于串行传输。尽管微控制器和中央处理器（CPU）的内部存储、检索和处理操作需要并行数据，这意味着串行
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202408
SerDes
并行
串行
PCB
一、SERDES的作用1.1并行总线接口在SerDes流行之前,芯片之间的互联通过系统同步或者源同步的并行接口传输数据,图1.1演示了系统和源同步并行接口。随着接口频率的提高，在系统同步接口方式中,有几个因素限制了有效数据窗口宽度的继续增加。a)、时钟到达两个芯片的传播延时不相等(clock skew)b)、并行数据各个bit的传播延时不相等(data skew)c)、时钟的传播延时和数据的传播延时不一致(skew between data and clock)虽然可以通过在目的芯片(chip #2)内用
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SerDes
通信
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作者：Frank Qin问题背景：在IVI系统中，SoC-串行器-解串器-屏幕的链路中存在很多的干扰及未知因素。尤其是当下各类芯片基本都没有提供各类信号的并行输出，导致难以在串行链路中的各个点位分别抓取我们希望得到的数字信号，从而导致在整个系统出现不稳定或者时钟及脉冲信号不匹配时，我们无从下手去找到不匹配的点。解决思路：如果可以把串行信号或者“黑盒子”中的有意义的信号单独抓取出来，找到其中的“可变量”和“定量”，就可以比较简单的判断出链路中是否有哪个信号出现的偏差或抖动。LVDS 可在并行和串行数据传输中
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TI
SerDes
_____泰克日前成为2023年DesignCon最佳论文奖得主，该奖项旨在表彰其在数据驱动式 PAM4 SerDes 建模领域的突出贡献。这篇论文是由泰克Wenzheng (Shawn) Sun 和 Muhammad Saad Chughtai 与惠普企业 (HPE) 的 Yongjin Choi 和 Chris Cheng 共同完成的。此外，北卡罗来纳州立大学的 Priyank Kashyap 和 Pual Franzon 也参与了论文的撰写过程。最佳论文奖旨在表彰获奖作者在半导体和电子设计领域的突出
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泰克
DesignCon
PAM4 SerDes
3nm 时代来临了！Cadence 在 2023 年 TSMC 北美技术研讨会期间发布了面向台积电 3nm 工艺（N3E）的 112G 超长距离（112G-ELR）SerDes IP 展示，这是 Cadence 112G-ELR SerDes IP 系列产品的新成员。在后摩尔时代的趋势下，FinFET 晶体管的体积在 TSMC 3nm 工艺下进一步缩小，进一步采用系统级封装设计（SiP）。通过结合工艺技术的优势与 Cadence 业界领先的数字信号处理（DSP）SerDes 架构，全新的 112G-ELR
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Cadence
TSMC
3nm工艺
SerDes IP
Credo Technology（纳斯达克股票代码：CRDO）近日正式宣布推出其基于台积电5nm及4nm制程工艺的112G PAM4 SerDes IP全系列产品，该系列能够全面覆盖客户在高性能计算、交换芯片、人工智能、机器学习、安全及光通信等领域的广泛需求，包括：超长距（LR+）、长距（LR）、中距（MR）、超极短距（XSR+）以及极短距（XSR）。 Credo IP产品业务开发助理副总裁Jim Bartenslager表示， “Credo先进的混合信号以及数字信号处理（DSP）1
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Credo
台积电
5nm
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SerDes
IP
近年来，车用全景监视系统 (Around View Monitor，AVM) 已经逐渐成为汽车中高阶市场的标准配备，影像处理及画面拼接的技术也越来越成熟。消费者除了要求画面的流畅度与拼接的准确度外，也开始追求画面的品质。图片取自：https://picclick.co.uk/ICAM-BMW-surround-360-camera-retrofit-set-kit-254219011731.html 目前市面上大部分的 AVM 系统都使用 720p HD 的镜头模组，因应未来市场
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THine
哉英
SerDes
Camera
MIPI-CSI
1080p
全景
环景
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Automotive
湛 伟（成都华微电子科技有限公司，成都 610041）摘 要：本文回顾了Serdes的发展历程，提出了Serdes技术分代及其特点，讲述当前国内外Serdes的技术现状，以及Serdes技术的发展趋势，对Serdes架构和各模块技术演变、关键技术挑战进行了分析，并从协议、电路设计、信号完整性、发展趋势几个维度加以详细讨论。关键词：Serdes；PAM4；数据时钟；恢复0 引言Serdes是英文单词串行器（Serializer）和解串行器（De-Serializer）的合成词，可以称之为串行解串器。根据其功
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201909
Serdes
PAM4
数据时钟
恢复
采用ALTERA Cyclone IV FPGA内部SERDES实现多路数据的复分解，舍弃了专用的复分解芯片，在降低系统硬件设计复杂度的同时缩小了PCB板的体积以及系统功耗。利用数据提取、缓存、还原等处理方式，去除异步采样带来的数据传输带宽增加的弊端。实现在有限的无线微波传输带宽、有限的体积内部多种同步异步数据的高可靠性传输。
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SERDES
高速串口
数据提取
异步采样
微波传输
201812
串行解串器是可将大位宽并行总线压缩成少量(通常为一条)差分串行链路的器件，该链路可在远远高于低速大位宽并行总线的速率下进行切换。串行解串器对大
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解串
SerDes
参考时钟对SERDES性能的影响-我们知道，SERDES对参考时钟有严格的相位噪声性能要求。通常，SERDES供应商会根据其SERDES采用的PLL以及CDR架构特点，以及性能数据，提出对参考时钟的相位噪声的具体要求。
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SERDES
参考时钟
XILINX
本文只谈及了一些基本的概念。这里所涉及的任何一个主题都可以用整本书的篇幅来讨论。关键是要在为PCB版图设计投入大量时间和精力之前搞清楚目标是什么。一旦完成了版图设计，重新设计就会耗费大量的时间和金钱，即便是对走线的宽度作略微的调整。不能依赖PCB版图工程师做出能够满足实际需求的设计来。原理图设计师要一直提供指导，作出精明的选择，并为解决方案的成功负起责任。
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PCB
电容
SERDES
FPGA
基于SERDES的设计增加了带宽，减少了信号数量，同时带来了诸如减少布线冲突、降低开关噪声、更低的功耗和封装成本等许多好处。而SERDES技术的主要缺点是需要非常精确、超低抖动的元件来提供用于控制高数据速率串行信号所需的参考时钟。即使严格控制元件布局，使用长度短的信号并遵循信号走线限制，这些接口的抖动余地仍然是非常小的。
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参考时钟源
高速串行接口
SERDES
摘要分布式基站系统中，RRU 通常会通过光纤拉远实现与 BBU 的远程互联。由于光纤自身的特性，传输过程中必然会引入抖动和漂移;尤其是漂移，因其低频特性，并且难于滤除，在SERDES 的 FIFO 深度不够的情况下有可能会造
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SERDES
FIFO
光纤
方案
Maxim汽车解决方案事业部管理总监Kent Robinett说，美国/英国对车主的调查表明，车主强烈希望爱车配置ADAS(先进的驾驶员辅助系统)。但消费者不愿意为目前的ADAS买单。 预计2017年，ADAS系统的市场将增长到近9000万套系统。 目前的挑战之一是：通过低成本线缆发送百万像素没有经过压缩的数据，并且还有强大的EMC(电磁兼容)性能。 Maxim的汽车互联创新始于2003年。2014年4月9日，又推出全新的SerDes芯片组，可大大降低用于信息娱乐的线缆成本和重量。
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Maxim
SerDes
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Maxim Integrated的汽车SerDes芯片组适用于屏蔽双绞线(STP)和同轴电缆传输，大幅提高设计灵活性。 Maxim Integrated Products, Inc. 推出最新3.12Gbps千兆位多媒体串行链路(GMSL)SerDes芯片组，设计人员利用传统的STP或重量更轻、成本更低的同轴电缆即可支持高分辨率汽车信息娱乐系统。 目前汽车设计普遍采用STP电缆将数据传送至汽车信息娱乐系统显示器。然而，越来越多的OEM厂商开始尝试转
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Maxim
GMSL
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2008年4月3日，北京-全球可编程逻辑解决方案领导厂商赛灵思公司日前宣布推出Virtex®-5 FXT 器件。这些FPGA器件在业界率先集成了嵌入式PowerPC® 440处理器模块、高速RocketIO™ GTX收发器和专用XtremeDSP™ 处理能力。作为65nm Virtex-5系列的第四款平台，Virtex-5 FXT提供了极高的性能，还可帮助设计人员降低系统成本、缩小板尺寸并减少元件数量。在赛灵思公司以及业
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FPGA
SERDES
全球领先的测试、测量和监测仪器供应商---泰克公司日前宣布，推出业内首个全集成式40 Gb/s可编程码型发生器(PPG)。该40 Gb/s PPG连同先前发布的40 Gb/s可编程误差检测仪现在构成完整的40 Gb/s误码率测试(BERT)解决方案。凭借200 fs随机抖动(RJ)和8 ps上升时间性能，新泰克PPG4001提供了对40 Gb/s串行数据测试至关重要的性能和信号质量。 开发高速数据及远程(long-hau
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泰克
PPG
BERT
SERDES
在OTN帧结构中，Serdes在从高速的串行数据中恢复出数据后，数据只是按顺序以64bit为宽度重新放置，并没有按字节对齐，所以后续电路无法直接使用这样的数据。需要帧头定位电路找到帧头后，把所有的数据按字节对齐。但是将OTN数据转换为并行的数据后，存在着数据速率高，位宽大的问题。在ASIC或FPGA中，大量的大位宽的数据，是不容易运行在较高的速率下的。所以需要对帧定位电路进行简化，以使得电路在大位宽时，仍然能够进行高速运行。研究了OTN数据的帧结构后，提出了一种适合于高速率的、大位宽的处理电路。
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OTN
FPGA
Serdes
ASIC
帧定位
201401
摘要 分布式基站系统中，RRU 通常会通过光纤拉远实现与 BBU 的远程互联。由于光纤自身的特性，传输过程中必 ...
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光纤漂移
SERDES
FIFO溢出
FPGA SERDES的应用需要考虑到板级硬件，SERDES参数和使用，应用协议等方面。由于这种复杂性，SERDES的调试工作对 ...
关键字：
Xilinx
SerDes
调试
Avago Technologies (Nasdaq: AVGO)为有线、无线和工业应用模拟接口零组件领先供应商宣布其28nm串行/解串器(SerDes)核心已经达到32Gbps的性能，并且可以承受高达40dB的通道损耗，这个最新的SerDes核心不仅仅重新定义了芯片到芯片、连接端口和背板等接口可达到的数据率，并且反映了Avago为数据中心和企业应用提供领先解决方案的持续承诺。
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Avago
CMOS
SerDes
对于10Gbps及以上数据速率的SerDes，每个数据位的单位间隔是随着近 20～30ps的信号上升/下降时间而缩短的。选择合适的封装互连结构，有效地传输这些信号已成为最大限度减少信号完整性问题的重要考虑因素，如串扰、阻
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SerDes
封装
键合
封装规范
Maxim的吉比特(千兆)多媒体串行链路(GMSL)方案可以对数字视频和音频数据进行串行转换，然后通过一对双绞线串行传输。另外，集成双向控制通道可以使能单个微处理器(micro;C)对串行器、解串器和所有连接外设编程。在典
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SerDes
GMSL
汽车电子
控制单元
LatticeECP4? FPGA系列结合了高性能FPGA结构、高性能I/O和多达16个通道的嵌入式SERDES，带有相关的物理编码子层(PCS)逻辑。每个PCS逻辑通道包含专用的发送和接收电路，用于高速、全双工的串行数据传输，传输速率高达
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LatticeECP4
SERDES
serdes介绍
SERDES 并串行与串并行转换器,串化器/并化器 A device that serializes output from, and deserializes input to, a business machine.
一种(信号)转换设备,对商业计算机的输出(信号)进行并串行(串行化)转换,而对其输入(信号)进行串并行(解串)转换。SERializer/DESerializer的缩 [
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