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灿芯半导体推出PCIe 4.0 PHY IP

一站式定制芯片及IP供应商——灿芯半导体（上海）股份有限公司（灿芯股份，688691）宣布推出基于28HKC+ 0.9V/1.8V平台的PCIe 4.0 PHY IP。该PHY IP符合PCIe 4.0规范的要求，支持PIPE 4.4.1/5.2接口及2.5Gbps至16Gbps的数据传输速率，全面覆盖PCIe Gen4.0/3.0/2.0/1.0标准，并兼容Rapid IO、JESD204B/C、USB3.2/3.1/3.0、10GBASE-R/KR等其他协议。凭借其优越的
关键字：灿芯 PCIe 4.0 PHY IP

Ceva无线连接IP市场份额达68%，稳居行业首位

据IPnest最新发布的2025年设计IP报告显示，Ceva公司在无线连接IP领域继续保持领先地位，市场份额在2024年增长至68%。这一数字是其最接近竞争对手的10倍以上，进一步巩固了其在智能边缘设备联机功能中的核心地位。Ceva（纳斯达克股票代码：CEVA）作为全球领先的智能边缘领域半导体产品和软件IP授权许可厂商，其技术覆盖蓝牙、Wi-Fi、UWB、802.15.4及蜂窝物联网IP解决方案。这些技术为下一代智能边缘设备提供了重要支持，满足了市场对高性能、低功耗解决方案的不断增长需求。Ceva首席运营
关键字： Ceva 无线连接 IP

Arteris将为AMD新一代AI芯粒设计提供FlexGen智能片上网络 (NoC) IP

在AI计算需求重塑半导体市场的背景下。致力于加速系统级芯片 (SoC) 开发的领先系统 IP 提供商 Arteris 公司近日宣布，高性能与自适应计算领域的全球领导者 AMD（纳斯达克股票代码：AMD）已在其新一代AI 芯粒设计中采用FlexGen片上网络互连IP。Arteris的这项智能NoC IP技术将为 AMD 芯粒提供高性能数据传输支持，赋能AMD从数据中心到边缘及终端设备的广泛产品组合中的AI应用。Arteris FlexGen NoC IP与AMD Infinity Fabric™互连技术的战
关键字： Arteris AMD AI芯粒片上网络 NoC IP

四大核心要素驱动汽车智能化创新与相关芯片竞争格局

智能汽车时代的加速到来，使车载智能系统面临前所未有的算力需求。随着越来越多车型引入电子电气架构转向中心化、智能驾驶的多传感器融合、智能座舱的多模态交互以及生成式AI驱动的虚拟助手等创新技术，都要求车用主芯片能够同时胜任图形渲染、AI推理和安全计算等多重任务。当下，功能安全、高效高灵活性的算力、产品生命周期，以及软件生态兼容性这“四大核心要素”，已成为衡量智能汽车AI芯片创新力和市场竞争力的核心标准。传统汽车计算架构中，往往采用CPU与GPU或/和NPU等计算单元组成异构计算模式；随着自动驾驶算法从L1向L
关键字： 202507 汽车智能化 Imagination GPU IP

合见工软发布先进工艺多协议兼容、集成化传输接口SerDes IP解决方案

中国数字EDA/IP龙头企业上海合见工业软件集团有限公司（简称“合见工软”）近日发布国产自主研发支持多协议的32G SerDes PHY 解决方案UniVista 32G Multi-Protocol SerDes IP (简称UniVista 32G MPS IP)。该多协议PHY产品可支持PCIe5、USB4、以太网、SRIO、JESD204C等多种主流和专用协议，并支持多家先进工艺，成功应用在高性能计算、人工智能AI、数据中心等复杂网络领域IC企业芯片中部署。随着全球数据量呈指数级增长，这场由数据驱
关键字：合见工软 SerDes IP

边缘AI广泛应用推动并行计算崛起及创新GPU渗透率快速提升

人工智能（AI）在边缘计算领域正经历着突飞猛进的高速发展，根据IDC的最新数据，全球边缘计算支出将从2024年的2280亿美元快速增长到2028年的3780亿美元*。这种需求的增长速度，以及在智能制造、智慧城市等数十个行业中越来越多的应用场景中出现的渗透率快速提升，也为执行计算任务的硬件设计以及面对多样化场景的模型迭代的速度带来了挑战。AI不仅是一项技术突破，它更是软件编写、理解和执行方式的一次永久性变革。传统的软件开发基于确定性逻辑和大多是顺序执行的流程，而如今这一范式正在让位于概率模型、训练行为以及数
关键字：并行计算 GPU GPU IP

芯原超低能耗NPU可为移动端大语言模型推理提供超40 TOPS算力

芯原股份（芯原）近日宣布其超低能耗且高性能的神经网络处理器（NPU）IP现已支持在移动端进行大语言模型（LLM）推理，AI算力可扩展至40 TOPS以上。该高能效NPU架构专为满足移动平台日益增长的生成式AI需求而设计，不仅能够为AI PC等终端设备提供强劲算力支持，而且能够应对智慧手机等移动终端对低能耗更为严苛的挑战。芯原的超低能耗NPU IP具备高度可配置、可扩展的架构，支持混合精度计算、稀疏化优化和并行处理。其设计融合了高效的内存管理与稀疏感知加速技术，显著降低计算负载与延迟，确保AI处理流畅、响应
关键字：芯原 NPU 大语言模型推理 NPU IP

灿芯半导体推出28HKC+工艺平台TCAM IP

近日，一站式定制芯片及IP供应商——灿芯半导体（上海）股份有限公司宣布推出基于28HKC+ 0.9V/1.8V平台的Ternary Content-Addressable Memory (TCAM) IP。该IP具有高频率和低功耗特性，随着网络设备中快速处理路由表与访问控制列表（ACL）等需要高效查找的场景不断增加，该IP将被高端交换机、路由器等芯片广泛采用。灿芯半导体此次发布的TCAM IP包含全自研Bit cell，符合逻辑设计规则，良率高；在可靠性方面，这款TCAM抗工艺偏差强，具有高可靠
关键字：灿芯 28HKC+ 工艺平台 TCAM IP

Arm的40岁不惑之年开启的新选择

确定IP技术发布的日期有时是一项挑战，尤其是英国处理器内核IP设计商 ARM。不过有证据可查的是第一款Arm内核处理器是在1985年4月26日在英国剑桥的Acorn上流片的，我们暂且将这个时间作为Arm真正进入IC设计领域的原点。ARM1是Acorn继BBC Micro家用电脑成功之后自主开发的处理器。它由Sophie Wilson和Steve Furber开发。当日这颗处理器流片前在设计和制造方面已经进行了好几个月的开发，而且硅片最后花了好几个月才回到剑桥。 “它的设计制造成本低廉，由于设计对微处理器的
关键字： Arm IP

出售Artisan将是Arm转型的标志性事件

虽然是EDA公司收购IC设计IP，但此次收购可能会在整个竞争格局中产生连锁反应。Cadence强化一站式服务和EDA工具护城河，而Arm转向更高利润的芯片设计。
关键字： Artisan Arm Cadence IP 202505

使用莱迪思iFFT和FIR IP的5G OFDM调制用例

摘要本文介绍了一种在FPGA中实现的增强型正交频分复用（OFDM）调制器设计，它使用了逆FFT模式的莱迪思快速傅立叶变换（FFT）Compiler IP核和莱迪思有限脉冲响应（FIR）滤波器IP核。该设计解决了在没有主控制器的情况下生成复杂测试模式的常见难题，大大提高了无线链路测试的效率。通过直接测试模拟前端的JESD204B链路，OFDM调制器摆脱了对主机控制器的依赖，简化了初始调试过程。该设计可直接在莱迪思FPGA核中实现，从而节省成本并缩短开发周期。该调制器的有效性验证中使用了Avant-X70 V
关键字：莱迪思半导体 iFFT FIR IP 5G OFDM

Cadence率先推出eUSB2V2 IP解决方案

为了提供更好的用户体验，包括高质量的视频传输、更新的笔记本电脑（例如最新的 AI PC）和其他前沿设备，都需要 5 纳米及以下的先进节点 SoC，以达成出色的功耗、性能和面积（PPA）目标。然而，随着技术发展到 5 纳米以下的工艺节点，SoC 供应商面临各种挑战，例如平衡低功耗和低工作电压（通常低于 1.2V）的需求。与此同时，市场也需要高分辨率相机、更快的帧率和 AI 驱动的计算，这就要求接口具有更高的数据传输速率和更强的抗电磁干扰（EMI）能力。随着这些性能要求变得越来越复杂，市场亟需创新的解决方案来
关键字： Cadencee USB2V2 IP

创意推全球首款HBM4 IP 于台积电N3P制程成功投片

创意2日宣布，自主研发的HBM4控制器与PHY IP完成投片，采用台积电最先进N3P制程技术，并结合CoWoS-R先进封装，成为业界首个实现12 Gbps数据传输速率之HBM4解决方案，为AI与高效能运算（HPC）应用树立全新里程碑。HBM4 IP以创新中间层（Interposer）布局设计优化信号完整性（SI）与电源完整性（PI），确保在CoWoS系列封装技术下稳定运行于高速模式。创意指出，相较前代HBM3，HBM4 PHY（实体层）效能显著提升，带宽提升2.5倍，满足巨量数据传输需求、功耗效率提升1
关键字：创意 HBM4 IP 台积电 N3P

灿芯半导体推出DDR3/4, LPDDR3/4 Combo IP

近日，一站式定制芯片及IP供应商——灿芯半导体（上海）股份有限公司宣布推出基于28HKD 0.9V/2.5V 平台的DDR3/4, LPDDR3/4 Combo IP 。该IP具备广泛的协议兼容性，支持DDR3, DDR3L, DDR4和LPDDR3, LPDDR4协议，数据传输速率最高可达2667Mbps，并支持X16/X32/X64等多种数据位宽应用。灿芯半导体此次发布的DDR3/4, LPDDR3/4 Combo IP集成高性能DDR&nb
关键字：灿芯半导体 DDR3/4 LPDDR3/4 Combo IP

Imagination继续推动GPU创新—发布全新DXTP GPU IP将功效提升20%

Imagination于不久前正式发布了DXTP GPU IP，这款新产品的亮点在于，在标准图形工作负载下，其能效比（FPS/W）相比前代产品实现了高达20%的提升。作为GPU IP行业的领导者，截至2023年的公开数据显示，搭载Imagination IP授权的芯片累计出货量高达110亿颗。这些芯片广泛应用于移动设备（包括智能手机）、汽车、消费电子产品和电脑等多个领域。此次功效得到大幅提升的DXTP GPU的发布，正值在DeepSeek等大模型技术的推动下，边缘AI设备广泛兴起的产业转型期，功效更高的G
关键字： Imagination GPU GPU IP

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ip介绍

IP是英文Internet Protocol（网络之间互连的协议）的缩写，中文简称为“网协”，也就是为计算机网络相互连接进行通信而设计的协议。在因特网中，它是能使连接到网上的所有计算机网络实现相互通信的一套规则，规定了计算机在因特网上进行通信时应当遵守的规则。任何厂家生产的计算机系统，只要遵守 IP协议就可以与因特网互连互通。IP地址具有唯一性，根据用户性质的不同，可以分为5类。另外，IP还有进入 [ 查看详细 ]

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