7月28日，美国司法部（DOJ）与加州北区检察官办公室联合宣布，总部位于美国加州圣何塞的EDA巨头公司Cadence Design Systems, Inc.就违反出口管制法律达成认罪协议，以解决其违反《出口管制条例》（EAR）的刑事指控。根据协议，Cadence需向司法部支付近1.18亿美元刑事罚款，同时与商务部工业与安全局（BIS）达成超9500万美元民事和解，经协调抵扣后总支付额超1.4亿美元，刷新了近年来美国对EDA企业出口违规的处罚纪录。Cadence必须在命令下达后的30天内，向BIS支付其中
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EDA Cadence
楷登电子（美国 Cadence 公司）近日宣布业内首个 LPDDR6/5X 内存 IP 系统解决方案完成流片。该解决方案已经过优化，运行速率高达 14.4Gbps，比上一代 LPDDR DRAM 快 50%。全新的 Cadence® LPDDR6/5X 内存 IP 系统解决方案是扩展 AI 基础架构的关键驱动因素。经过扩展之后，AI 基础架构可以适应新一代 AI LLM、代理 AI 及其他垂直领域计算密集型工作负载对于内存带宽和容量的需求。在这方面，Cadence 目前正在与领先的 AI、高性能计算（HP
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Cadence LPDDR6 内存IP
7月14日，国家市场监督管理总局发布公告，宣布附加限制性条件批准新思科技公司（Synopsys）收购安似科技公司（Ansys）股权案。公告称，鉴于此项经营者集中在全球和中国境内光学软件、光子软件市场、部分EDA软件市场和设计IP市场具有或者可能具有排除、限制竞争效果，根据申报方提交的附加限制性条件承诺方案，市场监管总局决定附加限制性条件批准此项集中，要求集中双方和集中后实体履行如下义务：· 剥离光学解决方案相关业务，即新思科技整个光学和光子器件仿真业务。· 剥离功耗分析软件有关业务，即安似科技功耗分析软件
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EDA 新思科技 Ansys Cadence 西门子
新一代消费电子及汽车音频系统的复杂性与日俱增，基于生成式 AI 的音频处理、沉浸式音效以及软件定义汽车中的高级信息娱乐系统等市场驱动因素，对音频 DSP 性能提出了更高的要求。然而，单个 DSP 已无法满足日益增长的计算需求，而多个 DSP 又会大幅增加编程难度。如今，原始设备制造商(OEM)和系统级芯片(SoC)供应商必须在日益紧迫的产品上市压力下，独立完成所有多核硬件设计和软件开发工作。与此同时，程序员们正艰难应对基于软件的共享存储域的复杂同步问题，绞尽脑汁设法将任务合理分配到多核集群中。这可能导致设
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Cadence 多核处理器
7 月 8 日，Cadence通过其微信公众号正式宣布，这家美国公司最近决定扩大与三星晶圆厂的合作。双方已签署一项新的多年 IP 协议，以扩展Cadence®存储器和接口 IP 解决方案在三星晶圆厂先进 SF4X、SF5A 和 SF2P 工艺节点的部署。这些解决方案将支持人工智能数据中心、汽车系统和下一代射频连接的高性能、低功耗应用。通过结合Cadence的 AI 驱动设计和硅解决方案与三星的先进制造技术，这项合作旨在加速基于三星领先节点的尖端系统级芯片（SoC）、芯片和 3D-IC 产品的上市时间（TT
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Cadence 三星 晶圆代工
据报道，Cadence近日宣布收购澳大利亚半导体技术公司（ASTC）旗下的VLAB Works。这一收购将进一步完善Cadence在系统验证全流程的技术布局，特别是在汽车软件与混合硅前验证领域形成显著竞争力。VLAB Works的加入巩固了Cadence与ASTC多年的合作伙伴关系。双方的合作将VLAB与Cadence的Helium Virtual and Hybrid Studio以及Xcelium、Palladium和Protium平台集成，显著增强Cadence在虚拟和混合硅前软件验证方面的能力。V
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Cadence VLAB Works 汽车软件验证
Silicon photonics 正在重塑数据中心的未来。但工程师需要更先进的仿真工具来将这些轻型吊索组件与电子设备集成。当今的计算和通信应用程序需要前所未有的处理能力和高带宽内存访问。以光速传输的数据正在成为解决方案。在数据中心，GPU 通常在 AI 训练和推理期间每秒相互传输数 TB 的数据，远远超过了传统铜缆互连的限制，后者的最高速度为每秒数百兆比特。光互连已成为满足这些需求的解决方案，它使用光束以高达 100 Gb/s 的速度传输数据。但是，设计和验证此类复杂系统需要高级仿真工具来对其性能进行建
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混合信号仿真 硅光子学 Cadence
楷登电子（美国 Cadence 公司）近日宣布率先推出基于台积公司 N3 工艺的 DDR5 12.8Gbps MRDIMM Gen2 内存 IP 解决方案。该新解决方案可满足业内对于更大内存带宽的需求，能适应企业和数据中心应用中前沿的 AI 处理需求，包括云端 AI。Cadence® DDR5 MRDIMM IP 基于 Cadence 经过验证且非常成功的 DDR5 和 GDDR6 产品线，拥有全新的可扩展、可调整的高性能架构。此 IP 解决方案已与人工智能、高性能计算和数据中心领域的多家领先客户建立合作
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Cadence DDR5 MRDIMM Gen2 内存IP 云端AI
Cadence（今日宣布，已与Arm（达成最终协议，收购Arm的Artisan基础IP业务。该业务涵盖标准单元库、内存编译器以及针对领先代工厂先进工艺节点优化的通用I/O（GPIO）。此次交易将增强Cadence不断扩展的设计IP产品线，其核心产品包括领先的协议和接口IP、内存接口IP、适用于最先进节点的SerDes IP，以及即将收购的Secure-IC公司提供的嵌入式安全IP。通过扩大其在SoC设计领域的布局，Cadence正在强化其持续加速客户产品上市速度，并在全球领先的代工工艺上优化其成本、功耗和
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Cadence ARM
内容提要● Cadence借助NVIDIA最新Blackwell系统，将求解器的速度提升高达 80 倍● 基于全新NVIDIA Llama Nemotron推理模型，携手开发面向工程设计和科学应用的全栈代理式 AI 解决方案● 率先采用面向 AI 工厂数字孪生的NVIDIA Omniverse Blueprint，旨在实现高效的数据中心设计和运营楷登电子（美国 Cadence 公司）近日宣布扩大与 NVIDIA 的多年合作，重点推动
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Cadence NVIDIA Grace Blackwell AI
随着 SoC 设计日益复杂，形式等效性检查面临更大挑战。为此，Cadence 推出了 Conformal AI Studio——一套全新的逻辑等效性检查（LEC）、自动化ECO（Conformal ECO）和低功耗静态签核解决方案。Conformal AI Studio 结合人工智能和机器学习（AI/ML）技术，可直接满足现代 SoC 团队日益增长的生产力需求。其核心引擎经加速优化，包括分布式低功耗引擎（支持对拥有数十亿实例的设计进行全芯片功耗签核）、全新算法创新以及面向 LEC 和 ECO 解决方案的简
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Conformal AI Studio SoC设计 Cadence
本文重点：射频功率收集，对于源和负载之间的最佳功率传输、减少功率反射和提高系统效率而言，IMN 至关重要。能量收集整流器和电压倍增器电路（例如 Cockcroft–Walton 和 Dickson 倍增器）是将射频信号转换并放大为可用直流电的关键，每种设计都会满足一些特定的电压要求和效率需求。射频功率收集系统可以利用静态（例如广播电台、移动基站）和动态（例如 Wi-Fi 接入点、警用无线电）环境射频源，需要采用复杂的方法才能在物联网应用中持续高效地供应能量。射频功率收集电路采用多种电路技术，旨在以最小电压
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Cadence 射频功率
内容提要● 与前一代产品相比，Cadence 新一代“动力双剑”组合的容量增加超过 2 倍，速度快 1.5 倍，可助力设计人员快速开发先进芯片，满足生成式 AI、移动、汽车、超大规模和 LLM 应用的需求● Palladium Z3 硬件仿真搭载全新自研 Cadence 硬件仿真核处理器，提供速度更快、预测能力更强的编译和全面的硅前硬件调试功能● Protium X3 原型验证平台能够以最快的速度搭建初始环境，用于十亿门级设计的硅前软
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Cadence Palladium Z3 Protium X3 加速验证 数字孪生
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Cadence Design Systems Inc.是全球最大的电子设计技术(Electronic Design Technologies)、程序方案服务和设计服务供应商。其解决方案旨在提升和监控半导 [
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