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一个用于测量，识别和消除对高速串行通信链路的时钟和数据抖动的建议框架
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clock and data recovery
CDR
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一个用于测量，识别和消除对高速串行通信链路的时钟和数据抖动的建议框架
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一个用于测量，识别和消除对高速串行通信链路的时钟和数据抖动的建议框架
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使用Altera FPGA Soft-CDR 模式的SGMII 接口实现
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Altera
FPGA
Stratix V
Stratix IV
Stratix III
Arria II
soft-CDR
SGMII
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Virex-4 FX
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