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Alder Lake有四种核心,开启E-Core就会禁用AVX512

发布人:超能网 时间:2021-10-21 来源:工程师 发布文章

在Intel近日放出的Alder Lake开发人员指南上,他们公开了一些此前没有公开的情报,包括大致的SKU以及指令集支持情况,因为Alder Lake是由Golden Cove(P-Core)和Gracemont(E-Core)两种不同架构的核心所组成的,所以它与以往的处理器相比会有更多不同的核心组合。

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桌面版的核心代号为Alder Lake-S,旗舰核心是有8个P-Core加8个E-Core组成,配备32组EU的核显,而另一种核心则只有6个P-Core,核显均是最多32组EU,根据此前的小道消息,Core i5-12600K及更高的型号都会用前面那种混合核心,而Core i5-12600及以下的型号都是用只有P-Core的核心。

移动版改变了以前用U与H的核心分类,统一叫Alder Lake-P,当然具体的处理器型号还是会分U和H的,与桌面版不同,移动版的Alder Lake-P全部都有E-Core,取代Tiger Lake-U的Alder Lake-P有2个P-Core和8个E-Core,而取代Tiger Lake-H的则最多有6个P-Core和8个E-Core,核显则是最多96组EU。

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根据Intel给出的示意图,每个P-Core都是有自己的L2缓存,并且是直接与L3缓存相连的,而E-Core则是4个一组,共享一份L2缓存再与L3相连的,而且很有趣的是,他们对开发人员是把P-Core叫Core,而把E-Core叫Atom。

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关于指令集方面,Golden Cove是支持AVX512的,但Gracemont不支持,所以目前Intel给出的解决方案就是当E-Core启用时AVX512就会被禁用,而AVX512的开关是否给出就可由OEM厂商来决定。TSX指令集则是直接被禁用,其他的AVX-VNNI、vAES、vCLMUL和UMWAIT/TPAUSE则是可由ISA添加。

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关键词: 芯片

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