- · BittWare加入Intel的Agilex M系列早期使用计划，以推动开发用于内存密集型应用的FPGA解决方案· BittWare新添两种全新的Intel Agilex I系列 SmartNIC加速器，打造最广泛的Intel基于FPGA加速器的企业级产品组合 · 与Intel进行数十年的
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BittWare Agilex PCIe FPGA 加速器
- 在各种装置应用中，优越电源管理与错误处理能力有效提升了PCIe 功能，得以称职胜任储存装置、网络、骨干及 I/O 互连技术的可靠表现。应用广泛的连接功能服务器、储存装置及网络市场目前经常使用PCI Express（PCIe）互连各种装置，工业自动化、物联网、消费性装置及车用电子产品的骨干和I/O产品应用项目也纷纷正视其优点，扩大采用PCIe。为了满足相关领域的用户期望与生态设计要求，PCI特殊课题小组（PCI-SIG）在延续多重世代的规范里先后引进了各种省电创新项目，以及提高可靠性、可用性、可维护性（RA
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PCIe 功耗敏感性
- 泰克提供TekScope PC电脑客户端进行示波器的波形获取及分析，往往在示波器端进行波形的解码及 分析，需要来回进行数据拷贝和处理，并占用示波器资源。利用TekScope PC客户端可以远程在多台 示波器获取波形，并且可以在自己的电脑上就可以进行MIPI的D-PHY/C-PHY 解码、搜索及分析。本文主要介绍了采用TekScope PC进行MIPI D-PHY/ C-PHY解码的使用方法和步骤。 1. 波形的采集 打开TekScope软件后，可以通过点击示波器下方的 “Add New Scope”添加需
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泰克 示波器 TekScope D-PHY/C-PHY 解码
- 芯研所 7 月 7 日消息，日前在 Innoprom 2022 国际工业展上，俄罗斯公司 Kraftway 公开了自研的 SSD 主控芯片 K1942VK018，这是一款 PCIe 4.0 主控。K1942VK018 主控采用的内核也有所不同，不是 ARM 而是开源的 RISC-V 架构，台积电 28nm HPC+ 工艺代工，支持 3D MLC、TLC 闪存，未来还可能支持 QLC 闪存，包括恺侠、美光甚至中国长江存储的闪存。芯研所采编使用这款主控的 SSD 是俄罗斯 GS Nanotech 生产的，支持
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俄罗斯 SSD PCIe 4.0
- Inuitive™ 和业界领先的提供片上网络(NoC)互连和IP部署软件以加快系统级芯片(SoC)创建的系统IP供应商 Arteris® Inc.今天宣布，Inuitive 已为其下一代计算机视觉平台部署了 Arteris FlexNoC® 互连 IP。该技术解决了连接和时序收敛的挑战，可以实现先进的下一代前沿视觉处理器所需的激进性能目标。这些先进的 SoC 将扩展多核视觉处理并增强高质量的深度传感。这些芯片将部署在 3D 深度成像、物体识别和跟踪，以及其他使用计算机视觉算法的各种应用中，比如增强现实、虚
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Arteris IP 视觉处理器
- Diodes 公司(Diodes) 宣布推出支持全新 PCI Express® (PCIe®) 5.0 协议的多样产品组合。这包括用于携带式和桌面计算机运算、数据中心和高效能运算 (HPC) 产品应用项目的 ReDriver™、切换器、时钟产生器和时钟缓冲器。在本系列产品组合中，最受瞩目的型号就是PI3EQX32908。这款 ReDriver 支持 PCIe 5.0 规范订定的 32Gbps 数据速率，有八个差分信道，具有独立的信道配置。线性等化、输出振幅以及平整增益参数均采可编程设计，能将讯号损失程度降
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Diodes PCIe 5.0
- 一站式定制芯片及IP供应商——灿芯半导体日前宣布推出用于高速DDR物理层中的Zero-Latency （零延迟）和True-Adaptive（真自适应）两项技术。这两项技术已经开始在12/14 FinFET, 22/28nm的DDR4/LPDDR4,4x高性能物理层IP上进行部署，将为客户带来更高效、更稳定的全新体验。 Zero-Latency （零延迟） 技术在读数据通路上，采用了两种可选的、独特的采样方式进行数据转换，而不像其他DDR物理层供货商采用FIFO进行跨时钟域转换，此技术将延迟降低
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灿芯 DDR IP
- 汽车的“信息化、智能化”为汽车行业带来了新的概念，软件定义汽车。它代表着车内软件的数量和价值（包括电子硬件）超过了机械硬件，代表着汽车行业的逐步转型，从高度的电子机械终端到智能、可扩展的移动电子终端并可持续升级。要成为如此智能的终端，汽车必须预先嵌入高级的硬件，而硬件的功能和价值通过整个生命周期中的OTA逐渐激活及增强。行业的价值链将从一站式的硬件销售变成持续的软件和服务优化，而消费者也期望汽车有类似智能手机的行为的客户感受。 因此汽车的电子电气架构 (EEA) 需要从传统的分布式模型向中心化、简介化、可
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PCIe 数据中心 泰克
- 可定制RISC-V处理器知识产权（IP）和处理器设计自动化的领导者Codasip日前宣布，Veridify Security公司的抗量子安全工具现在可以通过安全启动功能支持Codasip的RISC-V处理器。在固件加载到Codasip处理器上时，Veridify的安全算法就会对其进行验证，以使RISC-V开发人员确信嵌入式系统是安全可用的。Veridify的安全启动功能是基于一种比传统加密方法运行速度更快的算法；只需要很小的代码空间和超低功耗，非常适合Codasip的低功耗嵌入式处理器系列。通过使用Ver
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Codasip RISC-V IP
- 新闻重点：· 全新旗舰产品 Immortalis GPU 将显著优化安卓游戏体验，并首次推出基于硬件的光线追踪功能· 最新 Armv9 CPU 将峰值和效率性能提升至全新水平· 新的 Arm 全面计算解决方案 (Total Compute Solutions) 可满足各级别的性能、效率和可扩展
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arm IP 移动游戏
- 联咏芯片NT98560是一款高度集成的SoC，具有高画质、低码率、低功耗，适用于2Mp 至5Mp Edge-IP Camera应用。NT98560集成了ARM Cortex A9 CPU内核、新一代 ISP、H.265/H.264视频压缩编解码器、高性能硬件DLA模块、图形引擎、显示控制器、以太网PHY、USB 2.0 (Host/Device)、音频编解码器、RTC和SD/SDIO 3.0提供最佳性价比Edge-IP Camera解决方案、可适用于Professional IPCAM、HOME / Co
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IP CAM nt98560 aiot ai
- 可定制RISC-V处理器硅知识产权（IP）的领导者Codasip日前宣布，其Codasip Studio平台现已支持苹果公司macOS Monterey（当前macOS的主要版本）。Codasip Studio是一个处理器设计自动化平台，用于完成Codasip领先的RISC-V处理器IP的定制，使设计人员能够快速且轻松地定制其处理器设计，以面向特定领域中的应用实现最高性能。Codasip Studio还可以用于创建Codasip的业内最佳的RISC-V处理器内核，并帮助设计人员评估微架构的替代方案。应用软
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RISC-V IP
- 楷登电子（美国 Cadence 公司）今日宣布，其面向 TSMC N7、N6 和 N5 工艺技术 PCI Express®（PCIe®）5.0 规范的 PHY 和控制器 IP 在 4 月举行的业界首次 PCIe 5.0 规范合规认证活动中通过了 PCI-SIG® 的认证测试。Cadence® 解决方案经过充分测试，符合 PCIe 5.0 技术的 32GT/s 全速要求。该合规计划为设计者提供测试程序，用以评估系统级芯片（SoC）设计的 PCIe 5.0 接口是否会按预期运行。 面向 PCIe 5
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Cadence TSMC PCIe 5.0
- 芯研所6月22日消息，在AMD首发PCIe 4.0后，Intel去年开始普及PCIe 5.0。PCIe 6.0规范今年初才刚刚对外公布，标准组织PCI SIG今天正式宣布开发PCIe 7.0，并前瞻了核心参数。和这几代的变化类似，PCIe 7.0在PCIe 6.0的基础上再次实现带宽翻翻，达到128GT/s，x16通道双向可以达到512GB/s。即便是SSD常走的x2/x4通道，理论峰值速度也分别提高到64GB/s和128GB/s，想象空间无限大。细节方面，PCIe 7.0和6.0一样，采用全新的PAM4
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PCIe PCI SIG 英特尔
- 当今互联网世界正在经历一场革命，万物互联的理念深入人心，异军突起的可穿戴设备，渐入佳境的物联网，以及数据中心的增加等等，使得互联网连接设备的数量暴增，同时全球疫情带来的远距离办公提升了人们对于连接速度和稳定性的要求。不准确统计，现在有超过100种不断变化的接口标准、规范、合规性计划，为测试和设备连接的正常运行带来了更大的挑战。 2022年6月9日，GRL作为高速信号测试提供工程服务与测试自动化解决方案的全球领导者，召开了关于“电气一致性测试自动化软件解决方案”的线上发布会，与我们一同分享了他们为提高
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GRL PCIe 5.0 接口 电气一致性测试
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