芬兰的 Flow Computing 已开始对其并行处理单元 （PPU） AI 模块的 RISC-V 编译器进行 alpha 测试。PPU 能够通过使用编译器使源代码利用该架构，将任何 CPU 架构增加多达 100 倍。第一次目标编译表明，通过重新编译现有代码，可以显著减少 RISC-V CPU 模型中常见的循环，达到 100 倍的预期性能。相比之下，只需将一些 CPU 内核替换为 PPU，即可在不更改源代码的情况下进行 2 倍的改进，而无需重新编译。编译器识别现有源代码中可由 PPU 有效加速的并行元素
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并行AI RISC-V 编译器 Alpha测试
Structera CXL的互操作性将推动同时运行AMD EPYC CPU和第5代英特尔至强CPU的数据中心的内存性能提升。Marvell Technology最近宣布，其Structera CXL平台与AMD的EPYC CPU和英特尔第5代至强可扩展平台兼容，这标志着计算快速链路（CXL）内存性能的一个重要成就。云数据中心通常必须部署来自多个处理器供应商的服务器。虽然这种混合部署AMD和英特尔CPU的系统能够实现更快的数据中心扩展，但由于高速内存互操作性的挑战，它也可能导致性能下降。图片来源于AMDMa
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英特尔 AMD CPU 服务器
西班牙的 SemiDynamics 开发了一种完全可编程的神经处理单元 （NPU） IP，它结合了 CPU、向量和张量处理，可为大型语言模型和 AI 推荐系统提供高达 256 TOPS 的吞吐量。Cervell NPU 基于 RISC-V 开放指令集架构，可从 8 个内核扩展到 64 个内核。这使设计人员能够根据应用的要求调整性能，从紧凑型边缘部署中 1GHz 的 8 TOPS INT8 到数据中心芯片中高端 AI 推理中的 256 TOPS INT4。这是继 12 月推出的一体化架构之后发布的，本白皮书
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SemiDynamics RISC-V NPU
周二，英特尔通知各方，它正式将其用于台式机的盒装 Core Ultra 7 200 系列处理器的建议零售价 （SRP） 下调了约 100 美元。CPU 开发人员降低其产品的价格是很常见的，但像 Intel 这样的公司正式确认此类举措并不常见。但是，有一个小问题：由于我们正在处理 SRP，因此实际价格可能会有所不同。立即生效，英特尔的酷睿 Ultra 7 处理器 265K 的建议零售价为 299 美元（之前为 399 美元），而酷睿 Ultra 7 型号 265KF 的建议零售价为 284 美元（之前为 3
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英特尔 Core Ultra 7 台式机 CPU
4月15~17日，沁恒多维度、多层次的USB/Type-C/蓝牙/以太网接口芯片和青稞RISC-V系列MCU/SoC亮相2025上海慕尼黑电子展，现场人气火爆。RISC-V全家桶、Type-C全家桶等特色版块，工业控制、物联网、计算机手机周边等场景专题，9大版面充分诠释了沁恒对专业RISC-V玩家的定义：技术上一捅到底、产品上百花齐放，应用上互连互通。一捅到底的技术处理器“核”技术是数据处理的关键，接口底层PHY“根”技术是信息交换的窗口。秉承由核到芯、由内而外的全栈自研模式，沁恒青稞RISC-V贯穿了内
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RISC-V 沁恒 上海慕展
全球半导体产业竞争日趋激烈，RISC-V（第五代精简指令集计算机）凭借开源等优势有望改写芯片市场竞争格局。随着国际形势不断复杂化，RISC-V为中国在处理器设计领域实现自主可控提供了一条加速路径。近年，在政策支持、产业投资以及RISC-V架构自身优势的共同推动下，中国已成为全球RISC-V开发和应用的主要中心，国内RISC-V芯片正加速突围崛起。RISC-V快速崛起，生态链蓬勃发展RISC-V诞生于2010年左右加州大学伯克利分校的一项学术研究，其初衷是创建一种现代、简洁、可扩展且不受现有架构（如ARM、
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芯片规则 RISC-V
上个月，一个 Google 安全研究人员团队发布了一个工具，该工具可以修改基于 Zen 微架构的 AMD 处理器的微码，即 Zentool。虽然这是一个安全漏洞，但对某些人来说，这是一个机会:来自中国某项目组的成员正在举办一项竞赛，旨在为 AMD 基于 Zen 的现代 CPU 开发微码，使其能够本地执行 RISC-V 程序。最终目标可能是使用现有的芯片构建终极 RISC-V CPU。x86 是大约 48 年前开发的复杂指令集计算机 （CISC） 指令集架构 （ISA）。但是，
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AMD Zen处理器 RISC-V 代码
2025年4月9日——中国数字EDA龙头企业上海合见工业软件集团有限公司（简称“合见工软”）与北京开源芯片研究院（简称"开芯院"）宣布双方就“香山”高性能开源RISC-V处理器项目深化技术合作的又一重要成果，依托合见工软自主研发的全场景验证硬件系统UniVista Unified Verification Hardware System（UVHS），双方成功实现“香山”第三代昆明湖架构RISC-V处理器在16核大系统的软硬件协同实测验证。此次技术突破显著提升了处理器的开发验证效率，为后
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合见工软 开芯院 RISC-V
当您比较两款最佳 CPU时，首先想到的规格是时钟速度。它实际上代表了 CPU 处理时钟周期的速度，自然而然地，您会认为更高的时钟速度意味着更高的性能。然而，如今时钟速度并不能说明什么。它仍然可以代表两个 CPU 之间的性能差异，但在为您的设备选择处理器时，您还应该记住其他几个注意事项。时钟速度说明了你的 CPU首先，定义一下。CPU 的时钟速度定义了它每秒可以完成多少个周期。它只是一个频率，与音频频率没有什么不同，这一点很重要。时钟速度并不说明 CPU 一秒钟可以执行的指令数量。它只涉及一秒钟可以完成的时
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CPU 选型
对于使用基于 RISC-V 的平台的开发人员，该架构提供了独特的功能，可帮助实现功能安全和信息安全目标。例如，从开放式架构到丰富的工具生态系统，安全关键型软件团队看到了满足 DO-178C 和 ISO 26262 准则的好处，以及减少合规工作的机会。了解如何将 RISC-V 的模块化、简单性和可扩展性与行业标准对应起来可能很困难。本文介绍了开发人员可以利用 RISC-V 实现认证安全关键型系统的合规性的七种方式。降低系统复杂性RISC-V 的开放标准指令集架构 （ISA） 与专有架构相
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安全关键系统认证 RISC-V
国芯科技(688262.SH)公告称，公司基于RISC-V架构多核CPU自主研发的超高性能云安全芯片CCP917T新产品于近日在公司内部测试中获得成功。国芯科技本次内测成功的超高性能云安全芯片CCP917T，拥有超高的算法性能和接口带宽，为云安全应用场景下的数据处理提供高带宽、低延迟、快响应支撑。可以广泛应用于信息安全各个领域：● 需处理大规模加密数据流、虚拟化资源动态分配，以及存储加密服务的云计算● 超低时延、海量连接场景需高效密码运算的5G网络● 需处理高并发交易、
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国芯科技 RISC-V 云安全芯片
全球PC用户硬件配置呈现显著变化，八核CPU首次超越六核CPU成为最受欢迎的配置，这一趋势被认为与AMD锐龙 7 9800X3D处理器的热销密切相关。不过，截至2025年4月1日最新数据显示，目前在CPU市场中，英特尔仍以56.3%的份额保持领先，但较上年下降10%；AMD市场份额增至43.7%，同比上升16.6%，在八核市场的强势表现是其份额增长的重要驱动力。根据上月在美国亚马逊平台上，AMD的CPU销量占比高达78.74%，销售额达到约780万美元，而英特尔的CPU仅占21.26%，销售额约为150万
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AMD 英特尔 CPU 锐龙 酷睿
今天给大家分享一个耗时又有趣的项目：手搓一个16位RISC架构CPU。项目的起因是，作者在学习了MITx的 "计算结构 "课程后，发现好像自己做一个CPU也没那么难。在掌握了电子学的初级知识和课程中介绍的概念之后，就开始设计想要做一个基于NMOS逻辑的RISC CPU。课程中介绍的是Beta CPU——有一个负载存储，32位RISC架构。为了节省空间、晶体管，少掉一点头发，作者决定把自己的这个CPU减少到16位。注：MITx的"Computation Structures&q
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RISC-V CPU
Arm Holdings 希望到 2025 年底将其在全球数据中心 CPU 市场的份额从 15% 提高到 50%。Arm 基础设施高级副总裁 Mohamed Awad 在接受路透社采访时提出了这一说法。该公司主要将希望寄托在 AI 服务器上，因此请考虑 Nvidia 的 GB200 和 GB300 机器、大型云服务提供商的定制芯片以及基于 Ampere Computing 的系统等产品。如今，大多数服务器都运行依赖于 x86 指令集架构的 AMD EPYC 处理器或 Intel 的 Xeon CPU，因为
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ARM CPU 数据中心
4月3日消息，2日深夜，复旦大学宣布，复旦大学集成芯片与系统全国重点实验室周鹏、包文中联合团队成功研制全球首款基于二维半导体材料的32位RISC-V架构微处理器“无极（WUJI）”，中国二维半导体芯片取得里程碑式突破。该成果突破二维半导体电子学工程化瓶颈，首次实现5900个晶体管的集成度，是由复旦团队完成、具有自主知识产权的国产技术，使我国在新一代芯片材料研制中占据先发优势，为推动电子与计算技术进入新纪元提供有力支撑。相关成果已以《基于二维半导体的RISC-V 32比特微处理器》（“A RISC-V 32
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RISC-V 二位半导体材料
risc-v cpu介绍
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