- 全球领先的电子器件和系统设计、验证和制造软件及知识产权(IP)供应商新思科技公司(Synopsys, Inc.， 纳斯达克股票市场代码：SNPS)日前宣布：其DesignWare DDR接口IP产品组合已经实现扩充，以使其包括了对基于新兴的DDR4标准的下一代SDRAM。通过在一个单内核中就实现对DDR4、DDR3以及LPDDR2/3的支持，DesignWare DDR解决方案使设计师能够在相同的系统级芯片(SoC)中，实现与高性能或者低功耗SDRAM的连接，它已经成为诸如用于智能手机和平板电脑的应用处理
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Synopsys SDRAM
- DR2(Double Data Rate 2，两倍数据速率，版本2) SDRAM，是由JEDEC标准组织开发的基于DDR SDRAM的升级存储技术。 相对于DDR SDRAM，虽然其仍然保持了一个时钟周期完成两次数据传输的特性，但DDR2 SDRAM在数据传输率、
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CPU 硬件 设计 MPC8548 基于 SDRAM 介绍 及其 DDR2
- 电子产品世界,为电子工程师提供全面的电子产品信息和行业解决方案,是电子工程师的技术中心和交流中心,是电子产品的市场中心,EEPW 20年的品牌历史,是电子工程师的网络家园
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DSP 存储系统 SDRAM
- 存储器是容量数据处理电路的重要组成部分。随着数据处理技术的进一步发展，对于存储器的容量和性能提出了越来 ...
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多路读写 SDRAM 数据处理
- 采用Xilinx 和FPGA的DDR2 SDRAM存储器接口控制器的设计,本白皮书讨论各种存储器接口控制器设计所面临的挑战和 Xilinx 的解决方案，同时也说明如何使用 Xilinx软件工具和经过硬件验证的参考设计来为您自己的应用(从低成本的 DDR SDRAM 应用到像 667 Mb/sDDR2 SDRAM 这样的更
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接口 控制器 设计 存储器 SDRAM Xilinx FPGA DDR2 采用
- 摘要：充分利用DDR2 SDRAM速度快、FLASH掉电不消失、MATLAB/Simulink易产生矢量信号的特点，以FPGA为逻辑时序控制器，设计并实现了一种灵活、简单、低成本的矢量信号发生器。本文以产生3载波WCDMA为例，详细介绍了矢量信号发生器的设计方案与实现过程，使用Verilog HDL描述并实现了DDR2 SDRAM的时序控制和FPGA的逻辑控制。
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DDR2 SDRAM FLASH 201205
- 在高速数字视频系统应用中，使用大容量存储器实现数据缓存是一个必不可少的环节。SDRAM就是经常用到的一种存储器。但是，在主芯片与SDRAM之间产生的时序抖动问题阻碍了产品的大规模生产。在数字电视接收机的生产实际
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控制 分析 时序 SDRAM 视频系统 嵌入式
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DSP 存储系统 SDRAM
- 前个周末接到了一个朋友的电话，询问我如果内存有问题，需要测试哪些项目？对于这个很常见的问题，我习惯性的回答他...
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DDR测试 SDRAM 时钟分析
- 摘要：主要分析了PC-BasedPLC在控制系统中存在的理由及其发展过程，并对基于PC-BasedPLC架构的控制系统的集...
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PC-Based PLC 控制器
- Cyclone II实现DDR SDRAM接口的方法,在不增加电路板复杂度的情况下要想增强系统性能，改善数据位宽是一个有效的手段。通常来说，可以把系统频率扩大一倍或者把数据I/O管脚增加一倍来实现双倍的数据位宽。这两种方法都是我们不希望用到的，因为它们会增加
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接口 方法 SDRAM DDR II 实现 Cyclone
- 为数字家庭、网络和移动应用提供业界标准处理器架构与内核的领导厂商美普思科技公司 (MIPS Technologies, Inc) 日前宣布，将参加于 2012 年 3 月 21-23 日在北京中国国际展览中心举行的中国国际广播电视信息网络展览会 (CCBN)。CCBN 是亚太地区的大型技术与设备展览会，为中外广播技术与设备厂商提供最佳交流平台。
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MIPS 处理器 Based
- 摘要：SDRAM的读写逻辑复杂，最高时钟频率达100 MHz以上，普通单片机无法实现复杂的SDRAM控制操作，复杂可编程逻辑器件CPLD具有编程方便，集成度高，速度快，价格低等优点。因此选用CPLD设计SDRAM接口控制模块，简化
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设计 控制器 SDRAM EPM1240 基于
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