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VHDL的英文全名是Very-High-Speed Integrated Circuit HardwareDescription Language，诞生于1982年。1987年底，VHDL被IEEE和美国国防部确认为标准硬件描述语言 。自IEEE公布了VHDL的标准版本，IEEE-1076（简称87版)之后，各EDA公司相继推出了自己的VHDL设计环境，或宣布自己的设计工具可以和VHDL接口。此后VHDL在电子设计领域得到了广泛的接受，并逐步取代了原有的非标准的硬件描述语言。

  • vhdl资讯

高云半导体自主研发的逻辑综合工具Gowin Synthesis支持VHDL硬件描述语言

半导体 VHDL 2020-04-01

一文看懂VHDL和Verilog有何不同

VHDL Verilog 2018-11-08

VHDL语言实现的帧同步算法

VHDL 帧同步 2018-09-11

基于CPLD的测试系统接口设计

EDA CPLD 2018-07-27

基于VHDL逻辑电路设计与应用

EDA VHDL 2018-07-27

基于FPGA的Petri网的硬件实现

EDA技术 FPGA 2018-07-27

基于FPGA的数字密码锁

VHDL FPGA 2017-10-20

引入EDA技术进行数字电路设计的方案

EDA技术 PCB 2017-06-13

基于VHDL语言为核心的EDA技术在医学中的应用

VHDL Max+PlusⅡ 2017-06-07

EDA中的车载DVD位控主要VHDL源程序

车载DVD VHDL 2017-06-06

FPGA系列相关图书介绍

VHDL FPGA 2017-06-06

基于FPGA的数字式心率计的设计实现

VHDL 数字式 2017-06-06

VHDL结构体的行为描述法

VHDL 结构体 2017-06-06

异步FIFO的VHDL设计

异步 FIFO 2017-06-06

VHDL结构体的结构化描述法

VHDL 结构体 2017-06-06

VHDL结构体的数据流描述法

VHDL 结构体 2017-06-06

用VHDL设计实现的有线顶盒信源发生方案

VHDL 有线顶盒 2017-06-06

Verilog语言要素

Verilog 语言要素 2017-06-06

Verilog HDL的历史及设计流程

VerilogHDL VHDL 2017-06-06

SystemVerilog语言简介

SystemVerilog 语言 2017-06-06

HDL语言种类

HDL VHDL 2017-06-06

Verilog HDL和VHDL的比较

Verilog VHDL 2017-06-06

什么是VHDL?

VHDL 2017-06-06

VHDL设计的串口通信程序

VHDL 串口通信 2017-06-06

基于CPLD的字符叠加器的设计

字符叠加器 RAM 2017-06-06

VHDL编码中面积优化探讨

VHDL 编码 2017-06-06

IC设计工程师需要这样牛X的知识架构

IC设计 VHDL 2017-06-05

基于FPGA的串行通信控制系统的设计

模块化设计 串行通信控制系统 2017-06-05

TPC码译码器硬件仿真的优化设计

TPC码迭代译码器 VHDL 2017-06-05

VHDL设计中电路优化问题

行为级设计 VHDL 2017-06-05

基于VHDL的旋转编码器接口电路的实现

旋转编码器 VHDL 2017-06-05

同步数字复接的设计及其FPGA技术实现

同步数字复接 VHDL 2017-06-05

VHDL语言为核心的EDA技术在医学中的应用方案

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基于FPGA的全数字交流伺服系统信号处理

交流伺服系统 VHDL 2017-06-05

基于FPGA的全数字锁相环路的设计

VHDL 数字锁相环 2017-06-05

步进电机定位控制系统的VHDL程序设计

步进电机 VHDL 2017-06-05

基于VHDL的HDB3编码器设计

VHDL HDB3编码器 2017-06-05

SDRAM控制器的设计与VHDL实现

VHDL 状态机 2017-06-05

数字变频的FPGA实现

数字变频 VHDL 2017-06-05

基于FPGA的数据并转串SPI发送模块的设计

SPI VHDL 2017-06-05
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