联华电子今(3日) 与 ASIC 设计服务暨 IP 研发销售厂商智原科技共同发表智原科技于联电28奈米 HPCU 工艺的可编程12.5Gbps SerDes PHY IP 方案。此次智原成功推出的 SerDes PHY，为联电28奈米 High-K / Metal Gate 后闸极技术工艺平台中一系列高速 I/O 解决方案的第一步。
藉由采用涵盖1.25Gbps 到12.5Gbps 的可编程架构技术，此 SerDes PHY 能够轻易支持10G/1G xPON 被动光纤网络通讯设备。结合不同的
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联华电子 ASIC
2016年6月16-17日，ARM在京举办了“ARM Tech Day” (ARM技术日)，专门针对中国大陆和台湾地区的媒体人。来自ARM英美中的专家盘点了ARM的IP(知识产权)产品，并分析了热门的手机、AR/VR、汽车等技术市场。
移动产品与IP趋势
在移动领域，实际上，除了大家所熟悉的应用处理器IP，ARM的IP种类更加繁多，而且非常系统化(如图1)。因为SoC需要有完整的设计考虑。ARM移动市场全球营销总监James Bruce称。
图1 AR
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ARM IP
高通专利授权业务正面临欧盟、南韩、台湾等地的反垄断调查，高通法务长Don Rosenberg强调，高通并非垄断企业，而IP是保护创新，并采用广泛授权，让产业得利。业界解读，高通向我国公平会喊话的意味浓厚。
高通最近邀请台湾媒体参访圣地牙哥总部，介绍业务重心，专利授权业务为重点之一。Don Rosenberg和圣地牙哥经济发展企业执行长Mark Cafferty、CONNECT总裁Greg McKee等人更畅谈圣地牙哥的引资和创新。
Cafferty和McKee指出，圣地牙哥是全球最多元化的
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高通 IP
新发布的思科视觉网路指标(Cisco Visual Networking Index，VNI)预测，从2015年到2020年，全球IP数据流量将于未来5年成长3倍，从2015年的30亿人增加至2020年的41亿人，会有超过10亿名网路新用户加入全球网路社群，达到22%的年复合成长率(CAGR)。
随着日益普及的个人装置及机器对机器(M2M)采用和部署，推动全球数位转型，网路数据流量将会有显着的成长。在未来5年，全球IP网路会支援100亿个新装置及连结，从2015年的163亿上升至2020年的26
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IP 物联网
静态时序分析简称STA(Static Timming Analysis)，它提供了一种针对大规模门级电路进行时序验证的有效方法。它指需要更具电路网表的拓扑，就可以检查电路设计中所有路径的时序特性，测试电路的覆盖率理论上可以达到100%，从而保证时序验证的完备性;同时由于不需要测试向量，所以STA验证所需时间远小于门级仿真时间。但是，静态时序分析也有自己的弱点，它无法验证电路功能的正确性，所以这一点必须由RTL级的功能仿真来保证，门级网表功能的正确性可以用门级仿真技术，也可以用后面讲到的形式验证技术。值
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fpga asic 静态时序
2016年商用IP是否也将如同以往，各家供应商只期望在各方面推进一点就好?答案是对、也是不对。
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IP SoC
2月5日消息，ARM 宣布，从即日起全球晶圆专工领导者联华电子(UMC)的28纳米28HPC工艺可采用ARM Artisan物理IP平台和ARM POP IP。
此举将扩大ARM在28纳米IP的领先地位，使得ARM的生态合作伙伴能够通过所有主要的晶圆代工厂获得最广泛的28纳米基础IP。该全面性平台包括标准元件库(standard cell libraries)和记忆编译器(memory compilers)以及POP技术，可支持获业界广泛采用的64位ARM Cortex-A53，以及应用于超过1
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ARM IP
Arteris 于近日宣布国内领先系统厂商相继导入Arteris FlexNoC 总线IP。中兴通讯(ZTE)为国内领先手机及网络设备制造商，设计开发软硬件系统及部分自家芯片。北京松果则为一家成长迅速的手机芯片设计公司。
“在对我们SoC芯片作了详细严格的评估后，我们决定采用Arteris FlexNoC 技术” ，北京松果电子叶渊博副总指出。
中兴通讯项目负责人李总则说明 “经过长期与严苛的评估，我们最终选择Arteris FlexNoC总线IP&rd
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中兴通讯 IP
Arteris，让人联想起arteries(动脉)。顾名思义，该公司要做SoC中IP和功能块之间互联的动脉。2013年笔者就采访过这家年轻的初创公司，市场副总裁Kurt Shuler的生动讲演就给笔者留下过深刻印象，他提出了NoC(Network on a Chip)概念，这当然不是网络芯片的意思，而是一种在SoC内部加速IP和各功能块之间互联的IP。之所以叫NoC，因为该公司的创始人过去是网络出身，认为可以把网络概念移植到芯片上。 在2015年Globalp
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SoC IP
除法，这个小学4年纪就开始学习和使用的方法却一直是我这个ASIC工程师心中的痛。我一直在思考如何能找到一个简单(硬件资源少)而快捷(时钟排数少)的通用除法电路。 其实简单的说除法可以用迭代的减法来实现，但是对于硬件，这恐怕要花很多时间。我也一直没有找到实现任意除法的好方法。但是对于某些除数固定的除法还是有一些办法的。 1)最容易想到的就是ROM查找表，但是ROM毕竟不是我们的目标，虽然ROM有时是不错的方法。 2)我开始仔细考虑这个问题是在做264解码时必须要处理QP的问题。这是一个除以6的计算
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除法电路 ASIC
全球半导体在2016年维持跟全球GDP小幅成长态势，日月光(2311)集团营运长吴田玉今(2)日在南韩首尔表示，大国经济有内需与品牌经 济特性，与靠出口的小国经济是不同的。台湾在全球半导体地缘政治中，是美国、日本与欧洲等公司合作伙伴，能替客户保密知识产权，所以，台湾可以如同金融业 的中立地位、做半导体界的瑞士。
在全球半导体制造的变迁中，美国已决定不做了，日本业者也正在出场之中，欧洲半导体业则只有少数公司作制造，正在离开制造端。
(一)全球半导体地缘政治版图，台湾能取得平衡角力点：
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半导体 IP
2015年10月19日，Mentor Graphics公司今天宣布，推出支持25G、50G和100G以太网的Veloce® VirtuaLAB Ethernet环境。这种支持有助于实现今天正在创建的基于大规模以太网设计的高效的、基于仿真的验证。
连接需求的激增对交换机和路由器设计的尺寸有着深远的影响，使之成为了今天开发的最大的IC设计。设计的绝对尺寸、早期发布的压力，以及需要验证所有路径，都推动着将验证从模拟转向基于仿真流程方法的转变。
Juniper Networks硅和系统工程
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Mentor Graphics ASIC
谈到EDA与IP业者之间的合作关系，Imagination行销执行副总裁Tony King-Smith表示，Imagination与主要的EDA及居于领导地位的晶圆代工业者都有相当密切的合作，在考量到PPA(性能、功耗与面积)最佳化的前提下，以协助共同客户群的设计流程能执行的更加顺畅，所以Imagination会提供“参考设计流程”供客户们参考之用。随着时间推移，Imagination与EDA业者的合作范围也愈趋于广泛，在函式库方面，像是新思科技也会提供不少帮助，若再配合前面所
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IP EDA
作为全球第三大IP供应商，Imagination在合并MIPS后大举强化CPU IP，配合自己擅长的GPU IP，加上新整合的RPU(Radio Programmable Unit)IP，及套装安全性软、韧体资源，Imagination似乎已为新的移动装置、物联网(IoT)时代做好准备。
为进一步了解Imagination心中所策划的未来半导体世代技术及产品蓝图，DIGITIMES专访Imagination行销副总Tony King-Smith，以下为专访内容。
问：全球半导体产业似乎正进
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Imagination IP
市场研究公司IHS Infonetics近期发布了“全球运营商眼中的边缘和核心路由，及运营商以太网交换机厂商排名”报告。IHS选取了全球25家运营商的员工作为调查样本和受访者，他们熟知所在公司的数据网络，并影响着路由和交换设备的规划和购买决策。参与调研的25家运营商基本是全球一线的运营商，其网络规模和复杂性及其在网设备所涉及的提供商数量均远高于业界平均水平，他们的资本支出加起来共占据了全球电信行业的33%。
阿尔卡特朗讯在本次调研中，在“服务支持”
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阿尔卡特朗讯 IP
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