低功耗可编程器件及平台固件领域的领先供应商莱迪思半导体（Lattice Semiconductor，NASDAQ：LSCC）今日宣布推出最新版本的Lattice Sentry™解决方案集合（v5.0），这是业界首款支持后量子密码学（PQC）的平台固件弹性（PFR）与证明解决方案。Lattice Sentry将莱迪思在后量子密码学领域的领先优势从芯片拓展至完整的平台安全技术栈，为AI数据中心和关键基础设施提供契合CNSA 2.0要求、符合NIST标准的安全防护，为系统设计人员提供经过验证、可用于量产的抗量子
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莱迪思
后量子密码学
LatticeSentry
FPGA
AMI平台管理
低功耗可编程器件及平台固件领域的领先供应商莱迪思半导体（Lattice Semiconductor，NASDAQ：LSCC）今日宣布与Arm开展合作，为AI基础设施提供安全的控制与管理能力，提升平台适应性。该解决方案将Arm® AGI CPU服务器平台与莱迪思FPGA及AMI固件相结合，为下一代AI数据中心基础设施提供先进的安全性、可管理性、连接能力和灵活性。在Arm AGI CPU服务器平台中，莱迪思FPGA与CPU及基板管理控制器协同运行，AMI固件则提供平台启动和管理功能。莱迪思FPGA作为配套芯片
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莱迪思半导体
Arm
AI基础设施
FPGA
AMI固件
CPU
低功耗可编程及平台固件领域的领先供应商莱迪思半导体（NASDAQ: LSCC），近日宣布推出全新Lattice Mach™-N2 FPGA系列，进一步巩固莱迪思在安全控制FPGA领域的长期领先地位。Mach-N2专为现代基础设施中的系统控制与安全需求打造，基于Lattice Nexus™ 2小型FPGA平台，将集成式闪存、硬件可信根以及符合CNSA 2.0要求的后量子加密（PQC）与密码敏捷性相结合，为下一代系统提供可信、始终在线的系统控制与安全能力。莱迪思半导体首席战略和营销官 Esam Elashma
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莱迪思半导体
FPGA
系统控制
后量子加密
Mach-N2
随着分布式能源的大规模接入、配电网络拓扑的日益复杂化以及全社会对高质量电能的依赖度不断攀升，供电可靠性已不再仅仅是衡量电网服务水平的一项常规指标，而是维系工业生产与现代社会运转不可逾越的生命线。在这一演进过程中，如何在线路发生突发故障的瞬间，实现秒级感知、米级定位，成为了新一代智能电网建设亟待攻克的关键技术高地。面对挑战，兆易创新依托自研高性能MCU与完整模拟信号链，创新推出高集成、低功耗的行波测距参考方案，为电网设备自主可控与智能化演进筑牢根基。近日，兆易创新PMU事业部资深工程师舒先来在专题演讲中深入
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数模协同
新型电网
兆易创新
FPGA
GD32H757
行波测距
该单芯片解决方案可在宽工作电压范围内完成电平转换，简化与最新处理器的高精度内部时钟网络互连随着高性能FPGA、SoC、AI加速器与新一代CPU广泛采用先进FinFET工艺节点，低压时钟驱动器的市场需求持续攀升。由于标准1.2V LVCMOS 时钟缓冲器供应有限，以及缺乏能够将较高电压时钟信号转换为先进器件所需低电压电平的电平转换缓冲器，印制电路板设计人员面临越来越大的设计挑战。依赖分立器件和分压技术的传统方案可能会影响信号完整性和时钟占空比精度，同时增加电路板复杂度和元件数量。Microchip推出&nb
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Microchip
1.2V
时钟缓冲器
SoC
FPGA
高电压器件
近日，全球最大专注于FPGA解决方案的提供商Altera宣布，其Agilex® 3和Agilex® 5 FPGA产品已新增对后量子密码学（Post-Quantum Cryptography，PQC）的支持，此举为其FPGA产品组合引入了面向量子时代的安全防护能力，可助力客户更好地应对量子计算带来的安全挑战，加强长生命周期系统的安全防护。支持PQC的Agilex® FPGA将提供可持续演进的安全基础架构，助力客户随着安全威胁和密码学标准的迭代，不断增强防护能力。
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Altera
FPGA
后量子密码学
安全防护
人工智能的演进正在进入第四波浪潮。从感知 AI、生成式 AI、智能体 AI，到如今的物理 AI，智能不再局限于数字世界，而是开始拥有实体形态，直接作用于物理环境。人形机器人、四足机器人、手术机器人等具身智能设备已从概念走向现实，成为结构性转变而非周期性趋势。然而，物理 AI 的规模化落地面临一项核心工程挑战：如何在边缘侧高效连接、处理并保护海量且多样化的传感器数据？传感器多样性与系统瓶颈每一种具身机器人都需要专属的传感器配置组合——视觉、力矩、惯性测量、激光雷达、超声波等。这些传感器接口各异、数据格式不同
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人工智能
Lattice
物理AI
传感器
FPGA
协同芯片
紧凑型、高性能边缘AI系统的兴起正在重新定义传感器连接方式，推动开发人员打造面向未来的兼顾安全性与可扩展性的低功耗且节省空间的架构。为应对这些挑战，Microchip Technology（微芯科技公司）推出第二代 PolarFire® FPGA 以太网传感器桥接平台。这款开发板采用NVIDIA Holoscan传感器桥接（HSB）技术实现标准化传感器集成，体积显著缩小，可立即投入量产。这款2.0版本的开发板支持HSB，尺寸缩小60%，可接入摄像头数量翻倍，采用USB-C供电以简化机架部署，且定价比第一代
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Microchip
FPGA
以太网传感器桥接
传感器连接
在外科手术和急救护理领域，对高分辨率摄像头和显示屏的需求不断增长，主要原因在于临床对更高视觉精度的追求。更清晰、更细致的影像呈现，能够让医生在手术过程中更迅速、更准确地完成判断与决策。同时，相关设备在设计时也越来越注重医护人员的使用体验与舒适度，以减轻长时间手术带来的疲劳，并确保设备能够无缝融入日常工作流程。为了应对上述需求，ADI公司开发了Gigabit Multimedia Serial Link™（GMSL，千兆多媒体串行链路）技术，支持通过单条线缆传输未经压缩的视频、控制信号和电力，从而简化系统设
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医疗基础设施
内窥镜
FPGA
GMSL技术
手术可视化
众多机器人团队最终都会面临同一个困惑：明明芯片性能表现出色、基准测试结果亮眼、技术演示也稳定流畅，可为什么从实验室原型到真正可部署的机器人产品，中间仍然需要长达18个月的时间？问题的关键往往不在处理器本身，而在处理器之外的一切。如今自主机器人开发者面临的真正问题，并非哪款计算模块能提供最高的峰值吞吐能力，而是如何更快速地将一堆具有潜力的芯片，变成一台能工作、能验证、能量产的机器人。从微控制器到AI赋能的计算：全新自主机器人技术栈自主机器人架构正在发生变化。过去，系统运行在分布式微控制器上，每个微控制器只负
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ADI
机器人
AI
分布式微控制器
FPGA
摘要在现场可编程门阵列(FPGA)、专用集成电路(ASIC)和其他基于多轨处理器的系统中，随着电源时序规则愈发严格、时序要求日益精准、电压容差不断缩小，电源管理变得越来越复杂。时序错误可能造成闩锁或器件永久性损坏，而监控不足可能导致无法及时发现故障，使系统稳定性受到影响。本文提出了优化时序协调和故障响应的实用策略，并说明了与基本电源时序控制器方案相比，集成监控和工厂调整设置的8通道时序控制器如何有助于简化电源管理。引言人工智能(AI)、数据中心、医疗健康和工业自动化领域越来越多地使用现场可编程门阵列(FP
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FPGA
ASIC
电源
时序控制器
Microchip Technology Inc.（微芯科技公司）今日宣布，2026年Microchip中国技术精英年会（MASTERs）正式启动报名。作为面向嵌入式工程师的顶级线下技术培训活动，本届大会已是Microchip中国技术精英年会的第 23 届，与此同时，Microchip 中国也迎来深耕本土市场的第30周年，这不仅彰显了公司持续创新的实力，也体现了其长期扎根中国、坚定服务本地客户的承诺。 MASTERs 全称为Microchip Annual Strategic Technical
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微芯科
MASTERs
Microchip
边缘AI
FPGA
电机控制
人形机器人已进入到大型物流仓库中搬运货物、在汽车装配线上排列零部件，并在全球一些最大的订单履行中心开展试点运营。可以说人形机器人的第一波浪潮已经到来，其并非停留在实验室或演示中，而是在真实的生产环境中承担实际工作。高盛预测到2035年，该市场规模将达到380亿美元。而今天正在设计的人形机器人平台，正是未来随这一增长实现规模化扩张的关键。但制造人形机器人与制造传统机器截然不同。人形机器人是一个分布式计算平台，不仅需要行走、感知环境、在现场进行自我更新，还必须满足监管要求，而这一切都必须在有限的电池功耗预算下
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莱迪思
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人形机器人
我们很高兴宣布，AMD Spartan UltraScale+ SU200P FPGA 将于 2026 年 7 月正式投入量产。SU200P 是 Spartan UltraScale+ 系列中规模最大、性能最强的器件，采用成熟的 16nm FinFET 工艺。它为 AMD 成本优化型产品组合带来了高 I/O、低功耗、灵活连接，以及支持 PQC CNSA 2.0 的先进硬件安全能力。 AMD Spartan UltraScale+ SU200P FPGA 内部配置能力SU200P FPGA系统逻辑
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AMD
Spartan
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特性·正交解码器组件的VHDL源代码·输出正交编码器信号的方向和位置计数·可清零位置计数器以设置“原点”或索引·可配置位置计数器大小·可配置消抖时间以确保输入稳定性并消除毛刺简介本文详述了用于CPLD和FPGA的正交解码器电路，采用VHDL编写。该组件读取正交编码器的信号，判断方向，跟踪累计位置，并将结果输出至用户逻辑。设计基于Quartus II 13.1.0版本。资源需求取决于具体实现方案。图1展示了正交解码器集成至系统的典型示例。图 1. 实现示例背景正交编码器通过双通道检测运动装置（通常是旋转盘/
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VHDL
FPGA
CPLD
正交解码器
正交编码器
direction
position
GENERIC
Quartus
现阶段传统FPGA普遍存在资源分配固化的问题，逻辑单元与布线通道比例固定，很难适配结构多变的边缘AI负载。针对这项行业痛点，Efinix推出Titanium Edge系列边缘专用FPGA，凭借自研XLR可变单元架构，动态平衡芯片内部逻辑与布线资源，在同等性能条件下优化芯片面积与整体功耗。 传统FPGA固定资源架构与XLR可变单元结构对比传统FPGA存在固有设计短板常规FPGA芯片会提前划分固定区域，分别用于逻辑运算与信号布线。由于布线资源占用面积大、传输过程存在额外功耗与发热，厂商大多通过复杂化
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FPGA
边缘AI
ModRetro 正在将原汁原味的任天堂 N64 兼容游戏体验带给新一代玩家，而其所依靠的正是将 AMD Artix UltraScale+ FPGA 用于其全新 M64 游戏主机。 M64 游戏主机，兼容任天堂 N64 游戏卡带。图片来源：ModRetro。ModRetro 专注于打造高品质、基于 FPGA 的复古游戏主机，支持原装实体卡带，力求在硬件层面还原经典游戏体验。继推出专为运行原版 Game Boy 和 Game Boy Color 卡带打造的掌机 Chromatic 后
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AMD
FPGA
ModRetro
随着应用需求不断变化，叠加人工智能快速兴起，计算领域迎来全新变革。如今，算力高低不再单纯由时钟频率和通用处理器决定。传统处理器能效日渐触顶，性能提升空间急剧收窄。为此，设计人员开始转向专用芯片与硬件加速器，针对特定任务定制硬件电路，从而实现高速运算。这类经过深度定制的硬件模块，专为执行专属任务设计，也是技术发展到当前阶段、应对各类严苛限制下的必然选择。本文将带你快速了解硬件加速器的定义、原理以及实现方式。 硬件加速器的兴起在过去，提升芯片性能主要依靠提高时钟频率和增加并行运算能力。处理器主频实现
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硬件加速器
HLS
RTL
FPGA
ASIC
片上存储
开源软件如今无处不在：Linux 是全球服务器与超级计算机的主流操作系统，WordPress 更是支撑着超四成的网站平台，此外还有众多知名开源项目。开源硬件自 20 世纪 90 年代末便已出现，但其关注度与普及度远不及开源软件。初创企业 zeroRISC 创始人兼首席执行官多米尼克・里佐希望改变这一现状。近日，全球安全标准非营利联盟 GlobalPlatform 正式推出Pavona开源硬件生态，里佐担任该生态理事会主席。Pavona 旨在通过模块化、标准化与可信赖的硬件组件，推动开源硬件落地至各类场景，
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Pavona
开源硬件
OpenTitan
软件信任根
FPGA
为深度聚焦新一代高端FPGA与PSoC、人工智能和新一代存储技术三大核心方向，拟成立集成电路工程技术融合创新中心。5月12日，复旦微电发布公告称，为深度聚焦新一代高端FPGA与PSoC、人工智能和新一代存储技术三大核心方向，公司拟与复旦大学、国盛投资签署三方协议，共建“复旦大学集成电路工程技术融合创新中心”一期项目，实现在技术创新、人才培养和成果转化等方面的合作共赢。此次合作期限为协议生效后60个月（5年），复旦微电将向技术中心提供不超过10亿元合作经费，涵盖项目启动费、研发经费等，资金纳入公司年度研发预
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复旦微电
FPGA
PSoC
AI
鹏城五月，创新不止，2026年安路科技AEC FPGA技术沙龙首站将落地深圳，聚焦前沿技术，探讨应用落地新方向。米尔作为领先的嵌入式处理器模组厂商，将携安路FPGA核心板和开发板亮相，诚邀您莅临现场共同探讨和交流。我们诚挚邀请您莅临现场，共话未来图景。● 会议时间：2026年5月13日● 会议地点：深圳深铁塘朗君璞酒店现场活动：为回馈广大开发者长期以来的支持，米尔电子将在本次展会现场举办福利活动，限时免费赠送15套MYD-YM90G开发板。诚邀各位行业伙伴与
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米尔
安路科技
FPGA
简介更高效、更紧凑，这是快节奏的电子世界对电源解决方案提出的日益增长的需求。在电源技术进步的同时，工程师们不断寻求简化设计、减少占板空间并加快开发过程的方法。MPS 提供了极为广泛的电源模块产品组合，并将功率级、控制环路和电感集成在单个 SMD 封装中（见图 1），满足了设备对电源不断增长的高要求。 图1: MPS电源模块本文探讨集成型电源模块相对于传统分立 DC/DC 电源具有的诸多优势。简化设计并减少占板空间通过集成功率级、控制环路和电感，MPS 电源模块能够提供无可比拟的功率密度。利用MP
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集成电源模块
MeshConnect
COT控制
AVP瞬态优化
EMI
FPGA
MPM
DC/DC
电源模块封装
近日，全球最大专注于FPGA解决方案的提供商Altera宣布，正式推出FPGA AI套件 26.1.1 版本，完成其 AI 软件平台的重要升级。FPGA AI套件旨在简化并加速已训练 AI 模型在 FPGA 芯片上的部署落地，为机器人、实时自主设备等物理AI系统相关的边缘 AI 应用提供核心支撑。最新的 26.1.1 版本引入了全新的编译器技术，采用 AI 模型空间映射架构，可实现媲美ASIC的优化 AI 推理性能，同时有效控制研发成本，支持业务负载灵活迭代与再次编程，并保障基于 FPGA 架构的确定性和
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Altera
FPGA
AI套件
物理AI
当开发者想要榨干某一算法的极限性能、且软件优化手段已全部用尽时，可以通过软硬件功能重新划分对任务进行硬件加速。借助 FPGA，无需更换处理器、也无需改动电路板级设计，就能轻松将软件模块替换为硬件模块。本文将讲解如何利用 FPGA 对算法实现硬件加速。可定制指令集的可配置处理器架构图 1：带自定义指令的可配置处理器架构基于 FPGA 的硬件加速简介低成本可编程逻辑器件在嵌入式系统中的应用越来越普遍，让设计人员无需大幅改动处理器与硬件板卡，就能提升系统性能。可编程逻辑可将计算密集型函数转化为硬件加速器。从软件
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算法
硬件加速
FPGA
市场压力与设计挑战面对激烈的市场竞争，嵌入式系统设计人员必须重新评估开发流程。系统复杂度持续提升，同时在性能、功耗与空间方面的约束却愈发严苛。不断迭代的行业标准、新兴市场以及多变的行业趋势，要求设计流程具备高度灵活性，能够快速适配变化。设计人员需要开发更复杂的系统，并快速推出全新产品或衍生型号产品。尽管这些需求看似意味着需要投入更多开发时间与资源，但产品上市窗口期却在不断收窄，研发团队必须在更短周期内交付更先进、更灵活的系统方案。同时，成本预算限制往往迫使团队精简人员与投入，而非扩充规模。想要获得市场成功
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ARM
系统集成
FPGA
片上系统
FPGA 原型验证与硬件仿真，几乎同时起源于用可重构硬件实现数字设计的需求，而这一切得益于 FPGA 的诞生。但从一开始，两者的驱动目标就截然不同：硬件仿真：为应对设计复杂度而生，解决纯软件仿真无法验证百万门级芯片的问题，强调可控性与深度调试。FPGA 原型验证：为追求速度与真实运行而生，目标是在流片前高速运行设计，支撑软件开发、系统验证与真实业务负载。几十年来，二者长期处于平行世界，不仅技术目标不同，更有不同的工程思维与文化。如今，在市场与软件定义系统的推动下，两者已不再孤立，共同归入硬件辅助验证（HA
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FPGA
原型验证
硬件仿真
近日，全球最大专注于FPGA解决方案的提供商Altera宣布，将其Agilex®、MAX® 10和Cyclone® V FPGA系列的产品生命周期支持延长至2045年。此举彰显了Altera作为独立FPGA解决方案提供商专注客户长期需求、保障供应链稳定性，以及持续为基于FPGA的关键任务应用提供支持的坚定策略。此次延长生命周期支持的举措，进一步巩固了Altera对工业、通信、航空航天、医疗和交通等领域的客户构建长生命周期系统的坚定承诺。在这些市场中，半导体平台需要保证数十年的可用性和持续支持。通过这一举措
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Altera
FPGA
3月27日，上海复旦微电子集团股份有限公司发布了2025年年度报告。报告显示，公司全年实现营业收入39.82亿元，同比增长10.92%；归属于上市公司股东的净利润为2.32亿元，同比下降59.42%；扣除非经常性损益后的净利润为1.42亿元，降幅达69.3%。 报告显示，复旦微电的FPGA产品线表现突出，实现销售收入约13.16亿元，继续保持国内领先地位，并在通信、人工智能及高可靠领域持续扩展。安全与识别芯片收入约8.55亿元，其中RFID与传感芯片表现强劲。非挥发存储器收入约10.42亿元，受
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复旦微电
FPGA
中国，上海——2026年3月26日——低功耗可编程领域的领导者，莱迪思半导体（NASDAQ: LSCC）今日宣布正式加入英伟达（NVIDIA） Halos AI系统检测实验室生态体系。该实验室是首个获得美国国家标准协会认证委员会（ANSI National Accreditation Board，ANAB）认证、针对人工智能驱动的物理系统的检测实验室。此项合作在英伟达 GTC 2026大会上正式公布，莱迪思将与英伟达及其他Halos生态成员携手，开发基于Halos认证的Holoscan传感器桥接技术的物理
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英伟达
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