一种时延设计方法与DSP实现
加入技术交流群
设定一个输入信号x(n)包含f1=6．25 MHz和f2=10 MHz的信号，采样频率fs=25 MHz，要使信号多径时延精度达到1 ns，就要选择内插倍数为40倍。设计一个最高频率10 MHz的低通滤波器，得出含滤波器长度N=800的滤波器系数。将这些系数分为40个子滤波器参数组，每组中含有20个滤波系数，分别依次取子滤波器参数组组名为Group1，Group2，…，Group40。当信号需要延时5 ns时，通过内插后则需要5个采样样点延迟时间，然后再进行抽取实现。在DSP中算法的实现，是将包含f1=6．25 MHz和f2=10 MHz输入信号通过相对应的Group5子滤波器进行FIR卷积。在DSP系统的硬件仿真结果中可以得出输入输出信号时域波形图及其频谱图。图4是输入、输出信号时域波形比较图。本文引用地址：https://www.eepw.com.cn/article/152292.htm
从图4可以看出，在输入信号x(n)经过40倍内插滤波器滤波，并进行40倍抽取实现后的输出信号与输入信号有着相同的时域波形，并且输出信号时域波形相对输入信号时域波形出现了相应的延时。
图5为输入、输出信号的频谱图。
在原始采样频率fs为25 MHz下，输入信号x(n)经过40倍内插滤波器滤波并进行40倍抽取实现后，对输入输出进行频谱分析，可以得出输出信号的采样频率仍是25 MHz，并含有两个频率信号，其一信号频率f1=6．25 MHz，另一信号频率f2=10 MHz。从而得出输出信号频谱与输入信号频谱是吻合的，如图5所示。
3 结语
提出了一种实现时延的方法。可以选用大容量存储器作大尺度的延时处理，并选用DSP作插值算法做高精度的小尺寸的延时算法处理。结合软件无线电思想中的内插和抽取技术，重点介绍高精度、小尺寸的信号延时处理方法。它具有DSP处理时间周期短，节省DSP数据存储空间，时延精度高等特点。用实验板SEED-DEC6416进行硬件仿真。试验结果表明，设计结果基本达到要求，该方法的实现过程是可行的。
评论