基于DSP的CPLD软件更新方案研究

　　为实现本文提出的导航计算机系统中基于DSP的CPLD器件软件更新串行方案，首先需要在硬件方面解决如下3个问题：

　　(1)导航计算机系统所用DSP至少要有4个空余的I/O口，分别用于模拟CPLD的4个JTAG信号时序信号。

　　(2)导航计算机系统必须包含支持一个UART通信接口，用于接收CPLD的配置文件。此UART接口不能由CPLD参与控制，以避免CPLD某次编程失败后，该UART通信口不再可用的问题。

　　(3)导航计算机系统应保证足够的CPLD配置信息文件需要的存储空间。

　　本文所用DSP为TI公司的TMS320C6713B芯片，该款DSP支持16个通用输入输出口(GPIO)。在本导航计算机系统中，有12个GPIO口已被占用，多余的4个GPIO口可用来连接CPLD的4个JTAG信号引脚。

　　TMS320C6713B本身并不支持包含UART通信接口，其片上外设中包含2个多通道缓冲串行接口(McBSP)，McBSP接口支持全双工串行通信，只是收发数据需要独立的收发帧同步信号。根据TI公司提供的应用技术报告，经过对软件或硬件进行改造设计，McBSP接口可以支持UART通信标准。软件修改方法是通过将McBSP接口配置成通用I/O接口来模拟UART时序;硬件修改方法是将McBSP接口配置在串行口模式，McBSP接口中接收帧同步信号FSR来自于UART的发送数据线Tx，在检测到Tx的下跳沿时，McBSP内部开始采样接收数据，之后Tx的下跳沿将被忽略直至下一个字节的起始位再次触发内部帧接收新的数据;发送帧同步信号FSR由McBSP电路在发送UART数据起始位时产生。本文采用硬件修改和过采样软件措施，将一个多通道缓冲串行接口McBSP0设计成了支持UART通信标准的接口。

　　本导航计算机系统使用的CPLD配置信息文件是串行矢量格式(SVF)，可以在Xilinx软件开发平台ISE上生成。SVF是一种用来描述IEEE1149.1(JTAG)总线操作的规范，包含了编程需要的指令和数据，描述了TAP测试访问端口状态图中各状态之间的扫描操作过程和行为。由于SVF文件是ASCII格式，所以占用的存储空间比较大，可以将其转换为一种更简洁和紧凑的二进制格式：XSVF文件。对于本系统所用CPLD器件而言，仅对其进行编程操作时，XSVF文件大小为129720B，加上擦除和校验操作后，XSVF文件大小为259533B。根据上述分析，本文设计的嵌入式导航计算机系统中通过UART接口对CPLD器件进行在系统软件更新的硬件电路结构如图3所示。

　　图3中，UART通信口由DSP片上多通道缓冲串行口McBSP0实现。为了存储通过UART口接收到的包含CPLD配置信息的XSVF文件，本系统外扩了一片512kB的SRAM。FLASH芯片用来存储导航计算机系统升级固件和应用程序。CPLD的JTAG口直接与DSP空闲的4个GPIO口相连，为了提高CPLD器件编程的灵活性，在本系统中保留了连接PC机并口的CPLD程序下载接口。