帮助智能边缘设备更可靠、更高效地连接、感知和推断数据的全球领先半导体产品和软件IP授权许可厂商Ceva公司近日宣布屡获殊荣的Ceva-NeuPro-Nano嵌入式AI NPU在人工智能物联网(AIoT)和MCU市场势如破竹，赢得多家客户采用，并且带有涵盖人工智能和嵌入式应用整个软件设计周期的增强型开发套件。Ceva-NeuPro-Nano 32 和 64 MAC NPU(分别为 NPN32 和 NPN64)提供的独特功耗、性能和成本效益组合，是半导体企业和OEM厂商在其 SoC 上部署嵌入式人工智能模型所
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Ceva NPU AI Software Studio
随着人工智能技术的飞速发展，各行各业都在积极探索 AI 技术的应用，以便实现产业的智能化转型。在消费类电子产品市场，AI 技术已经成为推动产品创新和市场增长的关键因素，AI 技术的应用不仅能够提升产品的功能水平，还为用户带来了更加便捷、个性化的操作以及使用体验。在家电领域，AI 技术也为产品提供了许多想象空间。恩智浦深耕家电领域，在家电产品中有许多 MCU 的成功案例，应用在家电的控制板、马达驱动、屏幕显示、触摸按键等功能。在人工智能技术飞速发展的今天，恩智浦也没有落下，跟上时代的步伐，推出了带有 NPU
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恩智浦 MCX N947 NPU AI 咖啡胶囊识别
作为国产IC设计产业链中不可或缺的一环，国产IP授权厂商的不断涌现能够非常有效地提升国产IC设计产业的整体技术实力和行业竞争力。在ICCAD 2024上，5家领先的国产IP授权企业先后亮相，芯原微电子创始人、董事长兼总裁戴伟民，芯来科技创始人胡振波，锐成芯微CEO沈莉，奎芯科技联合创始人唐睿以及芯耀辉副总裁何瑞灵分别带来关于国产IP授权业务发展的介绍，为众多国内IC设计企业提供了开发高性能IC设计的技术底座。 作为一家成立不到五年的IP领军企业，芯耀辉专注于先进半导体IP研发和服务，凭借强大的自主研发能力
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芯耀辉 IP 路径依赖
摘要：● 新思科技超以太网IP解决方案将提供高达1.6 Tbps的带宽，可连接多达一百万个端点。● 新思科技UALink IP解决方案将提供每通道高达200 Gbps的吞吐量，连接多达 1024 个加速器。● 全新超以太网和UALink IP是基于新思科技业界领先的以太网和PCIe IP研发的，这些 IP 共同实现了5000多例成功的客户流片。● AMD、Astera Labs、Juniper Networks
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新思科技 大规模AI加速器集群 超以太网 UALink IP
芯原股份近日宣布推出全新Vitality架构的图形处理器（GPU）IP系列，具备高性能计算能力，广泛适用于云游戏、AI PC、独立显卡和集成显卡等应用领域。芯原新一代Vitality GPU架构显著提升了计算性能，并支持多核扩展，以进一步提升性能。该GPU架构集成了诸多先进功能，如一个可配置的张量计算核心（Tensor Core）AI加速器和一个32MB至64MB的三级（L3）缓存，提供强大的处理能力和出色的能效表现。此外，Vitality架构可单核支持多达128路云游戏，满足高并发和高画质的云端娱乐需求
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芯原 Vitality架构 GPU IP
无论是在出货量巨大的消费电子市场，还是针对特定应用的细分芯片市场，差异化芯片设计带来的定制化需求也在芯片设计行业中不断凸显，同时也成为了芯片设计企业实现更强竞争力和更高毛利的重要模式。所以，当您在为下一代SoC、ASIC或FPGA项目采购设计IP，或者寻求更适合的验证解决方案（VIP），以便更快更好地完成您的芯片设计项目的时候，SmartDV都可以快速且可靠地在其多元化的产品组合之上进行IP定制，以满足您期待的差异化设计需求。当大型IP供应商将其客户锁定在使用商品化的通用内核时，SmartDV就已经提供了
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IP Your Way SmartDV 定制IP
“NPU” 代表什么？它能做什么？在过去的一年里，关于神经处理单元（NPU）的讨论越来越多。虽然 NPU 已经在智能手机中出现几年了，但英特尔、AMD 以及最近的微软都推出了配备 NPU 的支持 AI 的消费级笔记本电脑和个人电脑。NPU 与 AI PC 的相关概念密切相关，AMD、Apple、Intel 和 Qualcomm 等主要硬件制造商生产的芯片中越来越多地使用 NPU。自微软推出 Copilot+ AI PC 产品以来，NPU 开始越来越多地出现在笔记本电脑中。NPU起什么作用？NPU 的作用是
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NPU 微软 AI 英特尔
在科技之光的照耀下，大模型从云端的殿堂飘然而至终端的舞台。这一历史性的跨越，不仅赋予了数据处理以迅捷之翼，更将智能体验推向了前所未有的高度。终端上的大模型以灵动的姿态，即时捕捉并回应着每一个细微的需求，将AI的触角延伸至世界的每一个角落。近日，在EEVIA主办的第12届中国硬科技产业链创新趋势峰会暨百家媒体论坛上，安谋科技产品总监鲍敏祺发表了精彩的主题演讲《端侧AI应用芯机遇，NPU加速终端算力升级》。他深入剖析了端侧AI发展的广阔前景，并详细介绍了安谋科技自研NPU的最新进展。端侧AI正在崛起AIGC大
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安谋科技 周易 NPU 端侧AI
进入2024年，全球RISC-V社群在技术和应用两个方向上都在加快发展，中国国内的RISC-V CPU IP提供商也在内核性能和应用扩展方面取得突破。从几周前在杭州举行的2024年RISC-V中国峰会以及其他行业活动和厂商活动中，可以清楚地看到这一趋势。作为全球领先的IP供应商，SmartDV也从其中国的客户和志趣相投的RISC-V CPU IP供应商那里获得了一些建议和垂询，希望和我们建立伙伴关系携手在AI时代共同推动芯片产业继续高速发展。SmartDV也看到了这一新的浪潮。上一次在行业庆祝RISC-V
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智权 SmartDV RISC-V CPU IP
MCX N系列NPU, 作为先进的人工智能处理器，以其强大的计算能力和高效的算法优化，不仅能够处理复杂的图像识别任务，还能在咖啡研磨过程中实现精准控制，确保每一粒咖啡豆都能得到恰到好处的处理。为AI咖啡机注入了前所未有的智能动力！先说结论，利用150MHz MCX N的NPU去推理咖啡豆烘焙程度(39mS)比用400MHz的M7内核推理(109mS)快了3倍!作为一名“咖市”的“MCU系统与应用工程师”一直为研磨咖啡豆的颗粒度而感到苦恼，每次换豆都要浪费2次18克豆子去实现“18克豆，10bar，30秒内
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NPU AI咖啡机 深度学习
本系列文章从数字芯片设计项目技术总监的角度出发，介绍了如何将芯片的产品定义与设计和验证规划进行结合，详细讲述了在FPGA上使用IP核来开发ASIC原型项目时，必须认真考虑的一些问题。文章从介绍使用预先定制功能即IP核的必要性开始，通过阐述开发ASIC原型设计时需要考虑到的IP核相关因素，用八个重要主题详细分享了利用ASIC IP来在FPGA上开发原型验证系统设计时需要考量的因素。在上篇文章中，我们分享了第二到第四主题，介绍了使用FPGA进行原型设计时需要立即想到哪些基本概念、在将专为ASIC技术而设计的I
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ASIC IP FPGA SmartDV
摘要：● 新思科技ARC HS4xFS处理器IP和新思科技IP开发流程均通过独立审计机构SGS-TṺV Saar的ISO/SAE 21434认证。● 获得ISO/SAE 21434认证可应对不断变化的网络安全威胁，有助于在整个生命周期内为汽车系统提供长期的安全性与可靠性。● 经过安全风险分析（SRA）认证的新思科技ARC HS4xFS处理器IP助力开发者能够以安全的方式将IP集成到系统中，从而满足ISO/SAE 21434要求。●&n
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新思科技 ISO/SAE 21434 网络安全合规认证 IP 汽车安全
本系列文章从数字芯片设计项目技术总监的角度出发，介绍了如何将芯片的产品定义与设计和验证规划进行结合，详细讲述了在FPGA上使用IP核来开发ASIC原型项目时，必须认真考虑的一些问题。文章从介绍使用预先定制功能即IP核的必要性开始，通过阐述开发ASIC原型设计时需要考虑到的IP核相关因素，用八个重要主题详细分享了利用ASIC所用IP来在FPGA上开发原型验证系统设计时需要考量的因素。在上篇文章中，我们介绍了将ASIC IP移植到FPGA原型平台上的必要性，并对原型设计中各种考量因素进行了总体概述，分析开发A
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ASIC IP FPGA SmartDV
一站式定制芯片及IP供应商——灿芯半导体（上海）股份有限公司近日宣布成功研发出一款通用高性能小数分频锁相环（fractional-N PLL） IP，支持24bits高精度小数分频，最高输出频率4.5Ghz，另外还支持扩频时钟（SSC）功能，可以为客户提供多功能的小数分频 PLL解决方案。PLL电路一般用于产生输出频率，输出频率值与PLL的参考输入频率呈倍数关系。小数分频PLL通过频率乘法比例的小数值，实现更精确的输出频率控制，从而提供更高精度和准确度的输出频率。SSC发生器是在一定频率范围内调制时钟信号
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灿芯半导体 小数分频 锁相环 IP
● 小巧的Ceva-NeuPro-Nano NPU带来了超低功耗与最佳性能的优化平衡，可在消费、工业和通用 AIoT 产品中高效执行 TinyML 工作负载● 用于Ceva-NeuPro NPU系列的Ceva-NeuPro Studio完善了AI SDK，支持包括TensorFlow Lite for Microcontrollers和 microTVM的开放式 AI 框架，可加快开发 TinyML 应用● Ceva凭借在物联网连接方
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Ceva 智能边缘IP TinyML NPU
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