- 本文针对FPGA实际开发过程中，出现故障后定位困难、反复修改代码编译时间过长、上板后故障解决无法确认的问题，提出了一种采用仿真的方法来定位、解决故障并验证故障解决方案。可以大大的节约开发时间，提高开发效率。
FPGA近年来在越来越多的领域中应用，很多大通信系统（如通信基站等）都用其做核心数据的处理。但是过长的编译时间，在研发过程中使得解决故障的环节非常令人头痛。本文介绍的就是一种用仿真方法解决故障从而减少研发过程中的编译次数，最终达到准确定位故障、缩短解决故障时间的目的。文例所用到的软件开发平台
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FPGA 应用仿真
- 时钟是整个电路最重要、最特殊的信号，系统内大部分器件的动作都是在时钟的跳变沿上进行, 这就要求时钟信号时延差要非常小, 否则就可能造成时序逻辑状态出错；因而明确FPGA设计中决定系统时钟的因素，尽量较小时钟的延时对保证设计的稳定性有非常重要的意义。
1.1 建立时间与保持时间
建立时间（Tsu：set up time）是指在时钟沿到来之前数据从不稳定到稳定所需的时间，如果建立的时间不满足要求那么数据将不能在这个时钟上升沿被稳定的打入触发器；保持时间（Th：hold time）是指数据稳定后
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FPGA 时钟
- 随着嵌入式技术和通信技术的发展，二者之间已呈现出更多的融合趋势：一方面嵌入式设备被更多地连接到互联网上，成为互联网接入终端；另一方面这些设备之间也越来越多地实现了互联互通。自今年英特尔推出面向嵌入式领域的凌动处理器以来，英特尔的嵌入式市场战略逐渐清晰，而其与终端设备芯片厂商ARM之间的竞争也成为业界关注的焦点。
7月14日，英特尔在北京举行嵌入式战略沟通会，英特尔公司数字企业事业部副总裁、嵌入式及通信事业部总经理DougDavis参加了会议，其在接受《中国电子报》记者采访时表示，下一个价值数十亿
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嵌入式 英特尔 SoC ARM
- Altera公司今天宣布第二季度销售额达到3.599亿美元，比2008年第一季度增长7%，比2007年第二季度增长13%。在2008年第一季度0.839亿美元净收入和每股摊薄后收益0.27美元基础上，第二季度净收入增长到0.98亿美元，每股摊薄后收益0.32美元。和2007年第二季度相比，今年第二季度净收入增长22%，每股摊薄后收益增长43%。
上半年运营现金流为2.268亿美元。第二季度，Altera以140万美元回购其65,000普通股。到目前为止，在第三季度，Altera已经以1004万美
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Altera FPGA Stratix
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视频采集的主流实现方案有两种：一是基于ASIC，该方案一般采用意法、AMD等公司的专用视频处理芯片；二是基于DSP，主要采用TI、ADI等公司的DSP信号处理器。它们作为辅处理器，可在主CPU控制下进行视频信号的采集压缩。随着FPGA的发展，通过SOPC技术实现视频采集已成为一种易于开发、设计灵活的方案。而这主要得益于IP复用技术的发展。在FPGA上构建复杂嵌入式系统可利用既有的功能模块及其驱动程序。该方案具有更大的集成度和灵活性，因而必将成为电子设计发展的一大趋势。
本文介绍了
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SOPC 视频采集 DSP ASIC FPGA
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数控电火花(electrical discharge machining，EDM)机床是一种实现工件精密加工的特种加工工具。早期的电火花成型加工机床的脉冲电源电路是用分立元件组成，或者是用单片机来实现。分立元件电路设计复杂，电路调试困难，基于单片机或者是32位的嵌入式CPU的脉冲电源性能有了很大的提高，也具有了很高的智能性，但对于不同的处理器，其移植性不太好，而且如果硬件电路一旦完成就不能进行更改与升级。而采用现场可编程门阵列FPGA在很好的继承单片机或者是嵌入式CPU设计的电源的优点
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FPGA 脉冲电源 EDM 数控机床 嵌入式
- 功耗关
其次，功耗更低。ARM是以低功耗和近乎福利价的IP（知识产权）授权走遍天下的。Intel的功耗不低，为此推出了多核战略。不仅如此，今年三季度（9月10日左右），Intel将推出第一个针对嵌入式市场的芯片：SoC(系统芯片)处理器“Tolapai”。实现了两年前的承诺：集成了北桥和南桥。Tolapai处理器基于改良版的Pentium M核心，32-bit设计，频率600MHz、1GHz、1.2GHz，采用65nm工艺制造，集成1.48亿个晶体管，封装面积37.5×37.5mm，热设计功耗1
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Intel 嵌入式 功耗 SoC ARM
- 随着下一代视频压缩标准问世，行业从基本视频处理向更复杂的集成处理解决方案转移，这使得系统的要求超越了独立DSP力所能及的视频性能。FPGA以不到30美元的价格提供20GMACs以上的DSP性能，从而为成本敏感型军事、汽车、医疗、消费、工业和安全应用填补了这一空白。只有FPGA能够为整套端对端视频解决方案提供逻辑、嵌入式处理、OS支持和驱动器。
妨碍开发人员将FPGA用于视频应用的因素并非他们缺乏对FPGA性能优势的了解，而是缺乏使用其设计流程的经验，对于那些习惯于用C语言编程的传统DSP程序开发
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FPGA 视频套件 VSK Simulink
- 全球电子设计创新领先企业Cadence设计系统公司（纳斯达克: CDNS），今天宣布推出Cadence® C-to-Silicon Compiler，这是一种高阶综合产品，能够让设计师在创建和复用系统级芯片IP的过程中，将生产力提高10倍。C-to-Silicon Compiler中的创新技术成为沟通系统级模型之间的桥梁，它们通常是用C/C++ 和SystemC写成的，而寄存器传输级（RTL）模型通常被用于检验、实现和集成SoC。这种重要的新功能对于开发新型SoC和系统级IP，用于消费电子、无
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Cadence RTL SoC IP
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图像处理系统的一个关键问题就是数据量庞大，数据处理相关性高，实时实现比较困难。即使采用高速单片机也无法满足实时处理的需求，而DSP芯片则具有速度快，信号处理功能强大，实时性好等特点，因此，将DSP用于图像处理可使这一难题得到较好的解决。
1 系统构成
本系统采用基于CameraLink接口的图像输出相机。DSP采用TI的TMS320C6711，这是一种高性能DSP处理器，其工作频率为150 MHz，最大处理能力高达900MFLOps，该DSP既可满足高速处理要求，又可满足高
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DSP 图象采集与处理 Camera Link USB FPGA
- 一、引言
“西新工程”以来，我国无线广播监测网有了长足的发展，为适应新形势下广播电视安全播出的需要，建立健全广播电视信息安全保障体系做出了巨大贡献，为执行贯彻江总书记“9.16”指示发挥了巨大的作用。
目前我国的无线广播监测网的遥控监测站、数据采集点系统绝大部分由通用工控机、通用Windows操作系统、通用I/O板卡、专业测量板卡四部分构成。与目前的流行的嵌入式技术相比，这种结构的网络监测系统已经显示出系统冗余、功耗太大、板卡繁多、安装复杂、
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SOC 嵌入式 广播监测 操作系统
- Tech Insights/Embedded Systems Design 2008年嵌入式市场调研报告表明，嵌入式系统设计人员在2008年要参与更多项目的开发，按期完成开发任务是他们最大的问题，有一半以上（大于50%）的开发项目不能按期完成。
调查结果表明：自2005年以来，2008年新项目对应项目改进的比例是这几年中最高的。在所有开发项目中，新开发项目占46%，剩余54%为以往开发项目的升级和改进。项目的改进和升级主要是针对新的软件特性（占81%），或因采用了新处理器（55%），
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嵌入式 设计 工程师 商用OS 定制OS FPGA DSP MCU
- 一、概述
视觉技术是近几十年来发展的一门新兴技术。机器视觉可以代替人类的视觉从事检验、目标跟踪、机器人导向等方面的工作，特别是在那些需要重复、迅速的从图象中获取精确信息的场合。尽管在目前硬件和软件技术条件下，机器视觉功能还处于初级水平，但其潜在的应用价值引起了世界各国的高度重视，发达国家如美国、日本、德国、法国等都投入了大量的人力物力进行研究，近年来已经在机器视觉的某些方面获得了突破性的进展，机器视觉在车辆安全技术、自动化技术等应用中也越来越显示出其重要价值。本文根据最新的CMOS图像采集芯片设
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机器人 机器视觉 CMOS 图像传感器 FPGA
- 引言
随着网络技术的发展，各种分布式的网络和局域网都得到了广泛的应用[1]。分布式数据采集系统广泛应用于船舶、飞机等采集数据多、实时性要求较高的地方。同步采集是这类分布式数据采集系统的一个重要要求，数据采集的实时性、准确性和系统的高效性都要求系统能进行实时数据通信。因此，分布式数据采集系统中的一个关键技术就是实现数据的同步传输。
由于产生时钟的晶振具有频率漂移的特性，故对于具有多个采集终端的分布式系统，如果仅仅在系统启动时进行一次同步，数据的同步传输将会随着系统运行时间的增长而失步。因此时
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数据采集 分布式 时钟同步 FPGA
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