确定IP技术发布的日期有时是一项挑战，尤其是英国处理器内核IP设计商 ARM。不过有证据可查的是第一款Arm内核处理器是在1985年4月26日在英国剑桥的Acorn上流片的，我们暂且将这个时间作为Arm真正进入IC设计领域的原点。ARM1是Acorn继BBC Micro家用电脑成功之后自主开发的处理器。它由Sophie Wilson和Steve Furber开发。当日这颗处理器流片前在设计和制造方面已经进行了好几个月的开发，而且硅片最后花了好几个月才回到剑桥。 “它的设计制造成本低廉，由于设计对微处理器的
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Arm IP
在可编程逻辑器件领域，基于SRAM的FPGA经常被误解。这些FPGA具有极高的灵活性和可重新配置特性，是从消费电子到航空航天等各类应用的理想选择。此外，基于SRAM的FPGA还能带来高性能和低延迟，非常适合实时数据处理和高速通信等要求苛刻的任务。一个常见的误解是，基于SRAM的FPGA会因启动时间较长而不堪负荷。通常的说法是，由于其配置数据存储在片外，特别是在加密和需要验证的情况下，将这些信息加载到FPGA的过程就成了瓶颈。然而，对于许多基于SRAM的现代FPGA来说，这种观点并不成立，莱迪思Avant™
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SRAM FPGA 安全启动机制 莱迪思 Lattice
虽然是EDA公司收购IC设计IP，但此次收购可能会在整个竞争格局中产生连锁反应。Cadence强化一站式服务和EDA工具护城河，而Arm转向更高利润的芯片设计。
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Artisan Arm Cadence IP
近期，高云代理商联诠国际联合合作伙伴DepEye（深目微）共同推出 MIPI CPHY转DPHY (C2D)透传模块：DEGC2DV60，功能基于高云GW5AT-LV60 FPGA实现，该产品适用于需要从 MIPI CPHY RX 桥接到 MIPI DPHY TX 的应用场景。DEGC2DV60 C2D透传模块高云Arora-V GW5AT-LV60FPGA特性高云 Arora V 系列的 GW5AT-LV60 FPGA，是其晨熙家族第5代产品，产品内部资源丰富，具有全新构架
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高云 Arora-V FPGA MIPI CPHY MIPI DPHY
告别英特尔Fab，告别OneAPI，能够走自己路的Altera才能对得起自己曾经的百亿身家。
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Altera 英特尔 FPGA
迈入4月，FPGA市场的重量级玩家Altera迎来了一次命运的转折。英特尔新任CEO陈立武（Lip-Bu Tan）宣布与私募巨头Silver Lake达成最终协议，战略性出售其Altera业务51%的控股权。FPGA（Field Programmable Gate
Array，现场可编程门阵列）芯片，作为与CPU、GPU并驾齐驱的关键集成电路，其核心竞争力在于颠覆性的“现场可编程”与“可重构性”。想象一下，FPGA宛如一块“变色龙”芯片，它的功能可以根据不同的“环境”（应用需求）而实时改变。亦或是把它
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FPGA altera
摘要本文介绍了一种在FPGA中实现的增强型正交频分复用（OFDM）调制器设计，它使用了逆FFT模式的莱迪思快速傅立叶变换（FFT）Compiler IP核和莱迪思有限脉冲响应（FIR）滤波器IP核。该设计解决了在没有主控制器的情况下生成复杂测试模式的常见难题，大大提高了无线链路测试的效率。通过直接测试模拟前端的JESD204B链路，OFDM调制器摆脱了对主机控制器的依赖，简化了初始调试过程。该设计可直接在莱迪思FPGA核中实现，从而节省成本并缩短开发周期。该调制器的有效性验证中使用了Avant-X70 V
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莱迪思半导体 iFFT FIR IP 5G OFDM
为了提供更好的用户体验，包括高质量的视频传输、更新的笔记本电脑（例如最新的 AI PC）和其他前沿设备，都需要 5 纳米及以下的先进节点 SoC，以达成出色的功耗、性能和面积（PPA）目标。然而，随着技术发展到 5 纳米以下的工艺节点，SoC 供应商面临各种挑战，例如平衡低功耗和低工作电压（通常低于 1.2V）的需求。与此同时，市场也需要高分辨率相机、更快的帧率和 AI 驱动的计算，这就要求接口具有更高的数据传输速率和更强的抗电磁干扰（EMI）能力。随着这些性能要求变得越来越复杂，市场亟需创新的解决方案来
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Cadencee USB2V2 IP
近日，全球FPGA 创新技术领导者 Altera 宣布， Agilex™ 7 M 系列FPGA正式量产出货，这是现阶段业界领先的集成高带宽存储器，并支持 DDR5 和 LPDDR5 存储器技术的高端、高密度 FPGA。Agilex™ 7 M 系列 FPGA 集成超过 380 万个逻辑元件，并针对 AI、数据中心、下一代防火墙、5G 通信基础设施及 8K 广播设备等对高性能、高内存带宽有较高需求的应用进行了专门优化。随着AI、云计算和流媒体的高速发展，数据量也在呈指数级增长，因此，用户对更高内存带宽、更大容
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Altera Agilex FPGA 内存带宽
创意2日宣布，自主研发的HBM4控制器与PHY IP完成投片，采用台积电最先进N3P制程技术，并结合CoWoS-R先进封装，成为业界首个实现12 Gbps数据传输速率之HBM4解决方案，为AI与高效能运算（HPC）应用树立全新里程碑。HBM4 IP以创新中间层（Interposer）布局设计优化信号完整性（SI）与电源完整性（PI），确保在CoWoS系列封装技术下稳定运行于高速模式。 创意指出，相较前代HBM3，HBM4 PHY（实体层）效能显著提升，带宽提升2.5倍，满足巨量数据传输需求、功耗效率提升1
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创意 HBM4 IP 台积电 N3P
Microchip Technology Inc.（微芯科技公司）的 PolarFire®片上系统（SoC）FPGA 已获得汽车电子委员会 AEC-Q100 认证。AEC-Q 标准是集成电路的指南，通过压力测试来衡量汽车电子元件的可靠性。通过 AEC-Q100 认证的器件都经过严格的测试，能够承受汽车应用中的极端条件。PolarFire SoC FPGA已通过汽车行业1级温度认证，支持-40°C至125°C工作范围。PolarFire SoC FPGA 采用嵌入式 64 位四核 RISC-V® 架构，能够
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Microchip FPGA
近日，一站式定制芯片及IP供应商——灿芯半导体（上海）股份有限公司宣布推出基于28HKD 0.9V/2.5V 平台的DDR3/4, LPDDR3/4 Combo IP 。该IP具备广泛的协议兼容性，支持DDR3, DDR3L, DDR4和LPDDR3, LPDDR4协议，数据传输速率最高可达2667Mbps，并支持X16/X32/X64等多种数据位宽应用。灿芯半导体此次发布的DDR3/4, LPDDR3/4 Combo IP集成高性能DDR&nb
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灿芯半导体 DDR3/4 LPDDR3/4 Combo IP
技术发展日新月异，为应对功耗和散热挑战，改善应用性能，FPGA、处理器、DSP和ASIC等数字计算器件的内核电压逐渐降低。同时，这也导致内核电源容差变得更小，工作电压范围变窄。大多数开关稳压器并非完美无缺，但内核电压降低的趋势要求电源供应必须非常精确，以确保电路正常运行1。窗口电压监控器有助于确保器件在适当的内核电压水平下运行，但阈值精度是使可用电源窗口最大化的重要因素2。 本文讨论如何利用高精度窗口电压监控器来使电源输出最大化。通过改善器件内核电压的可用电源窗口，确保器件在有效的工作电源范围内运行。 简
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202504 FPGA 窗口监控器 电源输出 ADI
2024年12月，随着“下一代小型FPGA平台”Nexus™ 2和基于该平台的首个器件系列Certus™-N2通用FPGA的面世，莱迪思(Lattice)公司在小型FPGA领域的领先地位再次得到强化。所谓“小型FPGA平台”，通常是指逻辑密度低于200K SLC(系统逻辑单元)的FPGA。而之所以被称之为“下一代”，则是指Nexus 2在“先进的互连”、“优化的功耗和性能”和“领先的安全性能”三方面做出的重大改进。根据规划，Nexus 2平台目前推出了3个产品系列：通用FPGA Certus、视频互连FP
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莱迪思 小型FPGA Certus FPGA 边缘网络
2024年，全球半导体行业发展面临着更加复杂的局面——整体市场增长步伐放缓，工业、汽车、通信等传统市场增长动力不足，AI技术相关领域异军突起，展现出强劲的发展动能。在这样的大环境下，莱迪思半导体在挑战中寻求突破，取得了一系列可圈可点的成果。作为莱迪思的重要营收来源，覆盖多个应用领域的工业市场增长显著，为公司的发展提供了稳定的支撑。汽车市场尽管在2024年处于去库存阶段，但新能源汽车领域的发展符合预期。特别是在中国市场，莱迪思在智能驾舱等多个细分领域，与众多国内新能源汽车厂商及Tier-1供应商建立了紧密的
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莱迪思 Nexus 2 FPGA
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