利用串行RapidIO实现FPGA协处理

SRIO系统应用实例

　　1.嵌入式系统：像x86这样的CPU结构是针对那些无需进行大量乘法运算的一般应用优化过的相比而言，DSP结构则是针对包括滤波、FFT、矢量乘法和查找以及图像或视频分析等信号处理操作优化过的

　　因此，同时采用CPU和DSP的嵌入式系统可以轻松利用通用处理器和信号处理器两种结构的优势图6给出了一个此类系统的例子，其中同时包含FPGA、CPU和DSP架构

　　　　　 图6：基于CPU的高性能DSP子系统

　　在高端DSP中，串行RapidIO已成为主流数据互连方式x86 CPU中主要的数据互连则采用PCI Express实现如图6所示，对FPGA进行一些简单的配置，就能用它调整DSP应用的规模，和/或桥接几种完全不同的互连标准(如PCI Express 和串行RapidIO)

　　在该系统中，管理PCI Express系统的是Root Complex芯片组，SRIO系统则受一块DSP管理PCIe的32/64位地址空间(基地址)可自动映射至34/66位SRIO地址空间(基地址)PCIe应用程序通过内存或I/O读写与Root Complex芯片组通信这些事务均可通过流写入、原语和确认读/写事务(SWRITEs ATOMIC NREADs NWRITE/NWRITE_Rs)等I/O操作轻松映射至SRIO空间

　　在Xilinx的FPGA中设计此类桥接功能非常简单，因为PCI Express的后端接口和串行RapidIO端点的功能模块是类似的分组队列模块随后就可以实现从PCIe到SRIO或从SRIO向PCIe的转换，从而在这两个协议域之间建立数据流

　　2.DSP处理应用：在那些DSP处理是主要架构要求的应用中，系统结构可按图7所示方式设计

　　　　　　　 图7：需要强大DSP处理能力的器件

Xilinx Virtex-5 FPGA在该系统中就可用作其他DSP器件的协处理器如果用SRIO进行数据互连，这整套DSP系统方案还可轻松实现调整这样的方案具备可扩展性，适应未来的发展，而且还能以多种外形尺寸实现

　　当需要强大DSP功能的应用还需要进行快速大量的复杂运算或数据处理时，可以将这些处理任务卸载至x86 CPU中去运行Xilinx Virtex-5 FPGA允许对PCIe子系统和SRIO结构进行桥接，从而实现高效的功能卸载

　　3. 基带处理系统

随着3G网络快速成熟，OEM厂商将会采用新的外形尺寸的器件和设备来减少容量和覆盖方面的问题，使用SRIO并基于FPGA的DSP架构正是应对此类挑战的绝佳方案传统DSP系统也可重新调整为这种快速低功耗的基于FPGA的结构，以便充分利用FPGA的可调整性优势

　　在此类系统中，如图8所示，FPGA可以在满足天线业务线速处理要求的同时通过SRIO为其他系统资源提供连接而由于串行RapidIO协议提供的速度和带宽均很高，所以那些内部固有低速并行连接的现存传统DSP应用要移植到这类系统中也很简单

　　　　　　　　　 图8：基带处理

本文小结

串行RapidIO正在越来越多的新应用中崭露头角，特别是在采用DSP的有线和无线应用中在Xilinx器件中实现串行RapidIO主要有以下优势：
1. Xilinx提供了完整的SRIO端点方案；
2. 可利用同样的软、硬件结构，通过灵活的调整，实现不同类型的产品；
3. 由于Xilinx器件采用了新型GTP收发机和65nm 技术，因此功耗很低；
4. 通过CoreGen GUI 可实现方便的可配置性和灵活性；
5. 由于业界领先的厂商都有器件支持SRIO连接，因而硬件互通性有保证；
6. 可通过使用PCIe和TEMAC等集成IO模块实现系统集成，从而降低系统整体成本