全球领先的半导体设计、验证和制造软件及知识产权(IP)供应商新思科技有限公司(Synopsys, Inc.， 纳斯达克股票市场代码：SNPS)日前宣布推出动态解析度自适应(DRA)解码器软件的优化版本，主要面向已广泛应用的DesignWare® ARC™ Sound AS211SFX 和各种AS221BD 音频处理器。
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Synopsys DRA IP
全球领先的半导体设计、验证和制造软件及知识产权(IP)供应商新思科技有限公司(Synopsys, Inc.， 纳斯达克股票市场代码：SNPS)，以及中国大陆领先的IC代工服务供应商上海华虹NEC电子有限公司(HHNEC)今日宣布：即日起推出130纳米参考流程版本3.0。该参考流程是Synopsys和华虹NEC共同合作的结晶，它将Synopsys Eclypse™ 低功耗解决方案加入到之前为设计师所提供的各种参考流程之中。
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Synopsys 130nm工艺
全球领先的半导体设计、验证和制造软件及知识产权(IP)供应商新思科技有限公司日前宣布：该公司所提供经芯片生产验证的DesignWareTM数据转换器IP，已被应用于中芯国际广受欢迎的65纳米低漏电(Low Leakage)工艺技术。这可帮助设计工程师更有效地提升其芯片的功率，并在集成设计上达事半功倍之效。
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Synopsys 65nm 数据转换器
全球领先的半导体设计、验证和制造软件及知识产权(IP)供应商新思科技有限公司(Synopsys, Inc.， 纳斯达克股票市场代码：SNPS)日前宣布推出HAPS®-600 系列，这是其HAPS系列基于现场可编程门阵列(FPGA)原型验证系统中容量最高的一款产品。HAPS-600系列将基于FPGA的原型验证系统容量扩展到高达相当于8100万ASIC门，从而确保了各种更大SoC项目的早期软件开发。
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Synopsys FPGA
全球领先的半导体设计、验证、和制造软件及知识产权 (IP) 的供应商新思科技有限公司(纳斯达克市场交易代码：SNPS)和中芯国际集成电路制造有限公司(中芯国际，纽约证券交易所交易代码：SMI，香港联交所交易代码：00981.HK)宣布已正式提供用于中芯国际先进65-nm 工艺的系统级芯片 (SoC) 综合设计解决方案。该解决方案将 Synopsys 丰富的 DesignWare? 接口、模拟 IP 产品组合和其他基础性 IP，通过可调参考流程与 Galaxy? 实现平台集成在一起。
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Synopsys SoC
全球半导体设计、验证及制造软件暨IP领导厂商新思科技(Synopsys)今日宣布，利用新思科技完整的DesignWare® SATA IP解决方案，包含控制器、实体层以及验证IP，使创意电子(Global Unichip Corp.) 之GP5080固态硬盘系统单芯片第一次流片就试产成功之成果。
系统单芯片设计代工服务的龙头企业创意电子，肯定了新思科技的DesignWare SATA IP在品质、功耗、性能和功能集上的卓越性。对创意电子来说SATA的互通性是一个关键的需求，而新思科技是唯
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Synopsys DesignWare IP
新思科技有限公司日前宣布：英飞凌科技(西安)有限公司通过采用新思完整的、基于统一功率格式(UPF)的低功耗综合、物理实现和验证流程，完成了国内首款采用40nm工艺技术的3G智能手机基带处理器设计，并按照时间计划成功实现一次流片成功。
为了达到芯片设计目标，英飞凌确定了在设计过程中采用了Synopsys全套实施流程，包括Design Compiler编译器、ICC布局工具等，同时引入新思的知识产权(IP)和支持服务。同时，还结合了英飞凌在移动通信基带芯片领域里丰富的经验和工程师的创新能力。
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Synopsys 40nm 基带处理器
由Gary Smith的EDA小组及Nancy Wu与Marry Olsson共同编辑的市场统计已经完成。2009年最大的变化是Mentor超过Cadence成为EDA市场全球销售额依产品计的第二。这也意味着市场向ESL方法论过渡。Synopsys仍是首位。
Mentor在IC设计居第二。在兼并Valor后mentor成为PCB设计的第三。
在Walden Rhines的带领下当转向RTL设计方法时，相信近期Cadence已经停止它的市场份额下降，十分相似于Mentor的变化。
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Synopsys EDA
全球半导体设计制造软件和知识产权领先企业新思科技有限公司和全球领先的半导体制造商中芯国际集成电路有限公司今天宣布开始提供用于中芯国际65纳米(nanometer)低漏电(Low Leakage)工艺技术的新思科技经硅验证的和获得USB标志认证的DesignWare® USB 2.0 nanoPHY知识产权(IP)。作为一家提供包括控制器、PHY和验证IP等USB2.0接口完整IP解决方案的领先供应商，新思科技继续致力于通过提供高品质IP助力设计人员降低集成风险，这些IP具备了验证过的互操作性，
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Synopsys IP 65纳米 DesignWare
下一代系统提供最高的性能、最高的容量、预测试IP和独有先进验证功能
美国加利福尼亚州山景城，2010年5月—— 全球领先的半导体设计、验证和制造软件及知识产权（IP）供应商新思科技有限公司（Nasdaq:SNPS）今天宣布推出快速原型系统HAPS™-60系列，这是一种可降低复杂SoC设计和验证挑战的综合解决方案。HAPS-60系列是Confirma™ Rapid Prototyping Platform快速原型平台的一部分，是一种易于使用和具有高性价比的快
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Synopsys HAPS-60 SoC
Synopsys日前宣布，在其Galaxy设计实现平台中推出了最新的RTL综合工具Design Compiler 2010，它将综合和物理层实现流程增速了两倍。Design Compiler自1988年问世以来，随着工艺技术从1.5微米到32纳米的进步，而不断得到调整升级。而今时序与面积布线的优化已成为主要的挑战，最新版工具与时俱进，针对拓扑技术进行扩展，为Synopsys布局布线解决方案IC Compiler提供“物理层指引”;将时序和面积的一致性提升至5%的同时，还将IC
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Synopsys RTL 32纳米
全球领先的半导体设计、验证和制造的软件及知识产权(IP)供应商新思科技有限公司日前宣布：该公司在其Galaxy™设计实现平台中推出了最新的创新RTL综合工具Design Compiler 2010，它将综合和物理层实现流程增速了两倍。为了满足日益复杂的设计中极具挑战性的进度要求，工程师们需要一种RTL综合解决方案，使他们尽量减少重复工作并加速物理实现进程。为了应对这些挑战，Design Compiler 2010对拓扑技术进行扩展，为Synopsys旗舰布局布线解决方案IC Compile
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Synopsys Galaxy RTL
假如IC设计的速度能够加快数倍，那么拥有各种复杂功能的各类电子产品将再次改变我们的生活。
IC设计中设计与验证的流程通常需要数月甚至数年，其中的人工重新编码的过程费时且容易出错，Synopsys选择这一环节为突破，开发出了Synphony高层次综合EDA工具，通过其独特的MATLAB语言、基于模型的解决方案，针对ASIC和FPGA芯片设计实现了10倍的设计与验证能力。
据Synopsys公司总监Chris Eddington介绍，Synphony的创意来自被收购的Synplicity公司，
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Synopsys IC设计 EDA
全球领先的半导体设计、验证和制造软件、硬件及知识产权(IP)供应商新思科技公司(NASDAQ: SNPS)，今天宣布推出其Synphony HLS (High Level Synthesis)解决方案。该解决方案集成了M语言和基于模型的综合法，与 传统RTL流程相比，能够为通信和多媒体应用提供高达10倍速的更高的设计和验证能力。Synphony HLS为ASIC 和 FPGA的应用、架构和快速原型生成最优化的RTL。此外，通过在虚拟平台中为系统验证和早期软件开发生成C模型，Synphony HLS补充
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Synopsys Synphony HLS
简·奥斯汀的《理智与情感》告诉我们，若要在地位和金钱都凌驾于爱情之上的社会得到幸福，一定要懂得在理智与情感之间取得平衡。对于在竞争激烈的科技领域驾御企业走向成功，同样不可缺少智慧和激情的平衡。近日，记者在北京采访了Synopsys公司董事长兼首席执行官Aart De Geus先生，这位一直强调以智慧和激情引领企业成功的商业奇才谈起了应对金融危机下的企业发展策略。
让De Geus先生可以坐在记者面前谈笑风生最重要的支撑就是Synopsys公司是在EDA行业中少数几个业绩预期继续增长
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Synopsys EDA IP 200907
synopsys介绍
Synopsys公司(Nasdaq: SNPS)是为全球集成电路设计提供电子设计自动化(EDA)软件工具的主导企业。为全球电子市场提供技术先进的IC设计与验证平台，致力于复杂的芯片上系统(SoCs)的开发。同时，Synopsys公司还提供知识产权和设计服务，为客户简化设计过程，提高产品上市速度。
Synopsys公司总部设在美国加利福尼亚州Mountain View，有超过60家分公司分布在北美 [
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