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基于FPGA的高速长线阵CCD驱动电路

  • 高速长线阵CCD(电荷耦合器)具有低功耗,小体积,高精度等优势,广泛应用于航天退扫系统中的图像数据采集。而CCD驱动电路设计是CCD正常工作的关键问题之一,CCD驱动信号时序是一组相位要求严格的脉冲信号,只有时序信
  • 关键字: CCD  线阵  FPGA  verilog HDL  

基于Verilog HDL的SVPWM算法的设计与仿真

  • 摘要:空间矢量脉宽调制算法是电压型逆变器控制方面的研究热点,广泛应用于三相电力系统中。基于硬件的FPGA/CPLD芯片能满足该算法对处理速度、实时性、可靠性较高的要求,本文利用Verilog HDL实现空间矢量脉宽调制算
  • 关键字: 同步电动机  电压型逆变器  Verilog HDL  

一种高效网络接口的设计

  • 为了得到比传统片上网络的网络资源接口(NI)更高的数据传输效率和更加稳定的数据传输效果,提出了一种新的高效网络接口的设计方法,并采用Verilog HDL语言对相关模块进行编程,实现了高效传输功能,同时又满足核内路由的设计要求。最终通过仿真软件Xilinx ISE Design Suite 12.3和ModelSim SE 6.2b得到了满足设计要求的仿真结果。
  • 关键字: 片上网络  网络资源接口  核内路由  Verilog HDL  

混合同余法产生随机噪声的FPGA实现

  • 混合同余法产生随机噪声的FPGA实现,摘要:随着电子对抗技术的快速发展,在有源式干扰机中需要用到数字高斯白噪声。通过对混合同余法产生随机序列的原理研究,本文提出了一种利用FPGA产生高斯白噪声的方法。该方法在PC主控端的控制下,采用ROM查找表的方
  • 关键字: 高斯白噪声  混合同余法  FPGA  Verilog HDL  

基于CPLD的LCD1602显示系统设计与实现

  • 摘要:为了提高LCD1602显示效果,增强抗扰能力,文章基于TOP2812开发板,依据LCD1602操作时序要求,在开发板CPLD部分实现了LCD1602显示系统的设计。文中对
  • 关键字: LCD1602  显示系统  时序  Vetilog HDL  

基于ModelSim的使用说明、技术文献、应用实例汇总

  •   Mentor公司的ModelSim是业界最优秀的HDL语言仿真软件,它能提供友好的仿真环境,是业界唯一的单内核支持VHDL和Verilog混合仿真的仿真器。它采用直接优化的编译技术、Tcl/Tk技术、和单一内核仿真技术,编译仿真速度快,编译的代码与平台无关,便于保护IP核,个性化的图形界面和用户接口,为用户加快调错提供强有力的手段,是FPGA/ASIC设计的首选仿真软件。   浅析基于Modelsim FLI接口的协同仿真   介绍了如何利用modelsim提供的FLI(Foreign Langu
  • 关键字: HDL  ASIC  

基于CMOS或CCD图像传感器的经典设计及技术文献汇总

  •   图像传感器,或称感光元件,是一种将光学图像转换成电子信号的设备,它被广泛地应用在数码相机和其他电子光学设备中。早期的图像传感器采用模拟信号,如摄像管(video camera tube)。如今,图像传感器主要分为感光耦合元件(charge-coupled device, CCD)和互补式金属氧化物半导体有源像素传感器(CMOS Active pixel sensor)两种。本文介绍基于CMOS或CCD两种图像传感器的应用及技术文献,供大家参考。   基于USB传输及CMOS图像传感器的指纹识别仪的实
  • 关键字: Verilog HDL  QuartusⅡ  VHDL  

基于Verilog HDL的SPWM全数字算法的FPGA实现

  •   随着信号处理技术及集成电路制造工艺的不断发展,全数字化SPWM(正弦脉宽调制)算法在调速领域越来越受到青睐。实现SPWM控制算法的方法很多,其中模拟比较法因电路复杂、且不易与数字系统连接而很少采用;传统的微处理器因不能满足电机控制所要求的较高采样频率(≥1 kHz)而逐渐被高性能的DSP硬件系统所取代,但该系统成本高、设计复杂。与传统方法相比,在现场可编程逻辑器件FPGA上产生一种新的SPWM控制算法,具有成本低、研发周期短、执行速度高、可扩展能力强等优点。该技术进一步推动了变频调速技术的发展。
  • 关键字: Verilog HDL  SPWM  FPGA  

FPGA开发基本流程及注意事项

  • 本文是根据FPGA技术牛人历年来的经验所总结出来的关于FPGA开发基本流程及注意事项基本介绍,希望给初学者丁点帮助。众所周知,FPGA是可编程芯片,因此FPGA的设计方法包括硬件设计和软件设计两部分。硬件包括FPGA芯片电路、 存储器、输入输出接口电路以及其他设备,软件即是相应的HDL程序以及嵌入式C程序。
  • 关键字: FPGA  嵌入式  SOC  HDL  

Verilog HDL设计进阶:有限状态机的设计原理及其代

  • 由于Verilog HDL和 VHDL 行为描述用于综合的历史还只有短短的几年,可综合风格的Verilog HDL 和VHDL的语法只是它们各自语言的一个子集。又由于HDL的可综合性研究近年来非常活跃,可综合子集的国际标准目前尚未最后形
  • 关键字: Verilog  HDL  进阶  代码    

Verilog HDL高级语法结构―函数(function)

  • 函数的目的是返回一个用于表达式的值。
    1.函数定义语法function 返回值的类型或范围> (函数名);
    端口说明语句>
    变量类型说明语句> begin
    语句>
    ...
    end
    endfunction 请注
  • 关键字: function  Verilog  HDL  函数    

Verilog HDL高级语法结构―任务(TASK)

  • 如果传给任务的变量值和任务完成后接收结果的变量已定义,就可以用一条语句启动任务。任务完成以后控制就传回启动过程。如任务内部有定时控制,则启动的时间可以与控制返回的时间不同。任务可以启动其他的任务,其他
  • 关键字: Verilog  TASK  HDL    

Verilog HDL硬件描述语言:task和function说明语句

  • task和function说明语句的区别task和function说明语句分别用来定义任务和函数。利用任务和函数可以把一个很大的程序模块分解成许多较小的任务和函数便于理解和调试。输入、输出和总线信号的值可以传入或传出任务和函
  • 关键字: function  Verilog  task  HDL    

verilog HDL基础教程之:实例3 数字跑表

  • 实例的内容及目标1.实例的主要内容本节通过Verilog HDL语言编写一个具有“百分秒、秒、分”计时功能的数字跑表,可以实现一个小时以内精确至百分之一秒的计时。数字跑表的显示可以通过编写数码管显示程序来
  • 关键字: verilog  HDL  基础教程  实例    

Verilog HDL基础教程之:时序逻辑电路

  • 在Verilog HDL语言中,时序逻辑电路使用always语句块来实现。例如,实现一个带有异步复位信号的D触发器如下。例1:带异步复位的D触发器1。wire Din;wire clock,rst;reg Dout;always @ (posedge clock or negedge rs
  • 关键字: Verilog  HDL  基础教程  时序逻辑电路    
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hdl介绍

 HDL(Hardware Description Language),是硬件描述语言。顾名思义,硬件描述语言就是指对硬件电路进行行为描述、寄存器传输描述或者结构化描述的一种新兴语言。   主流的HDL分为VHDL和Verilog HDL。VHDL诞生于1982年。在1987年底,VHDL被IEEE和美国国防部确认为标准硬件描述语言。自IEEE公布了VHDL的标准版本,IEEE- 1076(简称 [ 查看详细 ]

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