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Verilog HDL与C语言的区别与联系详解

数字电路设计工程师一般都学习过编程语言、数字逻辑基础、各种EDA软件工具的使用。就编程语言而言，国内外大多数学校都以C语言为标准，只有少部分学校使用Pascal 和Fortran。算法的描述和验证常用C语言来做。例如要
关键字： Verilog HDL C语言详解

Verilog HDL独家程序设计经验分享

对于Verilog HDL的初学者，经常会对语法中的几个容易混淆的地方产生困惑。下面列出几个常见问题和解决它们的小窍门。1.“=”和“=”的区分方法前面的内容已经从原理上解释了阻塞(=)和非阻塞(=
关键字： Verilog HDL 家程序设计

Verilog HDL基础教程之：程序基本结构

Verilog HDL是一种用于数字逻辑电路设计的语言。用Verilog HDL描述的电路设计就是该电路的Verilog HDL模型。Verilog HDL既是一种行为描述的语言，也是一种结构描述的语言。也就是说，既可以用电路的功能描述，也可以
关键字： Verilog HDL 基础教程程序

玩转FPGA必备基础

通过论坛里如火如荼的FPGA DIY活动就能看出来FPGA必然是现今的技术热点之一。无论学生还是工程师都希望跨进FPGA的大门。网络上各种开发板、培训班更是多如牛毛，仿佛在告诉你不懂FPGA你就OUT啦。那么我们要玩转FPGA必须具备哪些基础知识呢?下面我们慢慢道来。
关键字： FPGA HDL Altera Xilinx DIY

U盘SoC的设计与实现

设计和实现了U盘SoC。本系统包括USB CORE和已验证过的CPU核、Nandflash、UDC_Control等模块，模块间通过总线进行通信。其中USB CORE为本文设计的重点，用Verilog HDL语言实现，同时并为此设计搭建了功能完备的Modelsim仿真环境，进行了仿真验证。
关键字： U盘片上系统 USB Verilog HDL

电路设计模块化与设计重利用

摘要：本文主要介绍了在Cadence Board Design System上实现电路设计模块化与设计重利用的设计方法。
关键词：Cadence Concept—HDL；原理图；子电路；模块化；层次化

随着电路设计复杂程度的增加，设计
关键字： Cadence Concept&mdash HDL 原理图子电路模块化层次化

8位无符号数乘法运算HDL设计实例

原理分析加减乘除是运算的基础，也是我们在小学课堂里的重点必修课。乘除运算虽然对于我们今天来说还是小菜一碟，让计算机做起来也是九牛一毛不足挂齿，但是要真探究一下计算机是如何完乘除运算的，可还真有
关键字： HDL 8位符号乘法运算

Verilog HDL语言在FPGA/CPLD开发中的应用

1 引言近30年来，由于微电子学和计算机科学的迅速发展，给EDA(电子设计自动化)行业带来了巨大的变化。特别是进入20世纪90年代后，电子系统已经从电路板级系统集成发展成为包括ASIC、FPGA和嵌入系统的多种模式。可以说
关键字： Verilog FPGA CPLD HDL

基于Verilog HDL语言的32X8 FIFO设计

摘要:介绍了FIFO的基本概念、设计方法和步骤,采用了一种新颖的读、写地址寄存器和双体存储器的交替读、写机制,实现了FIFO的基本功能,同时使本32X8 FIFO拥有可同时读、写的能力,完全基于Verilog HDL语言实现了电路功能
关键字： Verilog 32X8 FIFO HDL

基于Verilog HDL语言的CAN总线控制器设计及验证

摘要：在此利用VerilogHDL设计了一款CAN总线控制器，首先根据协议把整个CAN总线控制器划分为接口逻辑管理、寄...
关键字： CAN总线控制器 FPGA Verilog HDL

Verilog HDL设计自动数据采集系统

随着数字时代的到来，数字技术的应用已经渗透到了人类生活的各个方面。数字系统发展在很大程度上得益于器件和集成技术的发展，著名的摩尔定律(Moores Law)的预言也在集成电路的发展过程中被印证了，数字系统的设计理
关键字： Verilog HDL 自动数据采集系统

基于Verilog HDL语言的CAN总线控制器设计及验证

摘要：在此利用Verilog HDL设计了一款CAN总线控制器，首先根据协议把整个CAN总线控制器划分为接口逻辑管理、寄存器逻辑和CAN核心模块3个模块，然后用Verilog HDL硬件描述语言设计了各个功能模块，并使用Modelsim软件
关键字：控制器设计验证总线 CAN Verilog HDL 语言基于

MATHWORKS推出基于MATLAB生成HDL代码的产品

MathWorks近日宣布推出HDL Coder，该产品支持MATLAB 自动生成 HDL 代码，允许工程师利用广泛应用的 MATLAB 语言实现 FPGA 和 ASIC 设计。MathWorks还宣布推出了HDL Verifier，该产品包含用于测试 FPGA 和 ASIC 设计的 FPGA 硬件在环功能。有了这两个产品，MathWorks现在可提供利用 MATLAB 和 Simulink 进行 HDL 代码生成和验证的能力。
关键字： MathWorks FPGA HDL

基于XCR3032的大容量FLASH存储器接口设计

摘要：提出一种使用Xilinx公司生产的低功耗CPLD芯片XCR3032来实现微控制器与大容量FLASH存储器相接口的...
关键字： XCR3032 FLASH存储器 K9K1G08U0M Verilog HDL

学习FPGA应注意的问题

FPGA的基础就是数字电路和HDL语言，想学好FPGA的人，建议床头都有一本数字电路的书，不管是哪个版本的，这个是基础，多了解也有助于形成硬件设计的思想。在语言方面，建议初学者学习Verilog语言，VHDL语言语法规范严格，调试起来很慢，Verilog语言容易上手，而且，一般大型企业都是用Verilog语言。
关键字：赛灵思 FPGA HDL

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hdl介绍

　HDL(Hardware Description Language)，是硬件描述语言。顾名思义，硬件描述语言就是指对硬件电路进行行为描述、寄存器传输描述或者结构化描述的一种新兴语言。　　主流的HDL分为VHDL和Verilog HDL。VHDL诞生于1982年。在1987年底，VHDL被IEEE和美国国防部确认为标准硬件描述语言。自IEEE公布了VHDL的标准版本，IEEE- 1076（简称 [ 查看详细 ]

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