- 全球增长最快的可编程逻辑公司-广东高云半导体科技股份有限公司（以下简称“高云半导体”）近日宣布，高云半导体自主研发的逻辑综合工具Gowin Synthesis支持VHDL（Very-High-Speed Integrated Circuit Hardware Description Language）硬件描述语言流程综合。VHDL语言诞生于1982年，最初是由美国国防部开发出来供美军用来提高设计可靠性和缩减开发周期的一种使用范围较小的设计语言。1987年，VHDL被IEEE确认为标准硬件描述语言。VHDL
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半导体 VHDL
- 当前最流行的硬件设计语言有两种，即 VHDL 与 Verilog HDL，两者各有优劣，也各有相当多的拥护者。VHDL 语言由美国军方所推出，最早通过国际电机工程师学会(IEEE)的标准，在北美及欧洲应用非常普遍。而 Verilog HDL 语言则由 Gateway 公司提出，这家公司辗转被Cadence所购并，并得到Synopsys的支持。在得到这两大 EDA 公司的支持后，也随后通过了 IEEE 标准，在美国、日本及中国台湾地区使用非常普遍。 我们把这两种语言具体比较下： 1.整体结构 点评
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VHDL Verilog
- 数字通信网中，帧同步是同步复接设备中最重要的部分，他包括帧同步码的产生和帧同步码的识别，其中接收端的帧同步识别电路的结构对同步性能的影响是主
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VHDL 帧同步 算法
- 介绍了一种用CPLD(复杂可编程逻辑器件)作为核心控制电路的测试系统接口，通过时cPLD和竹L电路的比较及cPLD在系统中实现的强大功能，论述了CPLD在测试系
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EDA CPLD 测试系统接口 VHDL
- 随着集成电路技术的高速发展，VHDL已成为设计数字硬件时常用的一种重要手段。介绍EDA技术及VHDL语言特点，以串行加法器为例，分析串行加法器的工作原理
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EDA VHDL 串行加法器
- Petri网是异步并发现象建模的重要工具，Petri网的硬件实现将为并行控制器的设计提供一种有效的途径.本文在通用的EDA软件Max+PlusII中，研究了基本Petr
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EDA技术 FPGA VHDL Petri网
- 基于FPGA的数字密码锁-本文介绍了一种以FPGA 为基础的数字密码锁。采用自顶向下的数字系统设计方法， 将数字密码锁系统分解为若干子系统， 并且进一步细划为若干模块， 然后用硬件描述语言VHDL 来设计这些模块， 同时进行硬件测试。
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VHDL FPGA 液晶显示驱动 QuartusII
- VHDL超高速集成电路硬件描述语言是随着集成电路系统化和高度集成化逐步发展起来的，是一种用于数字系统设计、测试，面向多领域、多层次的IEEE标准硬件描述语言。
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VHDL Max+PlusⅡ EDA
- 心率计是常用的医学检查设备，实时准确的心率测量在病人监控、临床治疗及体育竞赛等方面都有着广泛的应用。心率测量包括瞬时心率测量和平均心率测量。瞬时心率不仅能够反映心率的快慢。同时能反映心率是否匀齐；平均心率虽只能反映心率的快慢，但记录方便，因此这两个参数在测量时都是必要的。
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VHDL 数字式 FPGA 心率计 设计
- 所谓结构体的行为描述（behavioral descriptions），即对设计实体按算法的路径来描述。行为描述在EDA工程中称为高层次描述或高级描述，
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VHDL 结构体 行为描述法
- 本文给出了一个利用格雷码对地址编码的羿步FIFO的实现方法，并给出了VHDL程序，以解决异步读写时钟引起的问题。
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异步 FIFO VHDL 设计
- 在结构体中，设计任务的程序包内定义了一个8输入与门（and8）和一个二异或非门（xnor2）。把该程序包编译到库中，可通过USE从句来调用这些元件，并从work库中的gatespkg程序包里获取标准化元件。
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VHDL 结构体 结构化 描述法
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