2008年六月3日，全球半导体联盟(GSA)今日宣布，GSA亚太领袖议会增加两名新成员，并成为GSA董事会针对全球及地区议题的顾问。这两位领袖成员分别为展讯通信(Spreadtrum)的武平博士、及奇景光电(Himax)的吴炳昌先生。
「武平博士及吴炳昌先生的加入，将扩大亚太领袖议会在产业及知识上的多元性。有这么多位优秀的产业菁英支持，将可继续加强我们在未来几年的国际化首创精神。」Jodi Shelton女士，GSA的执行长暨共同创办人表示。
自展讯通信于2001年四月成立起，武平博士即担
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半导体 GSA 展讯通信 奇景光电 SoC
廉价消费类无线设备日益增多的功能要求更高的集成度。大型数字IP，如微处理器、数字信号处理器(DSP)或加密引擎，需要与“电源控制、数据转换”等模拟模块和“LNA、VCO、混频器”等射频(RF)模块整合在一起。前者作为入侵源，会产生大量干扰噪声，并散布到整个系统中，最终降低那些最敏感电路(受害者)的操作性能。
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分析 完整性 信号 SoC 无线
WIMAX是基于IEEE 802.16标准的宽带无线接入城域网技术，根据IEEE 802. 16标准，用Verilog HDL设计了PCI接口电路。
并在FPGA上实现了PCI接口的功能，重点描述了状态机控制模块的设计和仿真结果，使用EDA技术提高了开发速度，满足了系统的要求。
1. 引言
随着计算机控制技术在各个领域的深入应用，为计算机与被控设备之间提供方便、实用通信方法的PCI(Peripheral Component Interconnection)总线
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WiMAX PCI FPGA SOC
意法半导体（ST）宣布，该公司的SPEAr可配置型系统芯片系列新增加一款生力军，新款的SPEAr基本型产品采用当前最先进的65nm低功耗制造工艺，可满足各种嵌入式应用的需求，如入门级打印机、传真机、数码相框、网络电话（VoIP）等设备。
ST的SPEAr（Structured Processor Enhanced Architecture，结构化处理器增强型架构）不仅能够降低在开放市场销售的标准产品的制造成本，加快
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ST SPEAr 嵌入式 SoC 芯片
在系统级芯片（SoC）的设计当中，MIPS的RISC处理器是一种应用非常广泛的嵌入式CPU，它具有高性能、低功耗的特点，可以很方便地集成到一个完整的片上系统之中，使开发者能够专注于用户IP模块的设计。MIPS架构的处理器占据了数字机顶盒微处理器和解码器用CPU架构市场领域的领先地位。在MIPS家族的产品当中，32位的4KcTM处理器是具有代表性的一款，它采用了MIPS32的CPU架构，支持MIPS IITM指令集。在本文
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嵌入式CPU SoC MIPS 总线接口模块
随着集成电路制造技术的迅速发展,SOC设计已经成为当今集成电路设计的发展方向。SO C设计的复杂性对集成电路设计的各个层次,特别是对系统级芯片设计层次,带来了新挑战，原有的HDL难以满足新的设计要求。
硬件设计领域有2种主要的设计语言：VHDL和Verilog HDL。而两种语言的标准不统一，导致软硬件设计工程师之间工作交流出现障碍,工作效率较低。因此，集成电路设计界一直在寻找一种能同时实现较高层次的软件和硬件描述的系统级设计语言。Synopsys公司与Coware公司针对各方对系统级设计语言的
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SOC SystemC 集成电路 VHDL Verilog HDL
介绍了以ARM+DSP体系结构为基础的FPGA实现。在其上验证应用算法，实现了由ARM负责对整个程序的控制，由DSP负责对整个程序的计算，最大程度地同时发挥了ARM和DSP的各自优势。
ARM通用CPU及其开发平台，是近年来较为流行的开发平台之一，而由ARM+DSP的双核体系结构，更有其独特的功能特点：由ARM完成整个体系的控制和流程操作，由DSP完成具体的算法和计算处理。这样，不但可以充分地发挥ARM方便的控制优势，同时又能最大限度地发挥DSP的计算功能。这在业界已逐渐成为一种趋势。
本
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ARM DSP FPGA 软硬件协同验证 SoC
系统级芯片(SoC)中存储器容量的增加以及嵌入式存储器支配整个裸片良品率的事实，使良品率设计(DFY)面临日...
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SoC 存储 代码 结构 逻辑 密度 单元 密度
血压是人体重要的生理参数之一，对其进行精确测量，有利于早期发现和鉴别高血压类型，提出合理的治疗建议。目前，临床上对普通病人主要采用无创检测的方法，它大致分为人工柯氏音法和示波法两类。人工柯氏音法虽然比较准确，但操作困难，受主观因素影响较大；传统的示波法虽然操作简单，但稳定性和个体适应性较差，不利于在临床应用上的普及和推广。本文在示波法的基础上，从硬件实现和软件设计两个方面改进了原来的测量方法，并进行了比对测试。
1 硬件设计
示波法进行血压检测的主要过程是获取袖带内变化的压力信号，分析从中
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SoC 电子血压检测仪 示波法 形态滤波 人工柯氏音法
DSC（Digital signal controller，数字信号控制器）是一种面向高端嵌入式系统的最先进的单片控制处理器。基于浮点架构的DSC具有更快的处理速度，所需的程序储存容量更少，支持更高级的有助于节省功耗的计算算法，同时进一步扩展了系统的性能。浮点编程比定点编程的速度更快，SoC（system-on-a-chip，片上系统）的集成方式能够有效控制板级空间、元件数量和整体系统开销。
随着嵌入式系统承担的任务越来越复杂，不论是降低功耗还是实现诸如汽车导航之类的新功能，它们都需要具有更高性
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DSC 数字信号控制器 浮点 SoC 控制系统
Analog Devices推出的两款针对电能市场中日益复杂的通信网络要求而设计的ADE51xx和ADE55xx单芯片计量器件，扩展了其领先市场的电能计量产品系列。全球来看，固态电子式电能表正逐步替代故障率高、容易窃电且不易于支持诸如远程抄表和分时计费等新功能的机电式电能表。而这些新功能的实现以及对计量网络更高的可靠性要求使得其需要更大的存储器容量，以满足电能行业日益增长的数据量要求。ADI公司的新款SoC（片上系统）电能计量IC集成了62 KB的片内闪存和2 KB的RAM（随机存取存储器），与其它同
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SoC ADI 计量 电能 存储器
为数字消费、家庭网络、无线、通信和商业应用提供业界标准架构、处理器及模拟 IP 的领先厂商 MIPS 科技公司（MIPS Technologies Inc.，纳斯达克交易代码：MIPS）今天宣布，BroadLight已经选择高性能 MIPS32® 24K® 内核作为其新型 GPON 系统级芯片（SoC）的基础核心。BroadLight 今天还宣布针对光纤到户（fiber-to-the-home，FTTH）应用的 BL2348 GPON 家庭网关（RG）SoC 解决方案已经开始提供样品。
关键字：
BroadLight SoC MIPS 集成电路 GPON
引 言
随着片上系统(SoC，System on Chip)时代的到来，包括复杂可编程逻辑器件(CPLD，Complex ProgrammableLogic Devi(e)和现场可编程门阵列(FPGA，Field Programmable Gate Array)的可编程逻辑器件(具有在系统可再编程的独特优点)，应用越来越广泛。这给用于可编程逻辑器件编程的下载电缆提出了更高的要求。
本文研究基于IEEEll49．1标准的USB下载接口电路的设计及实现。针对Altera公司的FPGA器件Cy-
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CPLD USB FPGA 下载电缆 SoC
引 言
CC2431是TI公司推出的带硬件定位引擎的片上系统(SoC)解决方案，能满足低功耗ZigBee／IEEE 802.15.4无线传感器网络的应用需要。CC2431定位引擎基于RS-SI(Received Signal Strength Indicator，接收信号强度指示)技术，根据接收信号强度与已知参考节点位置准确计算出有关节点位置，然后将位置信息发送给接收端。相比于集中型定位系统，RSSI功能降低了网络流量与通信延迟，在典型应用中可实现3～5 m定位精度和0.25 m的分辨率。本文在
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SoC RSSI 定位 寄存器 TI
在SoC系统设计方面，现在还有一些人们几乎未涉足的领域，而这些领域将对降低功耗产生最大的推动作用。幸运的是，人们现在已经拥有大量针对这一领域的设计工具。在近日美国旧金山举办的Electronic Summit2008上，Mentor Graphics的ESL-HDL部门总经理Glenn Perry介绍了系统级设计需要考虑的方方面面。
系统架构方面的改进将带来巨大的好处，不过在EDA世界，人们只有在设计的较晚阶段才使用功耗仿真工具，如门级和物理实现级。那为何不在系统级进行这些工作？原因主要包括：
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SoC 功耗 EDA
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