引 言
RC6是作为AES(Advanced Encryption Standard)的候选算法提交给NIST(美国国家标准局)的一种新的分组密码。它是在RC5的基础上设计的，以更好地符合AES的要求，且提高了安全性，增强了性能。根据AES的要求，一个分组密码必须处理128位输入／输出数据。尽管RC5是一个非常快的分组密码，但它处理128位分组块时用了2个64位工作寄存器；而AES目前在讲究效率和简洁方面不支持64位操作，于是RC6修正这个错误，使用4个32位寄存器而不是2个64位寄存器，以更好地实
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FPGA RC6
近两年，国际上大的半导体公司都推出了65纳米产品，并开始了45纳米/40纳米产品的研发，而国内也已经有五六家企业开始了65纳米的设计。但总体来说，65纳米/40纳米设计目前仍然还是一个新生事物，企业要解决一系列的技术难题。为此，我们邀请FPGA企业、EDA企业、IP企业、芯片制造企业共同探讨新工艺技术的研发关键点。
主持人 赵艳秋
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半导体 FPGA 功耗 功率管理 Altera 65纳米
从模拟广播向数字广播的转变为业界提供了令人振奋的新服务和挣钱机会，而OEM厂商之间为生产更有价格吸引...
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FPGA 数字电视
赛灵思公司宣布开始批量供应 Virtex-5 SX240T 和 FX200T 两款器件，同时还新推出了 Virtex-5 TXT FPGA 平台，旨在帮助高性能系统的架构和设计人员实现高性能、低功耗以及产品尽快推向市场等方面的目标。基于业界领先的高性能 Virtex-5 FPGA 架构，这些器件为客户提供了性能最高的可配置 DSP 平台、唯一嵌入 PowerPC® 双处理器的 FPGA 器件、以及全球最高带宽的串行连接能力。
Ross Video 公司高级设计工程师 Mario LeCa
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Xilinx FPGA
台湾，新竹—在2008年的北京奥运中，光彩夺目的LED灯光秀让全世界都叹为观止，可谓将中国的LED显示技术划下一个完美的惊叹号。尤其在奥运开幕式中，一张长147公尺、宽22公尺的「地幕」让人印象深刻，其中中央1300平方公尺的异型动态LED显示屏部分（见右图）是由中国知名的LED显示屏制造商北京利亚德(Leyard)公司所制造，并搭配聚积科技570,000颗的S-PWM专利技术驱动芯片- MBI5030所构成的完美结合，展现LED技术的匠心独具。
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LED S-PWM 驱动芯片 聚积科技
1系统组成系统采用Pt100作为敏感元件。温度调理芯片AD7711对其施加激励电流,Pt100两端的电压差...
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TI DSP PID PWM 温度控制
2008年10月21号，北京——Altera公司(NASDAQ: ALTR)今天宣布，为开发信息娱乐、导航、舒适和便捷、辅助驾驶系统的汽车设计人员和OEM提供平台ASSP替换信息娱乐系统(P.A.R.I.S.)。与Gleichmann电子研究股份有限公司联合开发，P.A.R.I.S.平台实现了完整的开发环境，包括工具、知识产权(IP)和软件，大大简化了车内系统的开发。10月20至22号在密歇根州底特律Cobo中心举行的Convergence 2008展会上，Altera将在62
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Altera OEM FPGA 汽车系
由Altera公司主办的SOPC WORLD大会在深圳举行，Altera亚太区副总裁兼董事总经理Erhaan Shaikh在大会上作了“多处理技术提高性能，降低功耗”的主题演讲。
Shaikh说：“功耗管理对未来应用非常关键，功耗挑战的一个例子就是每个移动基站每年耗电大约20,000公斤柴油。”为此，必须从提高性能、降低功耗并降低成本这三个方面来满足未来应用的需要。他强调说，“Altera的构建未来的解决方案就是Stratix IV E
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Altera 功耗 FPGA 中兴通信 IBM
2008年10月20日，Cirrus Logic公司宣布推出具备业界最高电流脉宽调制(PWM)输出 的IC Apex Precision Power™ SA306-IHZ和SA57-IHZ，应用于直流电动机驱动市场。随着该系列产品的推出，设计师第一次能够选择单个封装的解决方案，利用9V至60V的电源电压驱动三相无刷直流电机或有刷直流电机。该系列IC面向用于工业应用的电机控制电路，如工厂及办公自动化、机器人控制、产品筛选机，以及航空航天及军工领域的飞行器座椅及位置控制。
此前，如电机驱
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CirrusLogic PWM IC
视频和图像处理发展趋势
以视频和图像处理为核心的HDTV和数字影院等创新技术的进展非常迅速，其推动力量在于图像采集和显示分辨率、高级压缩方法以及视频智能的跨越式发展。
在过去几年中，分辨率的发展最为显著，表1列出了不同终端设备上目前能够达到的最高分辨率。从标准清晰度(SD)过渡到高清晰度(HD)，需要处理的数据量提高了6倍。视频监控也从普通中间格式(CIF)(352×288)转向标准要求的D1格式(704×576)，某些工业摄像机甚至达到1280×720HD
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FPGA
应用VHDL语言设计数字系统，很多设计工作可以在计算机上完成，从而缩短了系统的开发时间，提高了工作效率。本文介绍一种以FPGA为核心，以VHDL为开发工具的数字秒表，并给出源程序和仿真结果。
1 系统设计方案
1.1 系统总体框图
数字秒表主要有分频器、计数模块、功能控制模块、势能控制模块和显示输出模块组成。系统框图如图1所示。
本次的设计仿真选用以EP1C6Q240芯片为核心的FPGA开发板，该开发板提供了较完善的外围周边电路和信号接口，并提供了一块4位7段数码管的扩
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FPGA
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