- 设计了一种基于FPGA控制的高速数据存储系统。该系统采用FPGA实现了对四个符合ATA-6规范的、RAID 0配置的IDE磁盘阵列的管理，并配合四个SDRAM实现对数据的高速稳定存储。该磁盘阵列同时挂四个IDE硬盘，平均数据流达到200MB/s，峰值传输速率达到800MB/s，也可以扩展更多硬盘，构成大容量的磁盘阵列。
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高速数据存储 IDE磁盘阵列 FPGA
- 提出一种实时数字化光纤传输系统，该系统分为发送端和接收端。发送端用A／D转换器将输入的模拟信号数字化，再用FPGA对数据进行处理，并通过光纤传输。同时，FPGA还控制A／D转换器的工作。接收端用串行收发器TLK1501对接收数据进行解码处理，还原有效信号。实验表明，该系统实时性好、信号传输误码率低、工作性能稳定、抗干扰性强，系统具有可行性和有效性。
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光纤通讯 高速数字信号传输 FPGA
- 在数字下变频系统实现方案中，输入的模拟中频信号经过高速A/D采样数字化后与数控振荡器NCO(Numerically Controlled Osillator)产生的正交本振信号混频，然后再由抽取滤波模块进行处理，以输出低速的低频或基带信号。本文以软件无线电数字下变频技术为研究对象，参考GSM系统建立数字下变频系统。
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数字变频 软件无线电 FPGA
- 基于FPGA硬件实现固定倍率的图像缩放，将2维卷积运算分解成2次1维卷积运算，对输入原始图像像素先进行行方向的卷积，再进行列方向的卷积，从而得到输出图像像素。把图像缩放过程设计为一个单元体的循环过程，在单元体内部，事先计算出卷积系数。降低了FPGA设计的复杂性，提高了图像缩放算法的运算速度，增强了系统的实时性，已经应用于某款航空电子产品中，应用效果良好。
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图像缩放 卷积运算 FPGA
- 设计了一种基于FPGA平台的并行处理流水线结构，配合高速查表，可支持10Gbps接口的报文转发。该设计已应用在国家863计划重大课题“可扩展到T比特的高性能IPv4/v6路由器基础平台及实验系统”中,并通过测试。
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并行流水线 高速查表 FPGA
- 本文论述了利用用FPGA来开发DDS函数发生器的总体设计思路，详细讨论了任意波形产生、频率精确调整、双路移相输出、PWM调制波产生、D/A转换与滤波电路、键盘与显示等诸方面软硬件实现方法。 整个设计
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DDS 任意波形发生器 FPGA
- 研究了基于FPGA的同步FIFO和移位寄存器，利用同步FIFO作为大幅面高速彩色喷绘机喷头与上位机之间数据传输以及接口数据传输的缓存模块。该设计在保证数据传输实时性的前提下，解决了喷头和上位机像素数据格式方向不一致的问题，并消除了部分数据冗余。
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同步FIFO 彩色喷绘机 FPGA
- 介绍了基于Altera公司EP1K30TC144芯片的电梯控制器设计过程，描述了该控制系统的功能。该设计采用VHDL语言进行编程，以QUARTUSⅡ软件为开发平台，对本设计进行了仿真，并使用JTAG将程序代码下载到实验板上进行了硬件验证。
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JTAG 电梯控制器 FPGA
- 介绍了一种基于FPGA的水声信号数据采集与存储系统的设计与实现,给出了系统的总体方案,并对各部分硬件和软件的设计进行了详细描述。系统以FPGA作为数据的控制处理核心,以存储容量达2 GB的大容量NAND型Flash作为存储介质。该系统主要由数据采集模块、数据存储模块和RS-232串行通信模块组成,具有稳定可靠、体积小、功耗低、存储容量大等特点,实验证明该系统满足设计要求。
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数据采集 Flash FPGA
- 在交流伺服驱动系统概念的基础上，提出了基于ACTEL现场可编程逻辑器件APA300的光电编码器与光栅尺信号处理电路设计原理，该电路由4倍频细分、辨向电路、计数电路组成，信号处理模块通过VHDL语言实现。
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交流伺服系统 VHDL FPGA 光栅尺信号处理
- 针对主飞行显示仪对图形处理和显示的苛刻要求，采用基于仪器总线和扩展总线的高速阵列信号处理板的设计模式，提出了一种基于硬件加速的PFD图形显示设计方法。该方法实现了图形分层双缓存交替切换、图形填充、图形合成和多通道DMA像素引擎，提高了PFD图形生成和显示的实时性和可靠性。实践证明，该设计显著解决了PFD图形显示系统中的速度瓶颈。
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图形处理 图形合成 FPGA
- intevac是商用和军用市场光学产品的前沿开发商。本文介绍该公司nightvista嵌入式电子系统的开发，该产品是高性能超低亮度紧凑型摄像机。该摄像机最初采用了流行的数字信号处理器、几个assp和外部存储器件。系统对性能的需求越来越高，工程师团队决定试验一种替代方案——在可编程逻辑中实现可配置软核处理器。
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图像处理 NIOS FPGA
- 围绕小卫星体积小、重量轻和价格低廉的特点，一个多CPU共享内存的系统（CPU仍然采用有相应宇航级器件的8086）将是比较合适的选择。同时为了提高共享内存的数据通信带宽，使其不成为整个系统的瓶颈，本文提出了一个用ASIC设计一个共享总线开关网络（简称SBSN，下同），组合成Omega网络的方案，以消除对某一组内存的总线竞争，实现多CPU对共享分组存储系统的低位交叉并行访问。
- 关键字：
并行存储器 多CPU共享内存 FPGA
- 多加数的加法器是FPGA的一个比较常见的应用。仿真对比了其三种实现方案的性能和所消耗资源，得出进位保留加法阵列是首选方案。针对进位保留加法阵列实现的复杂性给出了一个加法阵列的HDL代码生成器，极大地简化了加法阵列的设计工作。
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HDL代码生成器 加法器 FPGA
- 本文就调试FPGA系统时遇到的问题及有助于提高调试效率的方法，针对Altera和Xilinx的FPGA调试提供了最新的方法和工具。
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逻辑分析仪 测试内核 FPGA
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