- 为实现频谱监测、通信侦察等任务，提出了一种基于软件无线电的数字侦察接收机的软、硬件体系结构。该接收机基于高速数字信号处理器、大规模现场可编程门阵列、高速AD芯片、高精度大动态范围AGC电路，实现了信号的宽频段、宽带接收；采用盲信号处理技术，实现了对未知信号的参数辨识、分类、盲解调。
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频谱监测 软件无线电 FPGA
- 介绍以图像处理为应用背景、基于FPGA芯片建立的多软核系统设计。系统中包含两个Nios II软核处理器和两个用于进行图像颜色空间转换的CSC MegaCore IP核。两个Nios II软核处理器共享程序存储器、数据存储器及启动存储器。在硬件设计方面，CSC MegaCore IP作为外围组件通过一个自定义的接口控制器连接到以Nios II软核处理器为核心的SoPC系统中。在软件设计方面，运行在每个Nios II软核处理器上的程序通过硬件Mutex核协调对共享数据存储器的访问。
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图像处理 多软核系统 FPGA
- 以Altera公司的QuartusⅡ7．2作为开发工具，研究了基于FPGA的DDS IP核设计，并给出基于Signal TapⅡ嵌入式逻辑分析仪的仿真测试结果。将设计的DDS IP核封装成为SOPC Builder自定义的组件，结合32位嵌入式CPU软核NiosII，构成可编程片上系统(SOPC)，利用极少的硬件资源实现了可重构信号源。该系统基本功能都在FPGA芯片内完成，利用SOPC技术，在一片FPGA芯片上实现了整个信号源的硬件开发平台，达到既简化电路设计、又提高系统稳定性和可靠性的目的。
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直接数字频率合成 IP核 FPGA
- 基于遗传算法的组合逻辑电路的自动设计，依据给出的真值表，利用遗传算法自动生成符合要求的组合逻辑电路。由于遗传算法本身固有的并行性，采用软件实现的方法在速度上往往受到本质是串行计算的计算机制约，因此采用硬件化设计具有重要的意义。为了证明基于FPGA的遗传算法的高效性，设计了遗传算法的各个模块，实现了基于FPGA的遗传算法。
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遗传算法 自然进化 FPGA
- 现场可编程门阵列（Field Programmable Gate Array,FPGA）在通信、图形、控制、计算等领域的广泛应用,已经成为当今电子系统中的重要组成部分.随着越来越多的系统采用FPGA实现核心设计,使得FPGA中的设计和知识产权变得更加重要,建立FPGA代码运行安全体系已成为大型产品设计中重要的考虑因素.本文阐述了FPGA的多种安全解决方案,并探讨分析了FPGA的设计安全性.
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代码运行安全 安全解决方案 FPGA
- 半导体激光器的自动功率控制是解决激光器阈值漂移的重要手段，本文设计了一个基于FPGA的数字激光自动功率控制系统，该控制系统主要由光电检测、A／D转换、SOC控制、APC判定、PWM反馈输出及低通滤波几个部分组成。该自动功率控制系统使用硬件资源少，根据不同的设计要求，通过增加PWM模块和简单的模拟器件或者改变控制寄存器的设置，就可以实现多级激光功率和多个激光器的控制，可以大大缩短设计周期。
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数字激光器 自动功率控制 FPGA
- 介绍了反射式全景图像展开原理，分析了图像产生锯齿失真和阶梯化现象的原因，提出了解决问题的算法，并设计了FPGA实现的系统硬件结构。
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全景图像 锯齿失真 FPGA
- 本文以Ｖｉｒｔｅｘ－ＩＩ系列ＰｌａｔｆｏｒｍＦＰＧＡ为例，说明采用ＦＰＧＡ方案进行数字显示系统设计所具有的灵活、快速和低成本等特性。
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数字显示系统 SoC FPGA
- 设计了一种光强自动调节系统。通过光电传感电路实现光电信号的转换，使用FPGA对数据进行实时处理，并以实验环境光照强度测试结果为参照对所测光强进行线性变换修正，进而查表获得舵机偏转角度的控制量，通过改变偏振片偏振化方向夹角来调节入射光强。自动调光系统测量精度较高，实时调节性较好，鲁棒性较强。
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光强调节 光电传感 FPGA
- 利用功能强大的FPGA实现视频图像的一种运动估计设计，采用的搜索方法是三步搜索法。在进行方案设计时，本文采用了技术比较成熟的VHDL语言进行设计，并使用Quartus II软件进行时序仿真。由仿真结果可知，无论是在功能的实现上还是在搜索的准确性、高效性以及FPGA片上资源的利用率上，本设计方案都具有明显的优越性。
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运动估计 视频编码器 FPGA
- 在简要介绍同步数字复接基本原理的基础上，采用VHDL语言对同步数字复接各组成模块进行了设计，并在ISE集成环境下进行了设计描述、综合、布局布线及时序仿真，取得了正确的设计结果，同时利用中小容量的FPGA实现了同步数字复接功能。
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同步数字复接 VHDL FPGA
- 在应用FPGA进行DDS系统设计过程中，选择芯片的运行速度优化和资源利用优化常常是相互矛盾的，从发展趋势和运算要求看，系统速度指标的意义比面积指标更趋重要。基于此，介绍了一种流水线结构来优化传统的相位累加器，在QuartusⅡ开发环境下搭建系统模型、仿真及下载，并采用嵌入式逻辑分析仪分析和验证了实验结果。该系统可以完成多位频率控制字的累加，能够产生正弦波、方波和三角波，具有良好的实时性。
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流水线相位累加器 DDS FPGA
- 提出了基于FPGA技术实现数字复接系统的设计方案，并介绍了基群与二次群之间的复接与分接的系统总体设计。硬件电路调试证明，该方案是行之有效的。
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数字复接系统 基群 FPGA
- 文章中提出了一种应用于FPGA的嵌入式可配置双端口的块存储器。该存储器包括与其他电路的布线接口、可配置逻辑、可配置译码、高速读写电路。在编程状态下，可对所有存储单元进行清零，且编程后为两端口独立的双端存储器。
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块存储器 双端口 FPGA
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