为抑制电磁噪声对悬浮控制系统的影响，介绍了一种通过避开噪声持续时间进行A/D采样的方法，详细讨论了该方法的原理与实现。实践表明，它能有效地防止噪声引入控制系统，提高系统的性能
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悬浮控制 降噪 A/D采样 FPGA
基于FPGA设计的驱动电路是可再编程的，与传统的方法相比，其优点是集成度高、速度快、可靠性好。若要改变驱动电路的时序，增减某些功能，仅需要对器件重新编程即可，在不改变任何硬件的情况下，即可实现驱动电路的更新换代。通过对TCDl50lD输出图像信号特征的简要分析，分别阐述了内、外2种除噪方法，并给出了相应的时序，再利用Quartus II 7．2软件平台对TCDl501D CCD驱动时序及AD9826的采样时序进行了设计及结果仿真，使CCD的驱动变得简单且易于处理，这是传统逻辑电路无法比拟的，对其他CCD时
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CCD驱动时序 模拟信号处理 FPGA
本文只谈及了一些基本的概念。这里所涉及的任何一个主题都可以用整本书的篇幅来讨论。关键是要在为PCB版图设计投入大量时间和精力之前搞清楚目标是什么。一旦完成了版图设计，重新设计就会耗费大量的时间和金钱，即便是对走线的宽度作略微的调整。不能依赖PCB版图工程师做出能够满足实际需求的设计来。原理图设计师要一直提供指导，作出精明的选择，并为解决方案的成功负起责任。
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PCB 电容 SERDES FPGA
虽然数码相机 (DSC) 投入市场仅几年时间，但已经使消费类电子成像业发生了翻天覆地的变化。目前，全球售出的相机中大约有三分之一是数码相机，而且其份额还在稳步上升。
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DSP 数码 MPEG-4 压缩
你接到要求用FPGA实现FIR滤波器的任务时，也许会想起在学校里所学的FIR基础知识，但是下一步该做什么呢?哪些参数是重要的?做这个设计的最佳方法是什么?还有这个设计应该怎样在FPGA中实现?现在有大量的低成本IP核和工具来帮助你进行设计，因为FIR是用FPGA实现的最普通的功能。
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FIR滤波器 DSP LUT FPGA
赛灵思公司开发了一种规则驱动的方法。首先根据PCB和FPGA设计要求定义一套初始引脚布局，这样利用与最终版本非常接近的引脚布局设计小组就可以尽可能早地开始各自的设计流程。 如果在设计流程的后期由于PCB布线或内部FPGA性能问题而需要进行调整，在采用这一方法晨这些问题通常也已经局部化了，只需要在PCB或FPGA设计中进行很小的设计修改。
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PCB IO引脚分配 FPGA
对于实际的DSP应用系统特别是产品化的DSP系统而言，可靠性是一个不容忽视的问题。由于DSP系统的时钟频率比较高，因此在运行时极有可能发生干扰和被干扰的现象，严重时系统可能会出现死机。为了克服这种情况，除了在软件上作一些保护措施外，硬件上也必须作相应的处理。硬件上最有效的保护措施就是采用具有监视(Watchdog)功能的自动复位电路。各大公司生产了多种微处理器监控器，用来监测微处理器的运行状态，一旦微处理器失控就强行复位微处理器，引导程序重新运行。
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MAX706S DSP 监控电路
在FPGA开发的各个阶段，市场为我们提供了很多优秀的EDA工具。面对眼花缭乱的EDA工具，如何充分利用各种工具的特点，并规划好各种工具的协同使用，对FPGA开发极其重要。本文将通过开发实例“带顺序选择和奇偶检验的串并数据转换接口”来介绍基于多种EDA工具——QuartusII、FPGA CompilerII、Modelsim——的FPGA协同设计。
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FPGA；EDA；协同设计
在卫星姿态和轨道控制计算机(AOCC)分系统的设计和室内联调阶段，为方便系统调试，需设计动量轮模拟器，模拟执行机构动量轮所决定的卫星姿态和控制效果，代替真实部件进行分系统的开环和闭环试验。
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动量轮 模拟器 DSP
时序问题的恼人之处在于没有哪种方法能够解决所有类型的问题。由于客户对于和现场应用工程师共享源代码通常非常敏感，因此我们通常都是通过将工具的潜力发挥到极致来帮助客户解决其时序问题。当然好消息就是通过这种方法以及优化RTL代码，可以解决大多数时序问题。
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时序问题 FPGA
FPGA(Field Pmgrammable Gate Array)现场可编程门阵列在数字电路的设计中已经被广泛使用。这种设计方式可以将以前需要多块集成芯片的电路设计到一块大模块可编程逻辑器件中，大大减少了电路板的尺寸，增强了系统的可靠性和设计的灵活性。本文详细介绍了已在实际项目中应用的基于FPGA的串口通讯设计。本设计分为硬件电路设计和软件设计两部分，最后用仿真验证了程序设计的正确性。
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Verilog 串口通讯 FPGA
诱发电位是神经系统接受各种外界刺激后所产生的特异性电反应。它在中枢神经系统及周围神经系统的相应部位被检出，与刺激有锁时关系的电位变化，具有能定量及定位的特点，往往较常规脑电图检查有更稳定的效果，从而在诊断及研究神经系统各部位神经电生理变化方面，有重要作用。
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脑电电位 VGA FPGA 诱发电位
SoC是大规模集成电路的发展趋势。SoC设计必须依靠完整的系统级验证来保证其正确性。基于FPGA的验证平台能够缩短SoC验证时间，并提高验证工作的可靠性，还具有可重用性。本文利用Altera公司的FPGA设计了一个基于片上总线的SoC原型验证平台，并将VxWorks嵌入式操作系统应用于此平台，通过软硬件协同验证的方法，验证了平台的可靠性。该平台在CF卡及通用智能卡SoC芯片验证中得以应用。
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SoC验证平台 系统级验证 FPGA
介绍了一种以FPGA 可编程逻辑器件为设计平台的、采用大屏幕全彩led 显示屏进行全彩灰度图像显示的扫描控制器实现方案。经过对“19 场扫描”理论灰度实现原理的分析，针对采用该方法实现的全彩LED
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LED 显示屏设计 FPGA
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