- 提出了以DSP为控制核心，采用USB通信设计的飞机防滑刹车测试系统。分析了飞机防滑刹车测试系统的组成，并介绍了测试系统主要硬件电路设计和系统上下位机软件设计。
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刹车 测试系统 设计 防滑 飞机 USB 接口 DSP 基于
- 目前，处理器性能的主要衡量指标是时钟频率。绝大多数的集成电路 (IC) 设计都基于同步架构，而同步架构都采用全球一致的时钟。这种架构非常普及，许多人认为它也是数字电路设计的唯一途径。然而，有一种截然不同的设计技术即将走上前台：异步设计。
这一新技术的主要推动力来自硅技术的发展状况。随着硅产品的结构缩小到 90 纳米以内，降低功耗就已成为首要事务。异步设计具有功耗低、电路更可靠等优点，被看作是满足这一需要的途径。
异步技术由于诸多原因曾经备受冷落，其中最重要的是缺乏标准化的
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功耗 高性能 设计 核心 DSP 异步
- 在最近的机器人比赛和电子设计竞赛中，较多参赛题目要求机器人沿场地内白色或黑色指引线行进。一些研究人员提出了基于寻线的机器人设计策略，主要是关注指引线的检测，但对于机器人的整体设计未做说明。本文在总结此类赛事的基础上，提出了一种将DSP(Digital Signal Processor)和CPLD(Complex Programmable Logic Device)作为核心处理器，采用模糊控制策略处理来自检测指引线传感器信号的机器人行走机构的通用性设计方法。
1 车体机械设计
由于机器人比赛
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DSP 模糊控制 机器人 传感器 单片机
- 三维图像信息处理一直是图像视频处理领域的热点和难点，目前国内外成熟的三维信息处理系统不多，已有的系统主要依赖高性能通用PC完成图像采集、预处理、重建、构型等囊括底层和高层的处理工作。三维图像处理数据量特别大、运算复杂，单纯依靠通用PC很难达到实时性要求，不能满足现行高速三维图像处理应用。
本系统中，采用FPGA实现底层的信号预处理算法，其处理数据量很大，处理速度高，但算法结构相对比较简单，可同时兼顾速度和灵活性。高层处理算法数据量较少、算法结构复杂，可采用运算速度快、寻址方式灵活、通信机制强大的
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FPGA DSP 三维图像信息处理 EVIP PCI
- 数字滤波器在数字信号处理的各种应用中发挥着十分重要的作用，他是通过对采样数据信号进行数学运算处理来达到频域滤波的目的。数字滤波器既可以是有限长单脉冲响应(FIR)滤波器也可以是无限长单脉冲响应(IIR)滤波器。在维纳滤波器理论发明的早期，人们使用IIR滤波器，但现在更多是使用FIR滤波器。本文按照Matlab／Simulink／DSP Builder／QuartusⅡ流程，设计一个FIR滤波器。Altera DSP Builder是连接Simulink和QuartusⅡ开发软件的DSP开发工具。在DSP
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滤波器 设计 FIR Builder DSP 基于
- 这一新技术的主要推动力来自硅技术的发展状况。随着硅产品的结构缩小到 90 纳米以内，降低功耗就已成为首要事务。异步设计具有功耗低、电路更可靠等优点，被看作是满足这一需要的途径。
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功耗 高性能 设计 核心 DSP 异步
- 电子产品世界,为电子工程师提供全面的电子产品信息和行业解决方案,是电子工程师的技术中心和交流中心,是电子产品的市场中心,EEPW 20年的品牌历史,是电子工程师的网络家园
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8位微处理器 DSP 数字 低通滤波器
- 电子产品世界,为电子工程师提供全面的电子产品信息和行业解决方案,是电子工程师的技术中心和交流中心,是电子产品的市场中心,EEPW 20年的品牌历史,是电子工程师的网络家园
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数字信号处理 DSP
- 过渡至65纳米工艺的FPGA具备采用更小尺寸工艺所带来的优势：低成本、高性能和更强的逻辑能力。尽管这些优势能够为高级系统设计带来激动人心的机会，但65纳米工艺节点本身也带来了新的挑战。例如，在为产品选择FPGA时，功耗的考虑变得越来越重要。很可能下一代设计会需要在功耗预算不变(或更小)的情况下，集成更多的特性和实现更高的性能。
本文将分析功耗降低所带来的益处，还将介绍Virtex-5器件中所采用的多种技术和结构上的革新，它们能提供功耗最低的解决方案，并且不牺牲性能。
降低功耗的好处
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FPGA 低功耗 Virtex-5 静态功耗 动态功耗
- 2008年6月9日，为了满足高度定制化半导体解决方案的市场需求，飞思卡尔在Altera Cyclone III系列FPGA上推出32位V1 ColdFire内核的首款现场可编程栅格阵列（FPGA）。半导体知识产权（IP）许可专家IPextreme公司将通过其在线Core Store™市场免费为Cyclone III客户提供V1内核许可。
V1 ColdFire内核许可为那些不能通过标准嵌入式处理器和片上系统（SOC）器件解决其设计问题的工程师提供一款灵活、经济高效的解决方案。
- 关键字：
飞思卡尔 FPGA 内核 Cyclone
- 电子产品世界,为电子工程师提供全面的电子产品信息和行业解决方案,是电子工程师的技术中心和交流中心,是电子产品的市场中心,EEPW 20年的品牌历史,是电子工程师的网络家园
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FPGA 嵌入式系统
- 本文通过研究提出了一种多处理器实时开发环境的设计思想，它可以支持多种型号处理器的同时开发，使系统级开发变得简单易行。
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环境 设计 开发 实时 DSP 处理器 基于
- 介绍了DSP应用系统的硬件接口电路：包括电平变换电路、仿真器JTAG接口电路、以及可扩展的硬件接口（如A/D、D/A、SRAM）等的设计方法，并给出了接口电路在设计时须注意的几个问题。
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DSP 应用系统 电路设计 硬件接口
- 视频压缩编码标准H.264／AVC是由ISO／IEC和ITU-T组成的联合视频专家组(JVT)制定的，他引进了一系列先进的视频编码技术，如4×4整数变换、空域内的帧内预测，多参考帧与多种大小块的帧间预测技术等，标准一经推出，就以其高效的压缩性能和友好的网络特性受到业界的广泛推崇。特别是在2004年7月JVT组织做了重要的保真度范围扩展的补充后，更加扩大了标准的应用范围，但同时巨大的运算量却成为其广泛应用的瓶颈。考虑到H.264协议实现的复杂度，本文的思路是：一方面提高硬件处理速度和能力，采
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DSP 编码算法 视频压缩编码 编码器 ARM CPU
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