- 综合考虑面积和速度等因素，采用一次多项式拟合实现了简单快速的log-add算法单元。实验结果表明，在相同的精度要求下，其FPGA实现资源占用合理，硬件开销好于其他次数的多项式拟合实现方案。
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log-add算法单元 多项式拟合 FPGA
- 通过对传统Canny边缘检测算法的分析提出了相应的改进方法。通过模板代替卷积、适当的近似变换、充分利用并行处理单元等使其能够用FPGA实现。
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Canny边缘检测算法 卷积 FPGA
- 介绍了基于FPGA设计的三相PWM发生器。该发生器具有灵活和可编程等优点,可应用于交流电机驱动用的三相电压源逆变器。实验结果验证了本设计的有效性。
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PWM发生器 三相逆变器 FPGA
- 文本信息用户可能乐意以体积换取 QWERTY 键盘，因为文本输入大为简便了，而且两个大拇指都可以用来输入文本信息或数据。最近，有些手机生产商已经推出了面向文本用户的带 QWERTY 键盘的手机。
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QWERTY键盘 GPIO CPLD
- 小波变换在ECG信号处理中的应用得到了很多研究人员的关注。本文研究了5层5/3提升小波变换及其反变换的FPGA实现，并将其应用于ECG信号的压缩，在均方误差可控的范围内获得了较大的压缩比，并利用设计的硬核实现了信号的重建。
- 关键字：
ECG信号处理 小波变换 FPGA
- 传统的嵌入式产品只能实现某种特定的功能，不能满足用户可变的丰富多彩的应用需求。为解决这个问题，本文设计并实现了一种使用Java作为软件平台的基于FPGA的可编程嵌入式系统，以实现系统对多种本地应用和网络的支持。
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Java平台 JNI FPGA
- 考虑冲击环境下定时器会遇到的问题,并分析了单一的晶体振荡器和谐振振荡器都不能很好地满足抗冲击性和高精度两方面要求,因此提出了一种基于FPGA设计的双振荡定时器。此定时器能有效地解决爆破作业中延时雷管起爆精度和抗冲击性能之间的矛盾。更主要的是CPLD的时序比集成芯片更加容易控制。在FPGA实现,该设计的定时精度达到纳秒级,很好地满足系统性能要求。本方法具有结构简单、成本低、可靠性高、精度高等优点。
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定时器 纳秒级 FPGA
- 一种独立式多分辨率VGA/DVI压缩存储系统，该系统支持VGA/DVI输入，同时支持SVGA、XGA、SXGA、UXGA、1080p等任意分辨率图像的连续压缩和存储。在100 MHz时钟频率下，系统可以对图像SXGA和UXGA实时压缩为(25帧/s)和(17帧/s)。实验表明，在不同码率下，系统的单帧图像压缩性能与JPEG2000标准近似，PSNR值优于JPEG标准。
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VGA/DVI压缩存储系统 图像压缩 FPGA
- 为了解决SAR匹配成像数据以及合成孔径雷达中频采样后高速海量数据的存储问题，介绍了一种基于FPGA控制的NAND Flash数据存储及回放系统设计方案。实验证明,该系统能以3 Gb/s码流实时存储数据具有强实时性，且性能稳定，有很好的工程使用价值。
- 关键字：
合成孔径雷达 海量数据存储 FPGA
- 提出了一种基于CPLD的频率响应特性测试卡设计方案,分析了DDS原理的CPLD实现方法,给出了数据处理算法流程,并进行了设计验证实验,结果表明在逐点单频测试状态下,相位和幅值测量与标准仪器相比相位差小于0.5°,幅值差小于0.1dB。
- 关键字：
频率响应 DDS原理 CPLD
- 在通信系统中应用广泛。由于RS码的译码复杂度高，数字运算量大，常见的硬件及软件译码方案大多不能满足高速率的传输需求，一般适用于10Mbps以下。本文提出的欧氏算法和频谱结构分析相结合的RS硬件解码方案，适用于FPGA单片实现，速率高、延迟小、通用性强、使用灵活。笔者在FPGA芯片上实现了GF（2 8）上符号速率为50Mbps的流式解码方案，最大延时为640ns，参数可以根据需要灵活设置。
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RS编译码 差错控制编码技术 FPGA
- 为了准确截获并识别目标信号，针对军事通信信号环境设计了一种MSK信号检测识别方法，并使用FPGA进行了设计实现。
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MSK信号检测 频谱利用率 FPGA
- 本文结合实际应用需要，设计了基于复杂可编程逻辑器件(CPLD)的线阵CCD数据采集系统。着重介绍了数据采集的特点及该系统软、硬件设计和最后的性能评价。
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数据采集系统 CCD CPLD
- 针对现有的动态背景提取运动目标物体算法复杂且难以在硬件上实现的问题，研究了改进型surendra背景更新算法原理的特点，提出了改进型surendra背景更新算法的硬件结构，并对硬件结构进行综合、仿真后，在FPGA芯片上实现。
- 关键字：
运动目标提取 surendra背景更新算法 FPGA
- 为实现智能车全景视觉系统的应用研究平台，设计了一种基于FPGA+双DSP的实时6通道数字图像采集与处理系统。该系统由两片FPGA与两个DSP组成。第一个FPGA进行多通道视觉图像采集的同步控制、逻辑处理，第二片FPGA辅助DSP进行海量图像数据的高速并行处理。
- 关键字：
全景视觉系统 FPGA+DSP 数字图像采集与处理系统
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