全面线路保护方案供应商Semitel继半导体ESD全面保护方案之后，结合新材料和多层印制线路板技术，推出了超低电容的高分子ESD的专利产品。目前其产品的电容值最低已经能做到0.15pF，完全适合超高速传输的应用场合。
在需要超高速传输信号的场合，如高清晰多媒体接口(HDMI),数字影像接口(DVI),USB2.0接口，手机天线等，其传输速率多在3Gbps以上，当保护器件的电容大于1pF时，其寄生电容会对信号的传输造成非常大的影响。采用传统的半导体工艺制作的半导体ESD保护元件，其电容一般都在几个
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模拟技术 电源技术 Semitel 电子 ESD SoC ASIC
SOPC一词主要是源自Altera, 其涵义是因为目前CPLD/FPGA的容量愈來愈大, 性能愈來愈好, 加上价格下跌的推波助澜之下, 以往ASIC产品才能具有的 SoC观念, 也能移植到CPLD/FPGA上, 并且因为CPLD/FPGA的可编程(Programmable)能力, 使得CPLD/FPGA不仅能实现一个高复难度的系统, 而且还能快速改变系统的特性. 类似的观念也鉴于Xilinx的Platfor
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SOPC CPLD FPGA SoC ASIC
1 概述
数字摄像机的最大特点在于信号数字化。它由成像芯片CCD将静止或活动的图像分解成像素，并转换成电信号。这些信号由数字摄像机内的数字信号转换器转换成数字信号，再经微处理器进行图像处理和数据压缩编码后送到内部或外部存储器，同时也可送到LCD/TV显示屏。
存储器中的数字信息通过接口输入电脑再变成图像。借助于CPU所提供的图像处理软件，按人们意愿进行加工、编辑等处理，然后由彩色打印机制成一张理想的图像。更重要的是，数字委员会还能通过电脑网络传到世界各地。
与模拟摄像机相比较，数字摄
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嵌入式系统 单片 数字摄像机 LCD/TV CCD SoC ASIC
摘 要：本论文介绍视频编解码IP核在SOPC中的设计，用Verliog HDL实现其各个功能子模块，全部调试仿真通过合并成一个模块，实现了视频信号的采集，分配，存储以及色度空间的转换。整个模块都通过仿真实现与验证，很好的达到了系统的要求。关键字：SOPC；视频编解码；IP核；Verilog HDL 引言 基于Nios II软核的SOPC是Altera公司提出的片上可编程系统解决方案，它将CPU、存储器、I/O接口、DSP模块以及锁相环的系统设
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嵌入式系统 单片机 SOPC 频编解码 SOPC 视频编解码 IP核 Verilog HDL
据市场研究公司Frost & Sullivan最新发表的研究报告称，全球汽车专用集成电路（ASIC）市场将从亚洲市场收入增长中受益。这篇报告称，全球汽车专用集成电路市场2006年的收入为29.9亿美元，2007年的销售收入将达32.4亿美元，2008年的销售收入将达到35亿美元，2010年的销售收入将达到41亿美元。这个市场从2006年至2010年的复合年增长率将达8.2%。 Frost & Sullivan研究分析师Bonnie Varghese在声明中说，政府污染标准、安全标准
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汽车电子 集成电路 ASIC 汽车电子
据市场调研公司Gartner，专用标准产品(ASSP)和专用集成电路(ASIC)市场中的模拟领域，将以7.4%的复合年增率增长，2011年将从2006年的237亿美元上升到338亿美元。这低于以前的预测。Gartner先前预测模拟专用IC市场的复合年增率将达11.4%。 在其最新预测中，汽车领域将是专用模拟IC市场中增长最快的领域，复合年增率达10.8%，2011年将从2006年的35亿美元增长到59亿美元。同时，消费领域增长最慢，复合年增率只有5.5%，预计2011年将从2006年的39亿美元上升到52
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嵌入式系统 单片机 IC 集成电路 ASIC
由于与深亚微米标准单元ASIC相关的非重复性工程费用(NRE)越来越大，设计周期又很长，因此利用结构化ASIC进行定制IC设计的吸引力正变得越来越大。结构化ASIC能以极具竞争力的单位成本提供优秀的硅片性能，并且NRE费用极低。结 构化ASIC的多样性意味着它即可以用作系统主芯片，也可以用作高性价比的小型辅助芯片。
许多物理设计问题在结构化ASIC的片设计中已经得到解决，因此后端版图设计的时间可以大大缩短，从而导致更快的验证确认和原型提供。不过ASIC片具有预定义的结构，因此设计师必须合理安排芯片
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嵌入式系统 单片机 ASIC FPGA MCU和嵌入式微处理器
引言
随着半导体技术的发展,深亚微米工艺加工技术允许开发上百万门级的单芯片，已能够将系统级设计集成到单个芯片中即实现片上系统SoC。IP核的复用是SoC设计的关键，但困难在于缺乏IP核与系统的接口标准，因此，开发统一的IP核接口标准对提高IP核的复用意义重大。本文简单介绍IP核概念，然后从接口标准的角度讨论在SoC设计中提高IP核的复用度，从而简化系统设计和验证的方法，主要讨论OCP(开放核协议)。
OCP简介
基于IP核复用技术的SoC设计使芯片的设计从以硬件为中心转向以软件为中心，
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由于片上系统(SoC)设计变得越来越复杂，验证面临着巨大的挑战。大型团队不断利用更多资源来寻求最高效的方法，从而将新的方法学与验证整合在一起，并最终将设计与验证整合在一起。虽然我们知道实现验证计划几乎占去了整个芯片设计工作的2/3，但是我们还是发现有团队迟交芯片，错过计划的流片最终期限。这种疏忽可能造成严重的商业后果，因为这意味着硬件和软件错误经常被遗漏，直到设计周期的晚期。 为了创建一个全面的验证解决方案，我们首先必须认识到设计工程师和验证工程师所面临的分歧和挑战。在这个过程中，我们发现某些
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嵌入式系统 单片机 SoC 复杂性 片上系统 SoC ASIC
线性稳压器通常被设计工程师作为辅助措施 ，并且经常被选用于产品开发的后期阶段。设计工程师比较关注的是如何使复杂的基频(BB) 或射频( RF )ASIC 发挥作用，而不是其所选线性稳压器的功率/性能。
线性稳压器的选择依据通常性能列表中的主要规格，而不是位于数据表封面以内的非常关键的核心和性能参数。规格经常很容易令人误解 — 封面上所列的规格只代表主要参数，但如果不与其他连接参数相结合时，便失去了价值。
例如，接地电流是这些参数中的一个。出现这
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模拟技术 电源技术 基频 射频 ASIC 模拟IC 电源
利用商业化IP来设计大规模的复杂系统是中国芯片设计业实现跨越式发展的一种机遇。 利用商业化IP(硅知识产权)来设计大规模的复杂系统是中国芯片设计业实现跨越式发展的一种机遇。原因有四点。 第一，IP核交易成为IC设计企业加快产品研发进程、提升产品质量的捷径；第二，IP重用技术前景广阔，受到IC设计企业的重视；第三，IP核已经成为IC设计企业的一种重要的知识产权；第四，我国拥有众多的代工厂，为推广国家IP核标准和复用提供了资源保证。 我
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引 言
循环码是最重要的一类线性分组纠错码，而BCH码又是目前发现的性能很好且应用广泛的循环码，它具有严格的代数理论，对它的理论研究也非常透彻。BCH码的实现途径有软件和硬件两种。软件实现方法灵活性强且较易实现，但硬件实现方法的工作速度快，在高数据速率和长帧应用场合时具有优势。FPGA(现场可编程门阵列)为DSP算法的硬件实现提供了很好的平台，但如果单独使用一片FPGA实现BCH编解码，对成本、功耗和交互速度都不利。最新的SoC(片上系统)设计方法可以很好地解决这个问题。
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原型验证---用软件的方法来发现硬件的问题
在芯片tap-out之前，通常都会计算一下风险，例如存在一些的严重错误可能性。通常要某个人签字来确认是否去生产。这是一个艰难的决定。ASIC的产品NRE的费用持续上升。一次失败的ASIC流片将会推迟数个月的上市时间。谁愿意承担签字的责任呢? 一些BUG通过仿真和Emulation是抓不到的。传统的验证方法认为设计的功能符合功能定义就是对的。 但功能定义到底对不对呢？唯一的办法就是建立一个真实的硬件：原型。
基于FPGA的原型 --- 一个虚拟
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Dust Networks公司在Electronica大会上发布了世上首个无线传感器网络系统级芯片(SoC)。Dust Networks在这张名为“智能尘埃”的芯片上集成了构建分配式传感器网络所需的所有硬件和软件功能，并表示它的功耗比Zigbee要低5倍，使系统不再需要路由器，而且使在现有网络上添加新传感器的总成本降低了10倍。 Dust Networks公司创始人之一，电气工程师Rob Conant说：“我们的ASIC的功耗比使用802.15.4无线电
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全球领先的设备软件优化（DSO）厂商风河系统公司日前宣布，Bluesocket通过采用Wind River Platform for Network Equipment, Linux Edition，显著加快了产品上市速度，并且能够更专注于其核心竞争力的提高。Wind River Platform for Network Equipment, Linux Editio
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Bluesocket Linux River Wind 单片机 嵌入式系统 SoC ASIC
asic ip核介绍
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