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dds-pll 文章 进入dds-pll技术社区

如何满足复杂系统的高性能时序需求

  •   时钟设备设计使用 I2C 可编程小数锁相环 (PLL),可满足高性能时序需求,这样可以产生零 PPM(百万分之一)合成误差的频率。高性能时钟 IC 具有多个时钟输出,用于驱动打印机、扫描仪和路由器等应用系统的子系统,例如处理器、FPGA、数据转换器等。此类复杂系统需要动态更新参考时钟的频率,以实现 PCIe 和以太网等其它诸多协议。  时钟 IC 属于 I2C 从器件,需要主控制器来
  • 关键字: I2C  PLL  

基于单片机和CPLD的DDS正交信号源

  • 基于单片机和CPLD的DDS正交信号源,其频率幅度可精密控制,扩展输出频率达300 kHz,增加扫频输出功能。采用红外键盘控制频率和幅度,采用液晶同步显示信号的频率和幅度;输出端产生正弦波、方波、三角波、锯齿波,梯形波、短形波、频率突变的方波、尖脉冲数字信号等,且具有扫频输出的功能。测试结果表明,系统稳定可靠,人机交互界面友好,操作简单方便。
  • 关键字: DDS  正交信号源  CPLD  滤波器  DT9205  AT28C64  

基于DSP+FPGA技术的高精度程控交流电源的实现

  • 介绍了一种基于DSP+FPGA芯片技术的高精度程控交流电源的实现方法,利用FPGA实现了任意波形发生功能,并对功率逆变等电路进行了详细的分析和设计,最后给出了实验结果以及相关波形。
  • 关键字: 任意波形发生  谐波  DDS  

基于FPGA的流水线结构DDS多功能信号发生器的设计与实现

  • 在应用FPGA进行DDS系统设计过程中,选择芯片的运行速度优化和资源利用优化常常是相互矛盾的,从发展趋势和运算要求看,系统速度指标的意义比面积指标更趋重要。基于此,介绍了一种流水线结构来优化传统的相位累加器,在QuartusⅡ开发环境下搭建系统模型、仿真及下载,并采用嵌入式逻辑分析仪分析和验证了实验结果。该系统可以完成多位频率控制字的累加,能够产生正弦波、方波和三角波,具有良好的实时性。
  • 关键字: 流水线相位累加器  DDS  FPGA  

基于FPGA和DDS技术的软件无线电可控数字调制器的设计

  • 本系统在分析数字调制技术和DDS原理的基础上,详述了一种基于FPGA的DSP技术和DDS技术的适合于软件无线电使用的可控数字调制器的设计过程,并在系统中进行了功能验证。此调制器以FPGA硬件平台为核心,可实现ASK,FSK,PSK,QAM等调制方式,灵活性强。
  • 关键字: 数字调制技术  软件无线电  DDS  

基于FPGA的双路可移相任意波形发生器

  • 本文论述了利用用FPGA来开发DDS函数发生器的总体设计思路,详细讨论了任意波形产生、频率精确调整、双路移相输出、PWM调制波产生、D/A转换与滤波电路、键盘与显示等诸方面软硬件实现方法。 整个设计
  • 关键字: DDS  任意波形发生器  FPGA  

基于ARM的DDS信号发生器人机交互系统设计

  • 本文以Hynix公司生产的HMS30C7202工业级处理器作为控制器,以矩阵键盘作为输入设备,以AMPIRE公司生产的AM-320240LTNQW-00H TFT LCD显示屏作为显示输出设备,研究设计了相应的硬件电路与显示驱动程序,在此基础上完成了人机交互中英文显示系统的设计。
  • 关键字: 信号源  DDS  LCD显示屏  

如何预测直接数字频率合成器(DDS)输出频谱中主相位截断杂散的频率和幅度

  • 现代直接数字频率合成器(DDS)通常利用累加器和数字频率调谐字(FTW)在累加器输出端产生周期性的N位数字斜坡(见图1)。 此数字斜坡可依据公式1定义DDS的输出频率(fO),其中fS为DDS采样速率(或系统时钟频率)。
  • 关键字: 直接数字频率合成器  DDS  FTW  

信号链基础知识#54 谁是音频时钟的“老板”,谁是主,谁又是从呢?

  • 如果转换器为一个 I2S 从器件,则您必须通过相同源(如果转换器带有,则可以依靠内部 PLL),提供所有三个 I2S 时钟(MCK、BCK 和 LRCK)。
  • 关键字: I2S  DSP  DAC  TI  MCK  SCK  PLL  BCK  LRCK  压控振荡器  VCO  音频  

幅频特性的测试愁白头?DDS技术解你烦忧

  • 最初,对于DUT的幅频特性的测试是在固定频率点上逐点进行。这种测试方法繁琐、费时,且不直观,有时还会得出片面的结果。例如,测量点之间的谐振现象和网络特性的突变点常常被漏掉。
  • 关键字: DDS  幅频特性  

遥测信号模拟源的设计及实现

  • 遥测信号模拟源是多通道信号发生器,模拟弹载组件,输出模拟及数字信号供遥测舱采集,以判断遥测舱是否正常。本设计基于DDS及数字可编程技术,采用DAC芯片AD5312、运放,RS422、429、LVDS等接口芯片,编写FPGA模块,最终实现多达100路模拟电压及40路数字信号输出,并可在计算机上通过网络进行参数配置。该信号源输出信号种类多,参数配置灵活方便,可满足多个遥测组件的测试需求。
  • 关键字: 遥测  信号源  DDS  AD5312  测试  201706  

如何根据数据表规格算出锁相环(PLL)中的相位噪声

  •   也许你也会跟我一样认为典型数据表中的某些规格难以理解,这是因为其中涵盖了一些你不太熟悉的隐含惯例。对许多RF系统工程师而言,其中一种规格便是锁相环(PLL)中的相位噪声。当信号源被用作本机振荡器(LO)或高速时钟时,相位噪声性能对满足系统要求起到了重要作用。最初从数据表中推断出该规格时似乎就像一个独立的项目。下面我来讲解一下如何通过读取PLL的相位噪声规格来对您的无线电或高速应用可达到的性能进行初步评估。  注意,PLL是一种控制回路,这种系统具备频率响应功能。参考路径中生成的噪声受控于回路中对系统输
  • 关键字: PLL  VCO  

PLL回路滤波器设计的调整指南

  •   假设您已经通过迭代信息传递相位边限和回路带宽在锁相环(PLL)上花费了一些时间。但遗憾地是,还是无法在相位噪声、杂散和锁定时间之间达成良好的平衡。感到泄气?想要放弃?等一下!你是否试过伽马优化参数?  伽马优化参数  伽马是一个数值大于零的变量。当伽马等于1时,相位边限在回路频处会达到最大值(图1)。很多回路滤波器设计方法把伽马值设为1,这是个很好的起点,但还有进一步优化的空间。  图1:伽马等于1时的波德图  伽马能够有效用于优化带内相位噪声,尤其是因压控振荡器 (VCO) 带来
  • 关键字: PLL  回路滤波器  

PLL回路滤波器设计的调整指南

  •   假设您已经通过迭代信息传递相位边限和回路带宽在锁相环(PLL)上花费了一些时间。但遗憾地是,还是无法在相位噪声、杂散和锁定时间之间达成良好的平衡。感到泄气?想要放弃?等一下!你是否试过伽马优化参数?  伽马优化参数  伽马是一个数值大于零的变量。当伽马等于1时,相位边限在回路频处会达到最大值(图1)。很多回路滤波器设计方法把伽马值设为1,这是个很好的起点,但还有进一步优化的空间。  图1:伽马等于1时的波德图  伽马能够有效用于优化带内相位噪声,尤其是因压控振荡器 (VCO) 带来
  • 关键字: PLL  滤波器  

DDS-11A型实验室电导率仪使用方法

  • 电导率仪是实验室电导率测量仪表,它能测定一般液体和高纯水的电导率电导率仪是食品厂、饮用水厂办理QS、HACCP认证的必备检验设备
  • 关键字: DDS-11A型实验室电导率  
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