∑-△ADC的降采样滤波器的设计与实现

作者：时间：2009-04-16来源：网络收藏

0 引言
过采样∑-△A／D转换器以其高精度和易于用标准数字CMOS工艺实现的特点而被广泛应用，并越来越多地集成到片上系统(SOC)中。∑-△ADC采用的是过采样和低位量化结合的方法，能够避免使用高精度模拟电路，将噪声推向高频，具有分辨率高、量化结构简单等优点。降采样滤波器作为过采样∑-△A／D转换器的重要组成部分，用于滤除基带信号带外噪声和降低抽样频率至临界抽样频率。目前国内∑-△ADC的研究主要集中在音频领域，带宽20 kHz。本文介绍了一种带宽150 kHz、16 bit∑-△模数转换器中的降采样滤波器的设计与实现。

1 ∑-△ADC的主要性能指标
信号与噪声加失真比(SINAD)是直流到奈奎斯特频段内，正弦波的RMS(均方根，表示交流信号的有效值或有效直流值)值与转换器噪声的RMS值之比，包括谐波成分。
信噪比(RSN)是直流到奈奎斯特频段内，正弦波的RMS值与转换器噪声的RMS值之比。
无杂散动态范围(SFDR)是RMS信号幅度与最大杂散频谱分量RMS值的比率。
总谐波失真(THD)是出现在输入频率整数倍频点(谐波)失真的RMS值与输入(或输出)正弦波的RMS值之比。
有效位数(ENOB)与SINAD的关系为

本文引用地址：http://www.eepw.com.cn/article/188975.htm

本设计要达到的性能指标是ENOB≥14 bit；SINAI)≥86 dB；SFDR≥92 dB；THD≤一90 dB；信号带宽为150 kHz；精度为16 bit。

2 调制器的系统设计
2．1 低阶∑-△调制器
调制器中的阶数即积分器的个数，一阶∑-△调制器的信噪比
RSN=6．02N+1．76―5．17+301g(OSR) (2)
式中：N为模拟调制器中量化器的位数；OSR为过采样比。式(2)表明，当OSR足够大时，在理论上也可获得相当好的量化信噪比。
2．2 高阶∑一△调制器
高阶∑-△调制器理想信噪比

式中n为调制器阶数。
但是在使用一位量化器情况下，环内滤波器增加到三阶以上时，工作情况会变得不稳定。
2．3 本设计中的∑一△调制器
本设计采用三阶∑-△调制器(n=3)，OSR为128，调制器的量化器用1 bit进行量化(N=1，降低模拟电路设计的难度)。由式(3)可得RSN=133．9 dB，满足16 bit精度要求。
设计要求带宽为150 kHz，而过采样率设为128，则理想情况下为
fs=150 kHz×2×128=38．4 MHz
考虑到系统设计和实现的非理想特性，本设计的采样频率定为50 MHz，经过128倍降采样后ADC的输出数据速率为390．625 kHz。
本系统设计在Matlab 7．0环境下采用Mathworks公司的Delta-Sigma Toolbox中提供的迭代逼近法实现满足要求的噪声传输函数，得到初始结构参数。并根据文献得到∑-△调制器的三阶CRFB系统实现模型，对该模型的性能分析可得其峰值信噪比达到113．2 dB，满足16 bit精度要求。

3 降采样滤波器的设计和系统仿真
本设计中的降采样滤波器由级联积分梳状滤波器、频率补偿滤波器和FIR半带滤波器级联组成。其中级联积分梳状滤波器实现多倍降采样，频率补偿滤波器针对多倍降采样后的通带下降进行补偿，而FIR型半带滤波器硬件结构非常简单并且适合实现D=2倍降采样，因此作为本降采样系统中的最后一级。
3．1 级联积分梳状滤波器
CIC滤波器是由积分模块与梳状滤波器模块组成的一种滤波器。Hogenauer提供了输入、输出比特数之间的关系，它们之间满足

本设计中CIC滤波器的降频倍数R为16，调制器输出一位量化的数据，Bin=1。而参考文献指出，CIC的级数要求大于调制器的阶数，因此本设计的级数N=4。由式(4)得Bout=17，满足精度要求。CIC滤波器的结构用Matlab 7．0中Simulink Library搭建，实现如图1所示。

3．2 频率补偿滤波器
CIC存在着通带下降的问题。观察CIC滤波器的幅频响应图发现f=150 kHz时，Magnitude=O．996 l，而本设计的ENOB要求达到14 bit，即误差应小于2-14，无法满足。因此，本设计引入了Sharpened CIC和ISOP两种补偿技术对CIC的通带下降进行补偿。
3．2．1 Sharpened CIC滤波器
参考文献提出的一种新的CIC结构是基于由J．Kaiser和R．Hamming提出对滤波器响应进行锐化的技术。这项新的技术尝试通过复用相同的滤波器来同时减小通带下降和提高阻带衰减。Sharpened CIC的结构框图如图2所示。