CMOS图像传感器集成A/D转换器技术的研究
随着半导体制造技术，多媒体技术的迅速发展，图像传感器作为数码相机，摄像头等图像获取设备的核心部件正在成为当前和未来研究的重点。按照类型来分图像传感器主要可以分为CCD型和CMOS型。CCD（Charged Coupled Device）技术由在贝尔实验室在1969年首先提出，至今已有25年的历史。它是利用一个特殊的VLSI工艺，在硅片表面上生成一个紧密压缩的多硅电极网格，通过光电效益收集电荷。在过去的20多年里，CCD 图像传感器以其高灵敏性低噪声和宽的动态范围的优点占领了图像传感器市场。但是随着CCD应用范围的扩大，其缺点逐渐显露出来，首先是CCD光敏单元阵列难与驱动电路及信号处理电路单片集成，不易处理一些模拟和数字功能，这些功能包括模数转换器、精密放大器、存储器、运算单元等元件的功能，其次CCD阵列驱动的脉冲复杂，需要使用相对高的工作电压，不能与深亚微米超大规模集成电路（VLSI）技术兼容，而且CCD功耗大的缺点严重限制了其在便携电子设备上的应用。MOS图像传感器的概念最早出现在20世纪60年代，但当时由于大规模集成电路工艺的限制未能进行研究。随着超大规模集成电路和微细加工技术的发展，最近人们已经成功将图像传感器，模数转换电路，图像处理电路等模块集成在一块CMOS图像传感器芯片上[1][2]，以达到低功耗，高性能，高集成度和高可靠性，并且大大降低系统成本和面积，CMOS图像传感器开始突破原来成像质量差的缺点，逐渐成为图像传感器领域的研究热点。 信息请登陆:输配电设备网
本文主要针对CMOS图像传感器上集成的模数转换器转换电路的主要类型及其特点和最新进展作一介绍。
2.集成A/D转换器的分类
任何A/D转换器都具有抽样、量化和编码的基本功能。抽样使模拟信号在时间上离散化使之变为抽样信号；量化则是将抽样信号的幅度离散化使之变成数字信号；编码是将数字信号最终表示成为数字系统所能接受的形式，如何实现这三个基本功能就决定了A/D转换器的结构和功能。按照对信号的处理方式上来分，A/D转换器可以分为并行处理A/D转换器和串行处理A/D转换器两大类。并行结构处理速度较快，结构较复杂，串行A/D转换器结构简单，处理速度较慢。如果根据量化编码方式的不同，可以分为采用Nyquist频率采样并均匀量化的PCM型A/D转换器和采用增量调制的过采样型A/D转换器。
CMOS图像传感器上使用的A/D转换器按照集成方式的不同可以分为三种主要类型，芯片级集成，列级集成和象素级集成。 信息来自:输配电设备网
2.1芯片级集成(Chip Level)
芯片级集成是整个传感器阵列使用一个高速A/D转换器。这种结构的优点是由于A/D转换器作为一个独立的单元放置在传感器阵列外，A/D转换器的面积不受很强的限制。缺点是由于A/D转换器的高转换速率会带来较大功耗，而且由于传感器阵列与A/D转换器单元之间数据传输的是模拟信号，不可避免会引入额外的噪声，影响整个系统性能。
2.1.1并行结构A/D转换器
并行结构A/D转换器主要由电阻分压器，比较器，编码器构成。它的工作原理是每一级都需要一个比较器和分压电阻，通过串联电阻来产生比较器的参考电压。比较器输出输入信号和参考电压的比较结果送到一个解码器解码后输出数字量。这种结构的主要优点是采样速度只受比较器速度的限制，因而采样速度快，是目前采样速度最高的A/D转换器。主要缺点是采用大量比较器，而且比较器的数目相对采样的精度呈指数增长，因而使芯片面积急剧增大，集成在CMOS图像传感器芯片中的精度在8位左右。1998年美国学者Loinaz，成功的将一个8位并行结构A/D转换器集成到图像传感器芯片中，工作在3.3v电压下，功耗为200mW。
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为了克服并行结构带来的比较器过多，面积过大的问题，人们从面积和速度上进行折中，提出了一种半并行结构A/D转换器。半并行结构由高位和低位不同精度并行结构A/D转换器重构为一个A/D转换器，从高位和低位分别输出。半并行结构虽然速度是并行结构的二分之一，但比较器的数目也减少到原来的一半。Smith等人的单片视频记录芯片里就采用了这种半并行结构的A/D转换器。
2.1.2流水线结构A/D转换器
流水线结构A/D转换器是流水线和半并行结构A/D转换器的结合。它通过流水线把整个采样过程分为若干级，每级由一个低精度半并行A/D转换器，一个D/A转换器和一个采样保持放大电路组成，每通过一级输出数字量，同时信号减掉输出数字信号经过DAC反馈回来的量送到下一级。这样每级采样1-2位，然后合起来一起并行输出。虽然这样采样速度受级数影响，需要经过若干时钟周期才能输出，但是由于采用了流水线结构，还是能达到很快的转换速度，同时有效的控制了面积和功耗。近年来，流水线结构A/D转换器被广泛应用在各种高速数据转换电路和CMOS图像传感器芯片中。
2.2列级集成(Column Level)
列级集成是使用半并行的A/D转换器，通过集成一个中低速A/D转换器的阵列，每个A/D转换器只完成对一行或者几行象素的转换来实现对整个图像传感器模数转换的功能。列级A/D转换器的主要优点是可以使用简单中低速的A/D转换器。缺点是会使芯片版图布局变的更复杂。
2.2.1逐次逼近型A/D转换器
逐次逼近型A/D转换器可以提供8位到18位，速度最快在5Msps左右的模数转换。它使用了一个比较器，一个采样保持电路，一个N位的DAC，一个N位的移位寄存器和一个SAR逻辑。这种结构利用数据不断通过环路逐次逼近的方法来达到所需要的精度。想要达到N位的精度就需要循环比较N个周期。这种循环利用结构的缺点是A/D转换器的采样速度较慢。优点是芯片面积小。这种类型A/D转换器的另一特点是电路的功耗随采样率成比例增加，而不像全并行和流水线类型A/D转换器的对应采样率有固定功耗。逐次比较型A/D转换器在R. Panicacci等人的图像传感器芯片中成功的列级集成，并且得到了很好的应用效果。
2.2.2单边积分型A/D转换器
单边积分型A/D转换器可以提供高精度的模数转换，并且具有很好的噪声抑制。单边A/D转换器的工作原理是一个未知输入电路电压VIN通过RC电路进行积分。积分结果VINT与已知参考电压VREF进行比较。已知积分后的电压VINT比输入的VIN电压和积分时间t成比例关系，即VINT/VIN和达到的积分时间成比例关系。所以可以根据TINT等于VREF所耗用的时间来确定VIN的大小。
这种结构A/D转换器的制约因素是 的精度和RC的精度。因此参考电压，电阻和电容微小的变换都会影响转换精度。设计中成功使用了单边积分型A/D转换器与芯片进列级集成。
2.2.3周期型A/D转换器
周期型A/D转换器在原理上类似流水线结构A/D转换器。它在结构上相当于流水线 A/D转换器中的一阶，通过多周期调用达到所需要的精度。工作原理是输入信号在读入控制信号上升时被读入电路，然后在A/D转换器电路中被采样，结果存入寄存器输出，再通过一个DAC后和原信号相减。剩余信号通过采样保持放大器，放大到原来大小，在反馈控制信号上升时进行下一次采样。这种周期性重复使用的结构降低了功耗，提供了中低速的模拟信号到数字信号的转换。1998年S. Decker[8]教授在ISSCC会议上发表了采用该种结构A/D转换器，采用0.8 工艺,5v电压，用于256×256象素的图像传感器芯片。
2. 2.3象素级集成(Pixel Level)
象素级集成的特点是采用每个光电检测器（Photodetector）或者几个光电检测器共用一个低速A/D转换器，大量低速A/D转换器并行工作达到一个高速A/D转换器的效果。象素级A/D转换器使得图像传感器中心与周边的通讯由模拟信号改变为数字信号，减少了原来模拟信号传输过程中信号的损失。象素级A/D转换器和象素传感器集成带来了图像传感器结构上的重复性，从而使图像传感器内部具有很多重复单元，因而具有可扩缩性。虽然象素级A/D转换器有着诸多优点，但是象素级A/D转换器由于集成在象素单元内，A/D转换器面积上受到填充率(fill factor)的限制，而且A/D转换器数目和传感器象素单元个数处在同一数量级上，所以象素级A/D转换器对功耗和面积的要求非常的苛刻，故而传统A/D转换器结构很难作为象素级A/D转换器与图像传感器集成。
图6就是一个使用了象素级A/D转换器的读出电路原理图，它由N×M的象素单元阵列，行解码器，高精度放大器和列地址解码/输出复选器组成。其中一个A/D转换器和多个光电检测器一起构成一个象素单元。
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