基于ARM＋FPGA的重构控制器设计, 可重构技术是指利用可重用的软硬件资源，根据不同的应用需求，灵活地改变自身体系结构的设计方法。常规SRAM工艺的FPGA都可以实现重构，利用硬件复用原理，本文设计的可重构控制器采用ARM核微控制器作为主控制器
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控制器 重构 设计 需求 不同 作为 FPGA 可以 灵活 系统
安富利公司 (NYSE: AVT) 旗下安富利电子元件亚洲 (Avnet Electronics Marketing Asia)与赛灵思公司 (NASDAQ: XLX) 日前宣布启动亚洲区X-fest 研讨会注册。X-fest 是深受 FPGA、DSP 和嵌入式系统开发人员欢迎的、为期一天的培训活动。
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赛灵思 FPGA X-fest
如今的无线设备中，线路板上一半以上的元件都是模拟RF器件，因此要缩小线路板面积和功耗一个有效方法就是进行更大规模RF集成，并向系统级芯片方向发展。本文介绍RF集成发展现状，并对其中一些问题提出应对方法和解决
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线路板 面积 功耗 解决方案 手机 减少 大规模 RF 集成
随着宽带通信系统和其它高性能RF技术不断发展，测量系统也必须与之保持同步。过去，频谱分析对于大多数一般性应用来讲己经足够，矢量分析只用于更为特殊的测量中，如国防和信号监视场合。但矢量分析对测量快速移动的
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有效 测量 进行 RF 矢量 分析 基于
引言在通信基础设施设备、雷达、RFID阅读器、测控、消费电子、医疗设备的RF信号链(图1)中，放大器(低噪声放大器LNA，中频放大器IFA，驱动放大器及增益模块)是重要的器件。ADI公司最新推出覆盖全部射频信号链的12个放
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设计 放大器 RF/IF 高性能
一、 引言射频仿真系统的子系统-天线阵列及馈电系统，主要用于模拟弹目间的视线角运动，为了保证天线阵列及馈电系统的角位置模拟精度，必须对天线阵列系统进行校准。所谓校准是指为阵列控制计算机所存贮的表格获得项
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应用 系统 仿真 RF 基于
基于FPGA技术的存储器设计及其应用,复杂可编程逻辑器件—FPGA技术在近几年的电子设计中应用越来越广泛。FPGA具有的硬件逻辑可编程性、大容量、高速、内嵌存储阵列等特点使其特别适合于高速数据采集、复杂控制逻辑、精确时序逻辑等场合的应用。而应
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及其 应用 设计 存储器 FPGA 技术 基于
基于FPGA的图像采集模块设计,1 引言 图像采集是图像处理的前提。图像采集卡是常用的图像输入设备，通常占用PC机总线的一个插槽。它主要包括图像存储器单元、CCD或CMOS摄像头接口、PC机总线接口等。传统的图像采集卡大多数采用 PCI接口，这种图
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模块 设计 采集 图像 FPGA 基于
摘要 基于FPGA、PCI9054、SDRAM和DDS设计了用于某遥测信号模拟源的专用板卡。PCI9054实现与上位机的数据交互，FPGA实现PCI本地接口转换、数据接收发送控制及DDS芯片的配置。通过WDM驱动程序设计及MFC交互界面设计，最
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数据通信 设计 高速 LVDS FPGA
FPGA的高速多通道数据采集控制器IP核设计,随着可编程逻辑器件的不断进步和发展，FPGA在嵌入式系统中发挥着越来越重要的作用。本文介绍的在电能质量监测系统中信号采集模块控制器的 IP核，是采用硬件描述语言来实现的。首先它是以ADS8364芯片为控制对象，结合
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IP 设计 控制器 数据采集 高速 通道 FPGA
采用FPGA解决通信接口问题,引言
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接口 问题 通信 解决 FPGA 采用
基于FPGA的中文字符显示的VHDL程序,--文件名：lcd_driver.vhd。 --功能：FGAD驱动LCD显示中文字符“年”。 --最后修改日期：2004.3.24。 library IEEE; use IEEE.STD_LOGIC_1164.ALL; use IEEE.STD_LOGIC_ARITH.ALL; use
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VHDL 程序 显示 字符 FPGA 中文 基于
用VHDL/VerilogHD语言开发PLD/FPGA的完整流程,用VHDL/VerilogHD语言开发PLD/FPGA的完整流程为： 1.文本编辑：用任何文本编辑器都可以进行，也可以用专用的HDL编辑环境。通常VHDL文件保存为.vhd文件，Verilog文件保存为.v文件 2.功能仿真：将文件调入HDL仿真
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完整 流程 PLD/FPGA 开发 语言 VHDL/VerilogHD
基于FPGA的LED电视动态背光系统设计,本文设计一款基于FPGA(现场可编程门阵列)的液晶电视动态背光系统，采用LED侧背光方式，符合当前液晶电视LED背光应用主流。 电视动态背光 以往的电视机主板将图像信号通过LVDS(LowVoltageDifferentialSignal，低
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背光 系统 设计 动态 电视 FPGA LED 基于
基于FPGA的IPV6数字包的分离与封装的实现,笔者在参加国家“863”重大专题项目“高速密码芯片及验证平台系统”的过程中，遇到了将IPV6数据包的包头和数据部分拆开，然后在数据部分送密码芯片进行加/解密处理，最后再将处理后的数据部分与
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封装 实现 分离 数字 FPGA IPV6 基于
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