- 在现代IC设计中，特别是在模块与外围芯片的通信设计中，多时钟域的情况不可避免。当数据从一个时钟域传递到另一个域，并且目标时钟域与源时钟域不相关时，这些域中的动作是不相关的，从而消除了同步操作的可能性，并使系统重复地进入亚稳定状态[1]。在有大量的数据需要进行跨时钟域传输且对数据传输速度要求比较高的场合，异步FIFO是一种简单、快捷的解决方案。
异步FIFO用一种时钟写入数据，而用另外一种时钟读出数据。读写指针的变化动作由不同的时钟产生。因此，对FIFO空或满的判断是跨时钟域的。如何根据异步的指针
- 关键字：
FIFO 异步 Verilog HDL IC 亚稳态
- 一.可移植性编码
1．只使用IEEE标准类型（VHDL）：（1）使用STD_LOGIC类型,而不是STD_ULOGIC类型；(2)设计中不要创建过多的的子类型；（3）不要使用BIT和BIT_VECTOR类型。
2．不使用立即数：在设计中，不要使用立即数（但作为例外，可使用0和1），推荐使用常量。使用常量有以下优点：（1）常量对于一个设计具有更多的灵活性；（2）常量值只需要在一个地方修改；（3）编译器可能只支持常量类型，不支持立即数。
3．对于VHDL程序，把常数和参数定义在由1个或多个文件组成的程序
- 关键字：
HDL 设计 可编程
- 1.引言
随着集成电路复杂度越来越高，测试开销在电路和系统总开销中所占的比例不断上升，测试方法的研究显得非常突出。目前在测试源的划分上可以采用内建自测试或片外测试。内建自测试把测试源和被测电路都集成在芯片的内部，对于目前SOC级的芯片测试如果采用内建自测试则付出的硬件面积开销则是很大的，同时也增加了芯片设计的难度：因此片外测试便成为目前被普遍看好的方法。由于FPGA具有可重构的灵活性，利用FPGA来作为测试源实现片外测试就是一种非常有效的手段。
由于伪随机模式测试只需要有限个数的输入向量便
- 关键字：
嵌入式系统 单片机 FPGA 序列生成器 Verilog HDL MCU和嵌入式微处理器
- 摘 要：本论文介绍视频编解码IP核在SOPC中的设计，用Verliog HDL实现其各个功能子模块，全部调试仿真通过合并成一个模块，实现了视频信号的采集，分配，存储以及色度空间的转换。整个模块都通过仿真实现与验证，很好的达到了系统的要求。关键字：SOPC；视频编解码；IP核；Verilog HDL 引言 基于Nios II软核的SOPC是Altera公司提出的片上可编程系统解决方案，它将CPU、存储器、I/O接口、DSP模块以及锁相环的系统设
- 关键字：
嵌入式系统 单片机 SOPC 频编解码 SOPC 视频编解码 IP核 Verilog HDL
- 引言：数字滤波器是语音与图像处理、模式识别、雷达信号处理、频谱分析等应用中的一种基本的处理部件，它能满足波器对幅度和相位特性的严格要求，避免模拟滤波器所无法克服的电压漂移、温度漂移和噪声等问题。有限冲激响应(FIR)滤波器能在设计任意幅频特性的同时保证严格的线性相位特性。
一、FIR数字滤波器
FIR滤波器用当前和过去输入样值的加权和来形成它的输出，如下所示的前馈差分方程所描述的。
FIR滤波器又称为移动均值滤波器，因为任何时间点的输出均依赖于包含有最新的M个输入样值的一个窗。
- 关键字：
嵌入式系统 单片机 Verilog HDL FIR 数字滤波器 嵌入式
- 第一部分：说明
1.准则的重要程度分三个层次：
好的经验 -- 表明这条规则是一般情况下比较好的经验，在大多数的情况下要遵循,在特殊情况下可以突破这一规则。
推荐 -- 推荐这一规则，在遵循这一规则的条件下，一般不会出现问题；
强烈推荐 -- 表示严格规定，除非出现特别特殊的情况，否则要严格遵守。
2．斜体部分一般表明不按照规则执行，会出现的问题和现象，或一些相关注释。
3．版本及修订工作
姓名 徐欣，孙广富
修订 规范的最初发布
日期 2002-6-30
- 关键字：
HDL 编码风格 编码指南 嵌入式
- 从数字系统设计的性质出发，结合目前迅速发展的芯片系统，比较、研究各种硬件描述语言。
- 关键字：
HDL 硬件描述语言 发展
hdl介绍
HDL(Hardware Description Language)，是硬件描述语言。顾名思义，硬件描述语言就是指对硬件电路进行行为描述、寄存器传输描述或者结构化描述的一种新兴语言。
主流的HDL分为VHDL和Verilog HDL。VHDL诞生于1982年。在1987年底，VHDL被IEEE和美国国防部确认为标准硬件描述语言。自IEEE公布了VHDL的标准版本，IEEE- 1076（简称 [
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