海思半导体公司日前推出硬件加密8位微控制器Hi9102E321X V1.0，内置64K ROM及32K EEPROM，据称是提供高效、高安全性及低功耗特性，适用于SIM卡、UIM卡、社保卡、付费电视卡、银行卡、加油卡、校园卡等应用。 该微控制器CPU与标准的8051完全兼容，外部时钟频率支持1MHz～5MHz，大多数指令在一个时钟周期完成，并提供内部时钟倍频器，支持1x、2x、4x倍频。内置的EEPROM具有50万次的擦写能力，其中的数据可以保存10年时间，EEPRO
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IC卡 MCU 半导体 海思
结合采用低功耗元件和低功耗设计技术在目前比以往任何时候都更有价值。随着元件集成更多功能，并越来越小型化，对低功耗的要求持续增长。当把可编程逻辑器件用于低功耗应用时，限制设计的低功耗非常重要。本文将讨论减小动态和静态功耗的各种方法，并且给出一些例子说明如何使功耗最小化。 功耗的三个主要来源是启动、待机和动态功耗。器件上电时产生的相关电流即是启动电流；待机功耗又称作静态功耗，是电源开启但I/O上没有开关活动时器件的功耗；动态功耗是指器件正常工作时的功耗。 启动电流因器件而异
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FPGA 嵌入式 消费电子
介绍了SDRAM的特点和工作原理，提出了一种基于FPGA的SDRAM控制器的设计方法，使用该方法实现的控制器可非常方便地对SDRAM进行控制。
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Verilog SDRAM FPGA 控制器
高效、低成本及可靠的电池充电器设计可用各种方法来实现，但采用8 位闪速MCU 不仅能缩短设计时间、降低成本及提供安全可靠的产品，而且还能使设计人员以最少的工作量来进行现场升级。考虑到电池安全充电的成本、设计效率及重要性，基于MCU 的解决方案可为设计者们提供诸多优势。通过选择带适当外围与闪存的8 位MCU，工程师们能充分利用其优势来设计一种离线锂电池充电器。带2KB 闪存及适当外围以提供一种廉价解决方案的飞利浦 80C51 型MCU 就是这样一个例子。集成化闪存还能提供高效及方便地调试应用代码并进行现
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MCU 电源
毫米波多目标信号发生器通过模拟的方法产生多种类型高精度的雷达多目标回波信号，在实际雷达系统前端不具备的条件下对雷达系统后级进行调试，便于制导武器的性能测试，大大加快新武器的研制进程。毫米波多目标信号产生的关键是要求回波信号距离分辨率极高，常规的多目标信号产生方法如使用数字延时线产生多目标之间的延时，其控制不灵活，并且有些延时线需要接ECL电源，使用不方便也增加了设计的复杂度。使用分立元件实现延时则使电路元件过多，电路的稳定性及延时的精确性也会大大降低。本文介绍一种新的产生毫米波雷达模拟器的多目标信号的方法
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FPGA
本文讨论的四种常用FPGA/CPLD设计思想与技巧：乒乓操作、串并转换、流水线操作、数据接口同步化，都是FPGA/CPLD 逻辑设计的内在规律的体现，合理地采用这些设计思想能在FPGA/CPLD设计工作种取得事半功倍的效果。
FPGA/CPLD的设计思想与技巧是一个非常大的话题，由于篇幅所限，本文仅介绍一些常用的设计思想与技巧，包括乒乓球操作、串并转换、流水线操作和数据接口的同步方法。希望本文能引起工程师们的注意，如果能有意识地利用这些原则指导日后的设计工作，将取得事半功倍的效果！
乒乓操作
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FPGA 嵌入式
利用FPGA 实现大型设计时，可能需要FPGA 具有以多个时钟运行的多重数据通路，这种多时钟FPGA 设计必须特别小心，需要注意最大时钟速率、抖动、最大时钟数、异步时钟设计和时钟/数据关系。设计过程中最重要的一步是确定要用多少个不同的时钟，以及如何进行布线，本文将对这些设计策略深入阐述。
FPGA 设计的第一步是决定需要什么样的时钟速率，设计中最快的时钟将确定FPGA 必须能处理的时钟速率。最快时钟速率由设计中两个触发器之间一个信号的传输时间P 来决定，如果P 大于时钟周期T，则当信号在一个触发
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FPGA 嵌入式
算术编码是一种无失真的编码方法，能有效地压缩信源冗余度，属于熵编码的一种。算术编码的一个重要特点就是可以按分数比特逼近信源熵，突破了Haffman编码每个符号只不过能按整数个比特逼近信源熵的限制。对信源进行算术编码，往往需要两个过程，第一个过程是建立信源概率表，第二个过程是对信源发出的符号序列进行扫描编码。而自适应算术编码在对符号序列进行扫描的过程中，可一次完成上述两个过程，即根据恰当的概率估计模型和当前符号序列中各符号出现的频率，自适应地调整各符号的概率估计值，同时完成编码。尽管从编码效率上看不如已
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FPGA 嵌入式
设计了一种基于ＦＰＧＡ的ＨＤＬＣ协议控制系统?该系统可有效利用ＦＰＧＡ片内硬件资源，无需外围电路，高度集成且操作简单。重点对协议的ＣＲＣ校验及“０”比特插入模块进行了介绍，给出了相应的ＶＨＤＬ代码及功能仿真波形图。
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HDLC FPGA 控制协议
提出了一种基于FPGA和USB的高速数据传输、记录及显示系统的设计方案，并对其中的低电压差分信号（LVDS）传输方式、FPGA功能模块以及USB传输模块等进行了介绍。
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FPGA USB 高速数据传输 记录
介绍了应用ＦＰＧＡ技术进行帧同步器设计的实现原理、系统框图及设计中需要注意的问题，给出了用ＶＨＤＬ描述的几个模块的源代码。
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FPGA 数字复接 系统 帧同步器
基于C的设计方式简化FPGA/协处理器混合平台软硬件协同设计
在最近几年中日益流行在高性能嵌入式应用中使用现场可编程门阵列（FPGA）。FPGA已经被证明有能力处理各种不同的任务，从相对简单的控制功能到更加复杂的算法操作。虽然FPGA在某些功能上比设计专用ASIC硬件具有时间和成本上的优势，但在面向软件应用中FPGA比传统处理器和DSP的优势并没有体现出来。这很大程度上是由于过去割裂了硬件和软件开发工具和方法之间的关系。 然而最近FPGA在面向软件设计工具方面的发展，及器件容量的持续增
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FPGA/协处理器
为什么8位MCU依然活跃在当今市场上？ ZiLOG 董事长兼首席执行官 James Thorburn自20世纪70年代早期面世以来，8位微控制器（MCU）已成为电子行业广为应用的器件。但是，技术进步通常有这样的规律：一旦有更先进的技术出现，旧技术就要让位给新技术。尽管更复杂、更强大的16和32位器件出现，并且这些器件也带来了性能优势，但8位MCU市场却继续壮大。Semico公司的研究数据预测，8位MCU市场的全球总价值将从2002年的不足40亿美元攀升到20
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MCU
8位MCU的新变化
上期（5月上半月P108）介绍了以32位微处理器为主的高性能处理器的发展动向。谈到一些权威调查机构认为8位MCU的发展速度已趋于平缓，8位MCU的总营收甚至还有所下降。因此，许多处理器厂商勇于向高位攀登。
但是，仁者见仁，智者见智，8位MCU的市场总量毕竟还是很可观的，很多8位MCU厂商对此领域仍痴心不改，不断地革新自己的产品，以适应当今网络、无线时代的主旋律；同时，还有一些高端MCU厂商加盟到8位大家庭来。
笔者最近的采访中可看出，当今的8位MCU往往突出有闪存功能
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MCU 嵌入式
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