- 电子产品世界,为电子工程师提供全面的电子产品信息和行业解决方案,是电子工程师的技术中心和交流中心,是电子产品的市场中心,EEPW 20年的品牌历史,是电子工程师的网络家园
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DSP FPGA 超高速跳频
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DSP FPGA 卫星测控 多波束系统
- 基于IP核及可重构设计的信息安全SoC芯片的实现,当前,信息安全防护已经从传统的单点信息加密发展到了以芯片级硬件防护为基础,构建覆盖全网络系统的信息保障体系。基于芯片级的硬件解决方案已经成为保证信息安全的最可靠的途径。可重构信息安全SoC芯片是基于信息安全
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SoC 芯片 实现 安全 信息 IP 重构 设计 基于
- 高性能系统设计师在满足关键时序余量的同时要力争获得更高性能，而存储器接口设计则是一项艰巨挑战。双倍...
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FPGA 高端存储器接口
- 网络正在成为当今社会通信的骨干力量，网络监控的研究需求日益迫切。本文介绍了多路网络数据采集卡系统设计与实现，以Xilinx Spartan 6系列FPGA为平台，采集8路10/100M网络数据，引入队列管理机制和乒乓原理后，通过PCIe接口发送到PC机做分析。最后通过实际测试，验证了该卡的正确性。
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xilinx FPGA Spartan-6 201112
- 全球可编程平台领导厂商赛灵思公司，将在 2012 年国际消费电子展 (CES) 上演示专门针对汽车内高速数据流量传输进行优化的全球首款现场可编程门阵列 (FPGA)以太网音视频桥接 (EAVB) 网络方案。随着消费者对驾驶员辅助、导航和乘客娱乐系统的高分辨率显示和图形质量需求不断提升，车内内容传输技术也面临着日益严峻的挑战。此次演示将重点介绍赛灵思与其联盟计划成员数字设计公司 (DDC) 共同开发的全新 EAVB 开发套件的功能——可为汽车系统开发人员提供加速其应用开发所需的构架和工具，帮助他们为驾驶员和
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赛灵思 EAVB FPGA
- 全球可编程平台领导厂商赛灵思公司 (Xilinx, Inc. (NASDAQ:XLNX) )今天宣布推出基于 28 nm Kintex™-7 FPGA 的全新目标参考设计和全新开发基板，以加速新一代 3D 和 4K2K 显示技术的开发，旨在为消费者带来更加丰富的沉浸式体验。在全球最大的消费电子展会 2012 国际消费电子展(CES)上，参会人员可莅临赛灵思 MP25556 号展台，观看这些与高级赛灵思联盟计划成员东京电子器件有限公司(Tokyo Electron Device Ltd. (TED) )联合
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Xilinx FPGA Kintex-7
- 使用NI公司的产品，我们可以使用一套软硬件解决方案，轻而易举地测试不同的微控制器外设。我们使用NI的产品，通过向自动化框架提供易用的接口，使我们的测试系统自动化，这样节省了大量的精力和成本。ndash; Zalm
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LabVIEW FPGA 自动化 微控制器
- 摘要：介绍了一种交通信号灯控制电路的功能及其设计方案，给出了具体电路的逻辑设计结果，并通过QuartusII 5.0软 ...
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交通灯控制 FPGA 定时 译码
- 摘要：利用FPGA与单片机相结合的方法，使用单片机控制FPGA产生频率为10Hz~20kHz的正弦波，锯齿波，三角波和四路分别 ...
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FPGA 单片机 VHDL DDS
- FPGA中的处理器概述,可编程逻辑业对微处理器核的报道层出不穷，包括与ARM和MIPS的协议，这些讨论已经持续了数年。然而，讨论的主题大体上没什么改变，诸如采用硬核还是软核?采用供应商的特定标准还是行业标准?这些核如何用来全方位地支持
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概述 处理器 FPGA
- FPGA 解决方案和标准控制器内核比较, MicroBlaze处理器是赛灵思(Xilinx)在嵌入式开发套件 (EDK) 中提供的两款32位内核之一，是实现硬件加速的灵活工具。图1是MicroBlaze的典型设计。该内核含有一个32位乘法器，但不含浮点单元(FPU)、桶式移位器或专用硬
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内核 比较 控制器 标准 解决方案 FPGA
- 基于Xilinx FPGA的嵌入式Linux操作系统解决方案设计,FPGA是通过逻辑组合电路来实现各种功能的器件。由于FPGA内部集成了大量的逻辑资源和可配置的I/O引脚，加上独特的并行处理架构，可以轻松实现同时对多个外部设备的配置和管理，以及内外各种接口数据的传输。现在开发厂
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操作系统 解决 方案设计 Linux 嵌入式 Xilinx FPGA 基于
- USB2.0主机控制器IP核的设计,摘要 ：为了摆脱对USB2.0 主机控制器ASIC 芯片的依赖，提高产品集成度，本文设计了针对全速和高速USB 海量存储设备的USB2.0 主机控制器IP 核。首先介绍USB2.0 主机控制器IP核中主要涉及的USB2.0 通信协议以及与物理层
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设计 IP 控制器 主机 USB2.0
- 1 引言 基于FPGA的数字系统设计中大都推荐采用同步时序的设计，也就是单时钟系统。但是实际的工程中，纯粹单时钟系统设计的情况很少，特别是设计模块与外围芯片的通信中，跨时钟域的情况经常不可避免。如果对跨
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FPGA 异步时钟 策略
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