2008年，获得TI授予的“07年度亚太区最大的DSP分销商”殊荣。
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SEED DSP
为了在DSP平台上实现实时大图像旋转，结合TMS320DM642的性能结构特点,针对旋转算法中严重影响DSP CPU效率发挥的大量非连续图像像素地址访问的问题，提出了基于视口图像块覆盖的DSP图像旋转算法数据调度策略，对算法的结构流程进行了优化调整。
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数据 调度 策略 算法 旋转 DSP 图像 基于
TMS320C6000系列DSP的多通道缓冲串口McBSP是一个同步串口，因此不能与通用异步接收/发送器直接连接。但是，通过对DSP相关控制寄存器的简单调整，在软件控制下，UART与TMS320C6000之间的通信成为可能，该通信功能的实现也是所设计的串口加载系统的难点和重点。本论文对此串口加载系统硬件接口和必要的软件部分做了详细介绍，该系统硬件结构简单、通信线少、高速可靠，已经在实际运用中取得了良好效果。
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加载 实现 程序 DSP 计算机 串口 基于
本文以FPGA为控制单元，完成了AD1836中D/A部分的I2S接口设计，它在数字音频系统的设计中有一定的参考和实用价值。该设计已经成功运用在某话路特性综合测试系统中，性能良好。
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FPGA 1836 I2S AD
进一步展示其FPGA灵活性和通用性，Altera公司宣布，XLoom通信公司采用Stratix® II GX FPGA信号完整性开发套件来提供独特的误码率(BER)测试环境。和传统的BER测试设备相比，Altera基于FPGA的开发板支持XLoom以更高的性价比来测试芯片级光电互联模块。这一独特的测试环境更贴近实际的客户状态，同时进一步节省了空间，降低了功耗。
传统的BER测试仪成本高达100,000美元，而Stratix II GX FPGA信号完整性开发套件在这方面的成本节省了90％
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Altera FPGA 开发套件 XLoom
介绍了最新视频压缩标准H.264，并实现了适合TI C6416 DSP内核的H.264视频解码器算法，在NVDK C6416板卡上进行测试，达到了实时的解码效果。该优化算法，结合DSP处理平台和网络技术，构成新的多媒体通信终端设备，具有广泛的应用前景。
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DSP 实现 C6416 解码器 视频 H.264
1、乘法器的介绍
乘法器是多媒体芯片和DSP芯片中的核心部件之一，它决定着芯片的性能表现和面积大小。为了提高处理速度，并行乘法器通常需要增加面积和架构上的复杂度来实现。过去，有很多的学者提出不同的乘法器架构来减小芯片的面积和提高乘法运算的速度。本文所提出的定宽截断式并行乘法器架构，可大大减小乘法器的面积，对乘法器的整体性能却无太大影响。这种乘法器主要应用于多媒体和DSP芯片的定宽乘法操作中。
2、截断乘法器的设计实现
定宽乘法器可以直接由传统的并行乘法器截去一半的半加
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DSP 乘法器 多媒体芯片 定宽
1、引言
阿尔法磁谱仪(Alpha Magnetic Spectrometer，AMS)实验室是丁肇中博士领导的由美、俄、德、法、中等16个国家和地区共300多名科学家参加的大型国际合作项目。它是国际空间站上唯一大型物理实验，是人类第一次在太空中精密地测量高能量带电原子核粒子的实验。其目的是为寻找反物质所组成的宇宙和暗物质的来源以及测量宇宙线的来源。
但是对于AMS实验的空间电子系统，同样会受到高能粒子的袭击，导致存储器的内容发生变化，改写半导体存储器件的逻辑状态，导致存储单元在逻辑&ls
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FPGA 存储器 AMS 编码 译码
TMS320C62X是美国德州仪器公司(TI)的新一代高性能定点数字信号处理器(DSP)芯片。基于DSP的软件设计问题,就是采用编程语言进行算法实现并使程序效率尽量满足实时性要求。TI DSP的软件设计可以采用汇编语言、高级语言(C/C++)以及C语言与汇编语言的混合编程。完全采用汇编语言编程复杂性高、开发周期长,而完全采用C语言编程则程序的执行效率相对较低,不能满足实时性的要求。为了设计出性价比最好、开发周期较短、比较复杂的DSP系统,可以采用混合语言编程,把C语言和汇编语言的优点有效地结合起来。C
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DSP TI 混合编程 C语言 汇编
随着对信号处理要求的不断提高以及DSP技术的不断发展,越来越多的工程技术人员开始采用DSP进行系统设计。美国TI公司的TMS320VC5402(以下简称VC5402)DSP具有运算速度快、功耗小和性价比高的特点,已在个人移动通信、信号与信息处理以及自动控制等领域得到了广泛的应用。该芯片提供了两个多通道缓冲串行接口(McBSP)与外部设备进行通信。它与串行A/D变换器构成的信号采集与处理系统具有硬件设计简单、可靠性好的特点。本文将详细阐述VC5402与AD73360的接口设计。
1 VC5402的
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DSP TMS320VC5402 串行接口 A/D
Actel公司宣布其Libero® 集成开发环境 （IDE） 增添全新的功耗优化和增强的设计创建功能。全新的Libero IDE 8.4针对基于 Flash的IGLOO®、IGLOO PLUS和 ProASIC®3L现场可编程门阵列 （FPGA），提供由1.14V至 1.575V的FPGA内核工作电压范围，为设计人员提供额外的内核电压选择，以实现更低的功耗。新版本Libero IDE改进了SmartPower功耗分析工具，便于比较同一设计的多种设计实现和器件不同工作条件下的状况
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Actel IDE Libero FPGA 集成开发环境
电子产品世界,为电子工程师提供全面的电子产品信息和行业解决方案,是电子工程师的技术中心和交流中心,是电子产品的市场中心,EEPW 20年的品牌历史,是电子工程师的网络家园
关键字：
DSP TI 混合编程 C语言 汇编
1. 引言
在摩尔定律的推动下，半导体行业技术发展非常迅速，集成电路晶体管数量每两年翻倍，对器件或者系统之间的通信链路数据速率要求越来越高。而工艺节点的减小又促进了摩尔定律。减小体积可以在单位逻辑中容纳更多的功能，提高工作速率、逻辑密度和集成度，同时降低了。通常采用高级设计方法和工艺技术来提高数据速率，支持固网和无线通信、计算机、存储、军事应用以及广播电子系统发送接收大量数据，以满足不断增长的数据传输和带宽要求。
微处理器和FPGA等前沿产品采用了65-nm工艺技术。这些产品的后续型号将采
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半导体 FPGA 微处理器 I/O
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