AVR AT90S1200 IP核设计及其复用技术

　　下面具体描述FSPLCSOC的验证，SOC设计中包含了系统设计和模块设计，因此SOC验证一般包含了模块验证、芯片验证和系统验证三个部分。由于FSPLCSOC涉及到的主要是数字IP核，文中采用Altera NioslI开发板作为设计的验证平台，该开发板带有一个20多万门的Altera EP20K200EFC484-2的FPGA芯片、拨码开关、数码显示器等，用一个实际PLC应用程序在此开发板上对FSPLCSOC进行了可行性验证，同时通过对AVR编译器Avral。0的编译代码变量中增加PLC指令代码，使之能够对PL(:指令进行编译。图5，图6分别为PLC控制程序的梯形图及其汇编程序。

图5 PLC控制程序的梯形图

　　开发板的拨码开关SWl的1、2、3、4来模拟上述开关的闭合，观察数码显示器Dl数码段明暗，验证设计的可行性。FSPLCSOC在Altera Nios开发板的FPGA芯片上进行了可行性验证，获得了理想的运行效果:在33MHz晶振下，执行基本逻辑指令速度为0。09μ/条，达到了国际上大中型PLC的处理速度。

图6 PSPLC汇编程序

　　5 结束语

　　目前IC产业中，SOC已成为最主要的集成电路设计方法8位RISC微处理器芯片设计正在向SOC化发展，通过IP核复用方法以缩短周期、降低成本、提高效率。文中基于IP核复用和SOC技术借助ModelSim、Synplify Pro、QuartusⅡ等EDA软件设计了拥有自主知识产权的专用PLC微处理器SOC模块FSPLC，在复用了第三方AVRAT90SI200IP核基础上集成了自行设计的LP、BP、MBI、CBI、BBI等模块，具有快速处理PLC梯形图程序、快速处理IL语句表中复杂的嵌套逻辑运算、PLC之间CAN总线通讯等优点。最后采用Altera NiosII作为验证平台，对实际的PLC应用程序做了可行性验证，获得了理想的效果。