PCI总线智能GJB289A仿真卡设计 作者： 时间：2010-12-24 来源：网络 加入技术交流群 扫码加入和技术大咖面对面交流海量资料库查询 收藏 <a href='https://ad.eepw.com.cn/www/delivery/ck.php?n=a635e61e&cb=INSERT_RANDOM_NUMBER_HERE' target='_blank'><img src='https://ad.eepw.com.cn/www/delivery/avw.php?zoneid=88&cb=INSERT_RANDOM_NUMBER_HERE&n=a635e61e' border='0' alt='' /></a> <a href='https://ad.eepw.com.cn/www/delivery/ck.php?n=a576c0a2&cb=INSERT_RANDOM_NUMBER_HERE' target='_blank'><img src='https://ad.eepw.com.cn/www/delivery/avw.php?zoneid=87&cb=INSERT_RANDOM_NUMBER_HERE&n=a576c0a2' border='0' alt='' /></a> FPGA逻辑包括曼彻斯特编解码单元、协议处理模块、数据缓冲FIFO、寄存器控制等。逻辑框图如图1所示。发送数据时将已有的并行数据在系统的控制下，经过并／串转换，转换为并行的曼彻斯特编码，依次以符合1553B协议的消息的方式发出。在BC或者RT模式下接收数据时，模拟收发器接收曼彻斯特Ⅱ编码的串行数据，通过曼彻斯特解码器实现同步时钟的提取，同步头检出，数据检出，曼彻斯特Ⅱ码错误检出，奇偶校验，位／字计数以及数据的串／并转换功能。 上一页 1 2 3 4 下一页
加入技术交流群
评论