片上系统（SOC）设计与EDA

利用EDA工具和硬件描述语言（HDL），根据产品的特定要求设计性能价格比高的片上系统，是目前国际上广泛使用的方法。与传统的设计方法不同，在设计开始阶段并不一定需要具体的单片微控制器（MCU）和开发系统(仿真器)以及带有外围电路的线路板来进行调试，所需要的只是由集成电路制造厂家提供的用HDL描述的MCU核和各种外围器件的HDL模块。设计人员在EDA工具提供的虚拟环境下，不但可以编写和调试汇编程序，也可以用HDL设计、仿真和调试具有自己特色的快速算法电路和接口，并通过综合和布线工具自动转换为电路结构，与制造厂家的单元库、宏库及硬核对应起来，通过仿真验证后，即可投片制成专用的片上系统（SOC)集成电路。

一、 芯片设计和制造是电子工业发展的基础

近10年来我国的电子工业取得了很大的进步，无论在消费类产品如电视、录像机还是在通信类产品如电话、网络设备方面，产品的档次和产量都有快速的提高。但这些产品的核心部件——芯片，大多需要进口，每年需要花费大量外汇来购买。许多产品技术档次的提高也受制于芯片。由于高档产品使用的新芯片价格昂贵，研制能在国际高档产品市场竞争的电子产品和设备非常困难。我国目前能在国际市场上竞争的电子产品大多数还是中低档的。由于核心芯片大多需要进口，因此利润非常低，主要依靠我国相对较廉价的劳动力才能在市场中生存。

在21世纪的头5年中，如果我们还不能掌握核心芯片的设计和制造技术，电子工业很难在20年内赶上国际先进水平。核心芯片的设计是高级技术，但并非每一种核心芯片都是非常难设计和制造的，大多数中低档电子产品中的片上系统SOC(System on Chip)并不复杂。目前，我国许多电子工程师已掌握了传统的微控制器系统开发手段:编写汇编程序，利用开发系统进行仿真来调试汇编程序和接口信号。在这一基础上，如果掌握一些常用的EDA工具，了解复杂数字系统的设计思路并能主动深入地学习HDL语言，不但能设计出具有自己知识产权的微控制器和线路板，甚至能设计出几万门甚至几百万门的专用数字信号处理芯片和片上系统。

二、 掌握HDL是利用EDA工具--开发片上系统的敲门砖

由于设计的复杂性，必须有一种语言能在各个层面上精确地为各种电路行为和结构建立模型，以便在计算机上对设计是否正确进行仿真。HDL特别是Verilog HDL得到在第一线工作的设计工程师的特别青睐，不仅因为HDL与C语言很相似，学习和掌握它并不困难，更重要的是它在复杂的SOC的设计上所显示的非凡性能和可扩展能力。在数字系统设计的仿真领域，HDL早在10多年前就已得到全世界数字系统设计工程师的广泛承认，是目前世界上应用最普及的硬件描述语言。特别是近年来在数字系统自动综合方面也已显示出它旺盛的生命力。Verilog HDL还支持模拟电路的设计。Open Verilog International(以下简称OVI)组织，最近已公布Verilog-AMS语言参考手册（Language Refe-rence Manual，以下简称LRM）的草案，在这个草案里定义了这种可用于模拟和数字混合信号系统设计的硬件描述语言。 Verilog-AMS硬件描述语言是符合IEEE 1364标准的Verilog HDL的1个子集。它覆盖了由OVI组织建议的Verilog HDL的定义和语义，目的是让数模混合信号集成电路的设计者，既能用结构描述又能用高级行为描述来创建和使用模块。所以，用Verilog HDL语言可以使设计者在整个设计过程的不同阶段（从结构方案的分析比较，直到物理器件的实现），均能使用不同级别的抽象。目前，在许多软件公司的努力下，许多模型的开发工具正在出现，这必将大大加快模型的开发过程。他们提供了模拟电路模型的开发工具，如电路分析工具、行为建模工具、设计优化工具和设计自动化工具。有的工具能生成电路部件的行为模型，这种行为模型可用于电路的仿真。有联想能力的读者和电子工程师们，通过诸如手机、商务通等新电子产品的不断涌现，不难想像它们确实是设计方法革命性变革的产物。

三、 SOC的设计宜先从数字系统 开始逐步过渡到数模混合系统

由于数字系统的基本部件比较简单,无非是一些与门、或门、非门、触发器、多路器等，宏器件无非是一些加法器、乘法器等。设计数字系统的EDA工具也比较容易免费得到,一些简单的CPU核也可以在网上免费得到，即使是很先进的CPU核，如果需要投片即制成真正的ASIC，也可以通过与集成电路制造厂家协商得到。在投片制造之前，还可以用FPGA来验证所设计的复杂数字系统的电路结构是否正确。要做到这一点首先要搞清楚1个概念：这些数字系统的基本部件、宏器件或CPU核都是用HDL语言描述的，有的使用结构级的描述；有的采用用户自定义原语UDP（即逻辑真值表）描述；有的使用寄存器传输级描述；有的使用高级行为描述。不管用哪一级别的HDL语言，它们都属于HDL语言（不是Verilog HDL,就是VHDL）。由于描述数字系统的HDL语言比较成熟，使用的年代比较长，仿真和综合工具已经成熟，开展这一领域的设计工作已没有什么大的困难。SOC的设计可以先从单纯的数字系统开始，在这个基础上再开展数模混合信号系统的设计，可节省大量投资。电子芯片的设计已经成为一种国际性的行业，许多年轻人有热情参与这一项挑战性行业。我国在提高工程教育质量的基础上，在脑力密集型知识产业方面有很大的优势。我们的电子专业大学生，大多数有很好的逻辑思维能力。关键是这项工作需要很好地组织和规划，提高各种层次模块的质量、标准化和可重用性，以减少重复劳动，达到提高国际竞争能力的目的。

为进一步减轻建模的重担，美国许多EDA公司最近纷纷引进了用于新型通信系统的部件库。据报道，这些部件库可让设计小组的成员修改模型的方程来开发各种不同的模型，所需的开发时间只是原先所需时间的一小部分，所有这些模型都与新的数模混合HDL标准兼容。例如, Mentor Graphics公司除了宣布新的部件库外，最近还透露了与Motorola公司合作搞了1个语言开发计划，旨在为SOC的开发提供1条新的途径，以激励在多种芯片的设计领域中发展混合信号的应用（包括在电磁传感器和射频通信芯片设计中），这能使工程师们从传统的以Spice为基础的模拟设计方法转到更简单的具有系统风格的自上而下的设计方法。采用这种方法就能把用不同的行为描述语言表达的混合信号部件模型放到1个设计中，来验证整个设计。许多高技术公司不但引进各种可改变参数的部件库，还在努力开发模拟数字混合SOC的设计仿真工具。下面列出国外一些公司在数模混合SOC方面最新的技术动态:

1 Cadence公司由于把新出现的Verilog-AMS标准和不同的仿真算法与分析工具以及传统的Spice网表（netlist）表示方法结合起来，这样一个仿真器（即Spectre）就可以在设计流程的不同层次上应用。Cadence公司也提供了Verilog-A的语言调试检错工具和图形用户界面。