ARM中各种异常模式的进入和返回
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入口地址
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异常
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相应的处理器模式
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LR中存储的地址*
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是否禁止IRQ
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是否禁止FIQ
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0x00
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复位异常
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svc
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N/A
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ü
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ü
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0x04
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未定义指令异常
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und
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PC-4
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ü
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0x08
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软件中断异常
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svc
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PC-4
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ü
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0x0c
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预取指中止异常
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abt
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PC
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ü
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0x10
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数据中止异常
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abt
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PC
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ü
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0x14
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保留
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ü
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0x18
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中断请求异常
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irq
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PC
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ü
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0x1c
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快速中断请求异常
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fiq
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PC
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ü
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ü
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(* 这里仅讨论三级流水线结构的ARM处理器，采用ARM指令)
1、 在进入异常时，处理器完成以下工作（由硬件完成）：
u 保存相应的地址到LR（参见上表）
u 保存CPSR到SPSR
u 修改CPSR中的：
² T位：强制进入ARM状态（相对于THUMB状态）
² I位：禁止IRQ
² M[4:0]（模式位）：进入相应的处理器模式
² F位：在复位异常和快速中断请求异常发生时，需要禁止FIQ
2、 在退出异常时，程序完成以下工作（由软件完成）：
u 恢复保护的寄存器（if necessary）
u 复制SPSR到CPSR
u 开启屏蔽的中断（if necessary）
u 从LR中获取返回地址（可能需要进行相应的计算），并赋给PC，返回
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