一个IP子系统将多种经验证的IP模块单元和完整的软件解决方案整合到一个集成化设计之中，以完成一种诸如音频、视频及图像这样的系统级功能。
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音频IP子系统 SoC 软件集成流程
本文介绍一种通用的基于CPLD的片内振荡器设计方法，它基于环形振荡器原理，只占用片上普通逻辑资源(LE)，无需使用专用逻辑资源(如MaxII中的UFM)，从而提高了芯片的资源利用率。
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片内振荡器 SoC CPLD
利用SOC/IP芯片能组成完整的智能传感器系统。智能传感器传感参数可能是多种多样的。但从功能模块组成来讲，它主要包括数据采集模块、补偿与校正模块、数据处理模块、数据网络通信模块、人机界面和任务管理与调度模块等功能单元。从而基于IP的智能传感器SOC设计过程为：首先正确建立智能传感器的通用模块模型；然后合理划分各摸块功能规范，制定各模块之间的接口协议与标准；再设计出一系列通用的IP核；最后把所需的通用IP核搭建整合在一起构成完整的智能传感器系统。
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智能传感器系统 SoC IP核
如果不考虑功率问题，会导致器件性能低于预期，进而使得器件良率下降。此外，较高的功耗会要求在温度管理方面采取更多的系统级措施。总而言之，这些功率问题正在造成SoC和系统成本的增加。在SoC设计流程中进行功耗管理，能够有效控制这些成本。
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功率管理 功耗分析 SoC
作为SoC在移动通信控制的分支，移动操作SoC和一般的SoC在设计上是相似的。作为一个系统的核心，SoC要完成运行、操作或控制功能，必须有相应的组件配合。而多数组件，尤其是外部组件在SoC内都要有一个对应的控制器。所以，为了实现应用对象操作，SoC要设计相当数量的组件控制器。组件控制器的设计，对SoC而言就是一些IP（Intellectual Property）组件的设计。由于可编程器件PLD具有简单易学、修改方便的特点，常常被用来作为设计IP组件的硬件支撑。
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SoC 移动计算 无线通信
预制与定制FPGA式原型板加入协同仿真(co-emulatiON and co-simulation)功能，能够提供高速、高能见度平台，实现SoC的快速、早期验证。
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硬件辅助验证 SoC 硬件仿真
本文讨论电子系统级(ESL)设计和验证方法学在系统级芯片(SoC)设计中的应用。ESL设计是能够让SoC设计工程师以紧密耦合方式开发、优化和验证复杂系统架构和嵌入式软件的一套方法学，它还提供下游寄存器传输级(RTL)实现的验证基础。已有许多世界领先的系统和半导体公司采用ESL设计。他们利用ESL开发具有丰富软件的多处理器器件，这些器件为创新终端产品获得成功提供必需的先进功能性和高性能。
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架构师视图 时序捕获 SoC
假设设计的某个时钟驱动了大量触发器，以至它们的峰值开关动作超过设计的总体功率预算。我们不希望测试逻辑去改变任何时钟，相反我们将设计分割成N个模块，各模块具有自己的扫描启动引脚，并且包含自己的扫描压缩逻辑和扫描链。(如图2所示)模块的数量和组成需要仔细选取，以便任何单个模块(包括具有大部分触发器的模块)的触发器开关速率不超过总功率预算。从这方面讲，可以认为分割将功率预算硬连(hardwire)进了设计。
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ATPG 数字电路设计 SoC DFT
随着ARM架构处理器在移动市场的崛起，Intel所坚持的x86架构似乎被认为是错的，一直以来也有不少人坚持这样的观点，Seeking Alpha作者Ashraf Eassa近日却撰文表示，ARM是错的，ARM在PC领域和服务器领域会很快消亡，而Intel则将在平板和手机领域获得更多的份额
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SoC 移动处理器 智能手机 ARM架构处理器
SOC技术是当前大规模集成电路（VLSI）的发展趋势，也是世纪集成电路技术的主流，其为集成电路产业和集成电路应用技术提供了前所未有的广阔市场和难得的发展机遇。SOC为微电子应用产品研究、开发和生产提供了新型的优秀的技术方法和工具，也是解决电子产品开发中的及时上市（TTM——Time to Market）的主要技术与方法。
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SoC 集成开发环境 VLSI 嵌入式系统 处理器
带有多个处理单元的soc器件目前是产品设计链上的重要一环。本文综合各种因素评估了不同处理单元的优缺点，并通过卫星无线电接收器的设计实例帮助开发人员理解soc所涉及处理任务之间的复杂平衡并有效掌握系统功
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微处理器 SoC
给出了嵌入式Wi-Fi系统的设计方法,该方法采用的嵌入式Wi-Fi单芯片AX22001/11属于内置802.11无线网MAC/基带的单片式TCP/IP微处理器,同时包含兼容802.11a/b/g的无线网MAC/基带、快速以太网MAC及丰富的通信外设,可用于各类需要接入有线/无线以太网、局域网/互联网和物联网的电路设计,文章同时给出了几种基于AX22001/11的应用系统电路设计方案。
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音频信号传输 TCP/IP Wi-Fi
每一种标准2.4GHz联网技术都进行了必要的设计折衷来减小干扰的影响或完全避免干扰。设计者可通过以下方法将其系统设计成具有频率捷变性，即：使用由正在实施的标准所提供的步骤、或采用本文所提到的方法并结合诸如RSSI的无线电特性来构建其自己的协议等，通过这些方法可使产品在当前恶劣的2.4GHz ISM频段环境下良好地工作。
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干扰 Wi-Fi
Layerscape架构是下一代QorIQ LS系列片上系统（SoC）的底层系统架构。从一开始便旨在充分利用新的开发、提取和效率现实条件（从字面的双重含义理解），Layerscape架构的创建是为了让程序员找到极为轻松的方式“释放”每一块芯片的性能。
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Layerscape QorIQLS SoC 数据路径加速 DPAA
当今的网络世界，商务人士必须在返回办公室之前就开始工作。此时，他必须连上最近的无线区域网络(Wi-Fi) 热点，然后等待、等待、再等待。这种经验是家常便饭，或许可以称之为“Wi-Fi挫折症候群”。有几点原因造成此问题。在大多数情况，网络设计者安装的存 取点(AP)过少，以至于无法服务许多使用者。
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MU-MIMO 802.11ac Wi-Fi 波束成型技
wi-fi soc介绍
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