- 基于verilog的FPGA编程经验总结-用了半个多月的ISE，几乎全是自学起来的，碰到了很多很多让人DT好久的小问题，百度也百不到，后来还是都解决了，为了尽量方便以后的刚学ISE的童鞋不再因为一些小问题而纠结，把这几天的经验总结了一下。好了，废话不多说，上料！
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verilog FPGA
- 多核处理器会取代FPGA吗？-有人认为诸如图形处理器（GPU）和Tilera处理器等多核处理器在某些应用中正逐步替代现场可编程门陈列（FPGA）。理由是这些多核处理器的处理性能要高很多，例如，由于GPU起初主要负责图形绘制，因此，其尤其善于处理单精度（SP）及（某种情况下）双精度（DP）浮点（FP）运算。
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FPGA GPU Tilera
- 7 50T 入门级FPGA评估套件上手评测-FPGA即现场可编程门阵列，属于可编程逻辑器件的一种。随着工艺的进步和EDA设计工具的不断发展，FPGA的门槛（学习成本和价格成本）也越来越低，目前已经成为实现数字系统的主流平台之一。
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FPGA 可编程逻辑 Xilinx
- FPGA的快速入门经验谈（part1）-有很多年轻人，被割裂了历史，被荒废了未来，迷茫， 迷茫到几乎绝望，不过，他们还年轻，青春尚存，还有创造力，还有奋斗的资本，其中不乏不甘心被抛弃，被覆盖之人。
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FPGA 单片机
- FPGA开发技巧之同步复位与异步复位的理解-前两天和师兄讨论了一下design rule其中提到了同步异步复位的比较这个常见问题，据说也是IC公司经常问到的一面试题。
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FPGA 同步复位 异步复位
- 详细图解在NetFPGA上创建一个OpenFlow Switch的网络-Author: KiKiCompany：Digilent ChinaEmail : Date: 2012.02.14 目的 如 图所示，我们会创建一个基于OpenFlow Switch的网络。
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FPGA NetFPGA
- 用FPGA实现MAC核所要完成的功能-MAC发送模块可将上层协议提供的数据封装之后通过MII接口发送给PHY。
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FPGA MAC MII
- FPGA verilog实现的1602时钟计数器-网上很少用人公开这一类代码，一搜FPGA 1602，都是写一个静态的显示，在实际应用中，是没有用的，因此这个简单的例子，给大家抛砖引玉了！
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FPGA 1602时钟计数器
- 如何使用PlanAhead/Adept加速管脚排布-在排布FPGA管脚生成ucf文件的过程中，当FPGA管脚较多的时候，手工排布管脚不仅效率低，而且很容易出错。借助PlanAhead和Adept等工具，可以很方便快速的实现管脚排布。
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PlanAhead Adept FPGA
- 组合逻辑设计中的毛刺现象-和所有的数字电路一样，毛刺也是FPGA电路中的棘手问题，它的出现会影响电路工作的稳定性，可靠性，严重时会导致整个数字系统的误动作和逻辑紊乱。
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毛刺 FPGA 电路
- FPGA管脚分配时需注意的一些事项-设计过FPGA的原理图，看FPGA的手册，说管脚的分配问题，如时钟管脚要用GC类管脚，而且单端时钟输入时要用P类型的管脚，不能用N类型管脚等等。
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FPGA
- 学习FPGA需要注意的几个重要问题-如何学好FPGA呢，很多人很困惑，多数停留在基础位置徘徊，我就这方面问题给大家谈几点自己的看法。
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FPGA 数字电路 HDL语言
- FPGA专家教您如何在FPGA设计中使用HLS-Luke Miller并非一开始就是HLS（高层次综合）的倡导者。在使用早期的工具版本的时候，他似乎有过一些糟糕的经历。
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FPGA HLS
- 深度学习算法有望在FPGA和超级计算机上运行-由NSF资助的一个研究项目，目前正在研究如何使用RDMA高性能连接器将深度学习算法在FPGA和跨系统之间运行；另一个由Andrew Ng和两个超算专家牵头的项目，则希望把模型放在超级计算机上，给它们一个Python接口。
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FPGA 深度学习 人工智能
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