- FPGA实战开发技巧（11）-在串行模式下，需要微处理器或微控制器等外部主机通过同步串行接口将配置数据串行写入FPGA芯片，其模式选择信号M[2:0]=3’b111
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FPGA 赛灵思
- FPGA中的多时钟域设计-在一个SOC设计中，存在多个、独立的时钟，这已经是一件很平常的事情了。大多数的SOC器件都具有很多个接口，各个接口标准都可能会使用完全不同的时钟频率。
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FPGA 多时钟域
- 组合运用多种智能I/O规划工具能使引脚分配过程变轻松-对于需要在PCB板上使用大规模FPGA器件的设计人员来说，I/O引脚分配是必须面对的众多挑战之一。
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赛灵思 FPGA
- FPGA与单片机实现数据串行通信的解决方案-本文针对由FPGA构成的高速数据采集系统数据处理能力弱的问题，提出FPGA与单片机实现数据串行通信的解决方案。
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FPGA 串行通信
- FPGA与DSPs高速互联的方案-DSP与FPGA高速的数据传输有三种常用接口方式: EMIF, HPI 和 McBSP 方式。而采用 EMIF 接口方式, 利用 FPGA ( 现场可编程逻辑门阵列) 设计 FIFO的接口电路，即可实现高速互联。
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FPGA DSPs
- FPGA设计中对输入信号的处理-一般来说，在全同步设计中，如果信号来自同一时钟域，各模块的输入不需要寄存。只要满足建立时间，保持时间的约束，可以保证在时钟上升沿到来时，输入信号已经稳定，可以采样得到正确的值。
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FPGA 全同步设计
- 3系列FPGA中使用LUT构建分布式RAM(4)-前面讲了分布式RAM的方方面面，下面以RAM_16S为例，分别给出其在VHDL和Verilog HDL下面的模板代码（在ISE Project Navigator中选择 Edit--- Language Templates，然后选择VHDL 或者Verilog, 最后是Synthesis Templates --- RAM，在中也有具体调用过程的描述）
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FPGA LUT RAM
- 3系列FPGA中使用LUT构建分布式RAM（3）-前面简要介绍了Spartan-3系列FPGA中分布式RAM的基本特性。为什么不从更高级的Virtex系列入手呢？我仔细看了一下各个系列的介绍、对比，Spartan系列基本就是Virtex系列的精简版，其基本原理是一样的，所以从简单的入手来融会贯通未尝不是一个好办法。
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FPGA LUT RAM
- 3系列FPGA中使用LUT构建分布式RAM（1）-在赛灵思Spartan-3、3E等系列的FPGA中，其逻辑单元CLB中一般含有不同数量的单端口RAM（SRAM）或者双端口RAM（DRAM），这里的“单”或者“双”是由我们开发人员定义的。
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FPGA LUT RAM
- 3系列FPGA中使用LUT构建分布式RAM（2）-带有异步写/同步读的SRAM，其中的同步读取可以使用与分布式RAM相关联的触发器实现。
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FPGA LUT RAM
- 工程师对于有关FPGA项目的九大感言-要和人配合。以我们做硬件的工程师为例，测试的时候一般都需要软件的配合，一个对硬件来说无比复杂的工作，可能在软件工程师看来就是几行简单的代码。
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FPGA
- 未来只有懂FPGA开发的人才堪称计算机专家？-由于微电子和超大规模集成电路工艺技术设备的缺失，使国人根本没有条件能够自由地进入这个领域体验，这是一个严重的问题。
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FPGA 嵌入式 计算机
- 一个合格FPGA 工程师的基本要求-一个合格的FPGA工程师需要掌握哪些知识？这里根据自己的一些心得总结一下，其他朋友可以补充啊。
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FPGA Verilog
- ARM、DSP、FPGA的区别是什么？-ARM（Advanced RISC Machines）是微处理器行业的一家知名企业，设计了大量高性能、廉价、耗能低的RISC处理器、相关技术及软件。
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ARM DSP FPGA
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