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全同步设计 文章 进入全同步设计技术社区

FPGA设计中对输入信号的处理

  • FPGA设计中对输入信号的处理-一般来说，在全同步设计中，如果信号来自同一时钟域，各模块的输入不需要寄存。只要满足建立时间，保持时间的约束，可以保证在时钟上升沿到来时，输入信号已经稳定，可以采样得到正确的值。
  • 关键字： FPGA  全同步设计  
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