- FPGA/CPLD能做什么呢？可以毫不夸张的讲，FPGA/CPLD能完成任何数字器件的功能，上至高性能CPU,下至简单的74电路，都可以用FPGA/CPLD来实现。FPGA/CPLD如同一张白纸或是一堆积木，工程师可以通过传统的原理图输入法，
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CPLD FPGA
- FPGA的基础就是数字电路和HDL语言，想学好FPGA的人，建议床头都有一本数字电路的书，不管是哪个版本的，这个是基础，多了解也有助于形成硬件设计的思想。在语言方面，建议初学者学习Verilog语言，VHDL语言语法规范严格，调试起来很慢，Verilog语言容易上手，而且，一般大型企业都是用Verilog语言。
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赛灵思 FPGA HDL
- 目前以硬件描述语言(Verilog 或 VHDL)所完成的电路设计，可以经过简单的综合与布局，快速的烧录至 FPGA 上进行测试，是现代 IC 设计验证的技术主流。这些可编辑元件可以被用来实现一些基本的逻辑门电路(比如AND、OR、XOR、NOT)或者更复杂一些的组合功能比如解码器或数学方程式。在大多数的FPGA里面，这些可编辑的元件里也包含记忆元件例如触发器(Flip-flop)或者其他更加完整的记忆块。
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赛灵思 FPGA Verilog
- 何一个从事后看来很成功的新事物从诞生到发展壮大都不可避免地经历过艰难的历程并可能成为被研究的案例，FPGA也不例外。
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赛灵思 FPGA XC2064
- ASIC 和 FPGA 具有不同的价值主张，在作出选择前必须仔细评估。两种种技术对比。这里介绍了 ASIC 和 FPGA 的优势与劣势:
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赛灵思 ASIC FPGA
- 现场可编程门阵列 (FPGA) 是由通过可编程互连连接的可配置逻辑块 (CLB) 矩阵构成的可编程半导体器件。相对于专为特定设计定制构建的专用集成电路 (ASIC) 而言，FPGA 能通过编程来满足应用和功能要求。
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赛灵思 FPGA ASIC
- 在调试FPGA电路时要遵循一定的原则和技巧，才能减少调试时间，避免误操作损坏电路。一般情况下，可以参考以下步骤进行FPGA硬件系统的调试。
（1）首先在焊接硬件电路时，只焊接电源部分。使用万用表进行测试，排除电
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FPGA 调试 硬件系统 方法
- 本文首先简略介绍了几种当前对Virtex 系列FPGA 进行配置的方式和其不足之处， 在此基础上提出了一种使用微处理器读取SD 卡中的配置数据，并通过SELECTMAP 接口 对FPGA 进行配置的方案，并辅以电路图和工作流程图，以及配置数据在SD 卡中的存储方 式进行说明。采用此配置方案可以使产品更新只涉及到修改SD 卡中的数据，方便灵活，有 利于降低大规模产品升级时的成本，适用于通信、工控等多个领域。
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Virtex FPGA SD卡 方案
- 1．引言SPI-4.2（System Packet Interface）是 OIF（Optical Internetworking Forum）定义的局部高速总线标准，用于 PHY层芯片到链路层芯片的 10Gbps信号传输。主要应用有 OC-192 ATM、Packet over SONET/SDH（POS）
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FPGA 4.2 SPI 接口设计
- 莱迪思半导体公司今日宣布发布Lattice Diamond设计软件的1.4版本，这是适用于莱迪思FPGA产品的设计环境。Lattice Diamond 1.4软件的用户将得益于几大实用的增强功能，使得FPGA设计探索更容易并且缩短产品上市时间。
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莱迪思 FPGA Lattice Diamond 1.4
- Altera公司今天宣布，成功实现28-nm Stratix V GX FPGA与PLX技术公司ExpressLane PCI Express (PCIe) Gen3的互操作。Stratix V GX FPGA具有硬核PCIe Gen3 IP模块，是目前发售的能够与PCIe Gen3交换机实现互操作的唯一一款FPGA。
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Altera FPGA
- 全球可编程平台领导厂商赛灵思公司 (Xilinx, Inc. ) 今天宣布向客户交付首批 Zynq-7000 可扩展处理平台 (EPP)，这是其完整嵌入式处理平台发展战略的一个重大里程碑，率先为开发人员提供堪比ASIC 的性能与功耗，FPGA 的灵活性以及微处理器的可编程性。
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赛灵思 FPGA Zynq-7000
- 在舞台机械设备中，吊杆起着重要的伤脑筋。在大型的影剧院，一场演出往往需要调动大量的舞台背景，有时要控制 ...
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单片机 FPGA 舞台吊杆控制器
- 摘要 直接序列扩频通信系统以强抗噪声、低截获性和多址通信等特点，在军事及民用移动通信网络中得到广泛应用。文中对直序扩频的FPGA实现技术进行了研究。以QuartusII为开发工具，建立了一个初步的直接序列扩频通信系
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实现 FPGA 研究 扩频
- 1 引言 在数字化飞速发展的今天，人们对微处理器的性能要求也越来越高。作为衡量微处理器 性能的主要标准，主频和乘法器运行一次乘法的周期息息相关。因此，为了进一步提高微处 理器性能，开发高速高精度的乘法器
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FPGA 流水线 浮点 乘法器设计
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