- 基于FPGA的HDB3编解码器设计,本方案设计模块可以作为IP(Intellectual Property)核，与嵌入式处理器及其他功能模块或IP芯核相结合在一片FPGA上构成片上可编程系统SOPC，使得所设计的系统在其规模、可靠性、体积、功耗、性能等方面实现最优化。
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设计 解码器 HDB3 FPGA 基于 编解码器
- 1 前言 高速以太网可以满足新的容量需求，解决了低带宽接入、高带宽传输的瓶颈问题，扩大了应用范围，并与以前的所有以太网兼容。全双工的以太网协议并无传输距离的限制，只是在实际应用中，物理层技术限制了最
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FPGA 高速数据 中继器
- 近日，赛灵思公司在北京举办隆重的25周年庆典，并宣布推出全新一代旗舰产品系列——高性能VirtexⓇ -6和低成本SpartanⓇ -6 FPGA，同时提出了“目标设计平台”的新理念。
出席庆典和新闻发布会的有赛灵思公司产品营销高级总监Chuck Tralka，亚太区执行总裁/质量管理和
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赛灵思 Virtex FPGA
- 在移动电话市场上，手机电池寿命是一项任何客户都容易评估的技术指标。不足的电池寿命会招致用户的不满。因此，在设计手机及其关键部件时，通过降低功耗来延长电池寿命是重要的设计考虑。 但目前趋势却是沿着
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直流 电流 手机 功率放大器 RF 测量
- 摘要：本文采用FPGA器件EP1C6T144C8芯片代替单片机控制A/D转换芯片ADC0809进行采样控制，整个设计用VHDL语言描述，在QuartusⅡ平台下进行软件编程实现正确的A/D转换的工作时序控制过程，并将采样数据从二进制转化成B
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FPGA 转换 采样 控制模块
- 引言 微控制器在汽车和消费类市场上得到了广泛应用，能够以相对较低的成本实现系统高度集成。然而，这类产品也有潜在的成本问题。例如，如果元件功能不符合要求，就必须采用外部逻辑、软件或者其他集成器件
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FPGA 汽车 电子设计
- 介绍基于89S51单片机和FPGA的频率特性测试仪的设计。该系统设计利用DDS原理由FPGA经D／A转换产生扫频信号，再经待测网络实现峰值检测和相位检测，从而完成了待测网络幅频和相频特性曲线的测量和显示。经过调试，示波器显示待测网络频率范围100 Hz～100 kHz的幅频和相频特性曲线，该系统工作稳定，操作方便。
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tt 测试仪 频率 FPGA 单片机 基于 转换器
- 安富利公司 (NYSE: AVT) 旗下安富利电子元件部、The MathWorks、德州仪器(TI) 和赛灵思(Xilinx)宣布将举办为期2天的协处理SpeedWay设计研讨会(Co-Processing SpeedWay Design Workshop™)。研讨会将以最新推出的Spartan-3A DSP FPGA / DaVinci开发平台为基础，讲解如何“用基于模型化的设计方法，进行FP
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安富利 德州仪器 FPGA DSP
- 摘要： 本文阐述了通用异步发生器UART 的功能特点，介绍了用硬件描述语言Verilog 来开发各个模块，并给出仿真结果。本设计使用Altera 的FPGA 芯片，将UART 的核心功能嵌入到FPGA 内部，能够实现异步通信的功能，可以
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FPGA UART 电路设计
- 为保证线阵CCD在图像测量中正常、稳定工作，必须设计出适合其工作的时序驱动电路。在分析TCDl501D线阵CCD驱动时序关系的基础上，通过分析CCD输出的图像信号，给出了内、外相关双采样的时序控制。最后，利用quanus7．2软件平台结合VHDL语言进行开发，对所需驱动脉冲进行仿真设计。仿真结果表明，该驱动电路简单、功耗小、成本低、抗干扰能力强，适用于设备小型化的要求。
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FPGA CCD 线阵 驱动
- 简单介绍了全数字锁相环(ADPLL)的结构和工作原理，提出一种在FPGA的基础上可增大全数字锁相环同步范围的设计方法，并给出了部分verilog HDL设计程序的代码和仿真波形。
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FPGA 全数字 锁相环
- RS码是线性分组码中一种典型的纠错码，既能纠正随机错误，也能纠正突发错误，在现代通信领域越来越受到重视。文中介绍基于FPGA使用Verilog―HDL语言的RS(15，9)编码器的设计方法，并在QuartusII 5．O软件环境下进行了功能仿真，仿真结果与理论分析相一致，该设计方法对实现任意长度的RS编码有重要参考价值。
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FPGA RS编码器
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