为了使便携式心电监护仪实现友好的人机交互和更加方便的显示，这里提出一种GUI界面系统设计，就 是在基于NiosⅡ处理器的嵌入式平台上实现μC／GUI的移植，使之实现系统功能。
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IP核 μC／GUI TFTLCD
介绍了HDLC协议控制器的IP核方案及实现方法，分别对发送和接收模块进行了分析，给出了仿真波形图。该设计采用Verilog HDL语言进行描述，用ModelSim SE 6.0进行了功能仿真。
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IP核 Verilog HDLC协议控制器
利用SOC/IP芯片能组成完整的智能传感器系统。智能传感器传感参数可能是多种多样的。但从功能模块组成来讲，它主要包括数据采集模块、补偿与校正模块、数据处理模块、数据网络通信模块、人机界面和任务管理与调度模块等功能单元。从而基于IP的智能传感器SOC设计过程为：首先正确建立智能传感器的通用模块模型；然后合理划分各摸块功能规范，制定各模块之间的接口协议与标准；再设计出一系列通用的IP核；最后把所需的通用IP核搭建整合在一起构成完整的智能传感器系统。
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智能传感器系统 SoC IP核
IP核可以两种形式提供给客户：软核和硬核。两种方式都可使客户获得在功能上经过验证的设计。软核也被称为可综合内核，需要由客户进行综合并在其SoC上实现。而硬核已完全实现(完成了版图设计)，可直接用于制造。(从技术上说，一种设计只有生产后才能实现。但是在此情况下，实现的意思是指安排布局并可直接投入生产)。SoC团队只需将硬核像一个单片集成电路片那样置入芯片即可。软核和硬核具有不同的问题和好处。
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技术支持 IP核 定制
本文设计的高速数据采集系统是应用于芯片现场测试的实时数据采集系统，由于被测试芯片为250 MHz 8 bit的高速AD输出， 因此， 该数据采集系统的数据采集率是2 Gbps。为了达到实时、高速、海量的数据采集， 该系统利用DDR2 SDRAM的高速数据传输能力和海量存储能力做为采集数据的缓存，然后通过具有即插即用、易扩展、传输速率较高等特点的USB2.0接口来将DDR2 SDRAM中的数据传输到计算机中进行存储和分析。
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乒乓缓存 数据采集 IP核
设计复用技术广泛应用于当代电路设计中以提高开发效率，其中ip核的使用是设计复用的主要方式之一。由于完善ip核的开发周期长且成本高，一些国际开源组织便致力于免费ip核的开发设计和维护。电路设计人员灵活使用这些免费ip核资源将有效提供工作效率，本文以通信接口免费ip核为例介绍其使用方法，文中使用的免费资源取自opencores开源社区。
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通信接口 IP核
采用了32位微控制器TSK3000A、通用Wishbone总线规范IP核和BT656视频标准等。在FPGA软核设计时，采用了基于Openbus总线的系统设计方式，利用NB2开发验证平台，在Xilinx公司的Spartan-3系列FPGA芯片上下载实现，并接入平台进行验证。该设计的系统可以将输入的模拟视频信号处理之后显示在TFT真彩LCD屏
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TSK3000A TVP5150 视频采集 IP核
基于Altera浮点IP核实现浮点矩阵相乘运算时，由于矩阵阶数的增大，造成消耗的器件资源虽增加但系统性能反而下降的问题，针对现有IP核存在数据加载不连贯、存储带宽不均匀的不足，提出采用并行化数据存储、依据查找表加载数据和处理数据的方式对IP核进行改进。然后将改进的浮点矩阵运算在FPGA中实现，经过Quartus、Matlab软件联合仿真并进行结果比对，其误差不超过万分之一，且节省了器件资源、提升了系统性能。仿真结果表明该设计可行，有利于提高诸多高性能领域浮点矩阵的运算速度。
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IP核 浮点矩阵运算 存储方式
采用VHDL硬件描述语言，以Xilinx公司的FPGA为设计平台，设计实现了以开源软核MC8051为核心的控制单元，控制4路SSI协议模块的SoPC架构的通信控制器，并对通信控制器进行了功能仿真与验证。该控制器可灵活进行IP核模块扩展，并可作为外围处理机与TI公司TMS320C6000系列DSP进行互连通信，将慢速串行通信任务进行分离，从而减轻DSP的负担，提高系统的整体性能。
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IP核 同步串行接口协议 SoPC架构
目前IP core以及IP core的运用是行业技术发展的一大趋势。对EDA技术实验教学中的IP core的综合运用进行了探讨。所给出的例子都是利用Xilinx的ISE软件,在其FPGA（SPARTAN3A and SPARTAN3AN系列）芯片上实现了的。文中所讨论的基本要点,对初学者如何理解设计重用和运用IP core来进行综合型实验设计是有所帮助的。
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IP核 综合实验 EDA
为解决实时性盲信号分离的问题,基于独立分量分析的模型,设计出了NLPCA-RLS算法的IP核。利用Simulink和DSP Builder对算法中用到的乘法器、查找表、状态机等进行建模,通过Quartus II综合后在Altera FPGA器件中进行硬件仿真。仿真实验分别采用人工生成的周期信号和真实的语音信号进行验证。实验结果表明,该IP核能很好的完成瞬时混合模型中盲信号的分离,具有很强的实用性。
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DSPBuilder IP核 FPGA
介绍了基于Nios II 的多功能数码相框的实现。系统基于Nios II处理器，设计用户自定义模块，构建了灵活性高、可重配置的SoPC系统。设计自定义模块控制LCM显示；采用流水线方式设计JPEG解码自定义模块以提高解码效率；根据SD协议设计SD卡控制器扩展SD卡。实现了FAT16文件系统，便于对SD卡进行文件管理及多平台上的数据交换，并使用?滋C/OS-II操作系统简化软件设计复杂度、提高系统稳定性。最终实现可播放音频并能显示、缩放、旋转图像且带有图像切换特效的多功能数码相框。
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双线性插值缩放 数码相框 IP核
本设计为基于C语言开发的程序开发了一个FPGA的并行计算接口，凡是以C语言设计的程序，均可通过调用本设计的接口，把复杂的算法、数值处理交给FPGA芯片完成，在不需要程序员学习FPGA知识以及使用FPGA开发工具的前提下，大大地减轻CPU的负荷以及从根本上提高了程序的执行效率，是FPGA并行化应用的一次全新尝试。
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IP核 调度模块 FPGA PCI设备驱动 Express总线
LCD显示屏的应用越来越广，数量越来越多。LCD显示屏应用广泛,无处不在。如家庭各种电器设备。更常见是用于各种公共场合如体育馆、广场等商业用途。给我们传递一种更为直观、生动的信息。从此我们的生活发生了巨大改变。巨大的应用巨大的市场带来了巨大的商机。基于FPGA的LCD显示的3D影像是为了LCD显示屏的信息量更多，满足人需求。
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IP核 3D图像处理器 FPGA LCD Verilog
本模块采用xilinx公司的Spartan 3E系列XC3S500E型FPGA作为核心控制芯片，对采集到底模拟信号进行数字转换后通过3DES算法进行加密、然后通过网络传输，再经过解密算法解密出明文数据。
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信息安全系统 RAM IP核 FPGA 乒乓操作
ip核介绍
IP核概述
IP核则是一段具有特定电路功能的硬件描述语言程序，该程序与集成电路工艺无关，可以移植到不同的半导体工艺中去生产集成电路芯片。利用IP核设计电子系统，引用方便，修改基本元件的功能容易。具有复杂功能和商业价值的IP核一般具有知识产权，尽管IP核的市场活动还不规范，但是仍有许多集成电路设计公司从事IP核的设计、开发和营销工作。IP核有两种，与工艺无关的VHDL程序称为软核；具有特定电路 [
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