- 基于Verilog简易UART的FPGA/CPLD实现,目标：在xo640上实现一个简单的Uart，能够解析串口数据，并在寄存器中存储，用FIFO实现数据的传递。那么后期可以通过开发板上的串口经CPLD访问各种数据。比如PC=CPLD=EEPROM等等，极大方便后期的开发和调试。
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FPGA/CPLD 实现 UART 简易 Verilog 基于
- 摘要：FPGA既具有门阵列的高逻辑密度和高可靠性，又具有可编程逻辑器件的用户可编程性，可以减少系统的设计和维护风险，降低产品成本，缩短设计周期。文中给出了利用FPGA设计汉明距离的计算电路，同时给出与通过有效
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FPGA 汉明距离 电路
- 基于FPGA嵌入式系统的雷达目标模拟器的设计,人为地对雷达进行测试时，有时只对雷达的某个和某些参数感兴趣，希望在回波中表征感兴趣的参数强一些，这时就应该在回波中去掉杂波和噪声的影响，而这在实际的外场试飞过程中是不可能实现的，这也是雷达信号模拟器对
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目标 模拟器 设计 雷达 系统 FPGA 嵌入式 基于
- 引言 目前，市场上的中小规模LED显示系统，一般采用传统的单片机作为主控芯片。对LED大屏幕显示屏来说，由于数据传输量大，要求扫描速度快，而单片机内部的资源较少、运行速度较慢，难于满足系统要求。以FPGA
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显示屏 控制系统 图文 LED MCU FPGA 基于
- 摘要：在现代数字通信系统中，为了扩大信道的传输容量提高信号传输效率，常采用数字复接的技术。在分析了PCM30／32...
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FPGA PCM30 信号同步
- 研究了雷达多目标模拟系统中数字射频存储(DRFM)单元的设计与实现，根据模拟系统的设计要求, 提出一种基于高性能 FPGA数字射频存储单元设计方法；着重阐述了数字射频存储单元的设计思路, 给出了系统的设计方案, 并对系统中雷达模拟目标的各功能模块进行了分析，实验结果表明，所设计的DRFM满足设计系统要求。
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FPGA DRFM 雷达 多目标
- FPGA与单片机实现低频数字式相位测量仪,摘要：提出了以AVR ATmega128单片机和Altera公司的Cyclone系列EP1C3T100为核心的系统设计方案。分析了数字式低频相位测量仪的测量原理和测量误差及其消除的方法。主要介绍了系统的软硬件设计。实践表明，此方案设计的
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数字式相位 测量仪 低频 实现 单片机 FPGA
- 基于TMS320C6416与FPGA的实时光电图像识别系统,光电混合模式识别以其高速并行处理和无串扰的优点成为实现模式识别实用化和实时化的重要途径，其在目标识别、指纹识别、光纤检测、工业零件识别、汽车牌照识别等领域得到了广泛的研究和应用[1.2]，并取得了很好的识别
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图像 识别 系统 光电 实时 TMS320C6416 FPGA 基于
- FPGA设计中毛刺信号解析,在FPGA的设计中，毛刺现象是长期困扰电子设计工程师的设计问题之一, 是影响工程师设计效率和数字系统设计有效性和可靠性的主要因素。由于信号在FPGA的内部走线和通过逻辑单元时造成的延迟,在多路信号变化的瞬间，组合
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解析 信号 毛刺 设计 FPGA
- 摘要：为了降低超声波流量检测过程中噪声对检测精度的影响，采用FPGA器件构建了FIR滤波器，并提出一种新颖的查表法替代滤波器中的乘法运算。试验结果表明，该滤波器设计方法显著降低了FPGA的片内硬件开销，提高了滤波
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FPGA 超声波 信号处理
- 摘要：在现代数字通信系统中，为了扩大信道的传输容量提高信号传输效率，常采用数字复接的技术。在分析了PCM30／32路系统基群信号帧结构的基础上，以EDA综合仿真设计软件QuartusⅡ8．0为开发平台，利用Verilog HDL硬
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FPGA PCM 30 系统
- 摘要：基于长期演进(LTE)的Tail-biting卷积码，介绍了维特比译码算法，它是一种最优的卷积码译码算法。由于Tail-biting卷积码的循环特性，采用固定延迟译码的方法，降低了译码复杂度。通过使用全并行的结构及简单的回
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FPGA LTE 卷积码 译码器
- I2C总线作为一种事实上的国际标准，在超过100种不同的IC上实现并且得到超过50家公司的许可。它具有连线少，结构简单的特点。本文介绍了一种高速I2C从器件接口电路IP核设计。在系统应用中，单片机作为主控器件，本IP核作为从器件中的接口电路，它们通过I2C总线相连，实现MCU对IC或FPGA中相关寄存器的访问。从而代替了MCU通用的地址数据接口，大大减少了IC或FPGA的管脚数量，节省了I/O资源，这对于I/O资源紧张的IC设计和FPGA开发是非常有意义的。
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FPGA I2C总线 IP核 201107
- 当今社会无线通信迅猛发展，无线通信用户激增，要解决通信系统容量、带宽限制等这些严重问题的一个关键技术就是多天线通信技术。这项技术的使用能大幅度地提高无线通信系统的频谱效率和链路可靠性，与单天线系统相比，用多天线系统发射和接收信号能获得阵列增益(或称波束形成增益)、分集增益、多路复用增益和干扰抑制等优势。然而多天线技术带来诸多优势的同时会不可避免地引起通道不一致性问题[1]。在实际工程应用中，阵列接收机的多个通道由于PCB(印制电路板)走线长度不等、通道特性存在差异等硬件的非理想因素，导致多个通道接收到的
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FPGA，Xilinx 201107
- 摘要：为了缩短卷积编码器设计周期，使硬件设计更具灵活性，在介绍卷积编码器原理的基础上，论述了一种基于可编程逻辑器件，采用模块化设计方法，利用VHDL硬件描述语言实现CDMA2000系统前向链路卷积编码器的方法，给
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FPGA 实现 编码器 链路 系统 CDMA
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